xref: /linux/scripts/dtc/include-prefixes/dt-bindings/reset/qcom,ipq9650-gcc.h (revision b2128290c29902315e632ea59e0504d6bc9e9b42)

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#ifndef _DT_BINDINGS_RESET_IPQ_GCC_IPQ9650_H
#define _DT_BINDINGS_RESET_IPQ_GCC_IPQ9650_H

#define GCC_ADSS_BCR						0
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#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR			2
#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_GPLL0_CLK_ARES		3
#define GCC_APSS_AHB_CLK_ARES					4
#define GCC_APSS_ATB_CLK_ARES					5
#define GCC_APSS_AXI_CLK_ARES					6
#define GCC_APSS_TS_CLK_ARES					7
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#define GCC_BOOT_ROM_BCR					9
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#define GCC_CMN_12GPLL_APU_CLK_ARES				11
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#define GCC_CMN_LDO_CLK_ARES					14
#define GCC_CPUSS_TRIG_CLK_ARES					15
#define GCC_GP1_CLK_ARES					16
#define GCC_GP2_CLK_ARES					17
#define GCC_GP3_CLK_ARES					18
#define GCC_MDIO_AHB_CLK_ARES					19
#define GCC_MDIO_BCR						20
#define GCC_NSSCC_CLK_ARES					21
#define GCC_NSSCFG_CLK_ARES					22
#define GCC_NSSNOC_ATB_CLK_ARES					23
#define GCC_NSSNOC_MEMNOC_1_CLK_ARES				24
#define GCC_NSSNOC_MEMNOC_CLK_ARES				25
#define GCC_NSSNOC_NSSCC_CLK_ARES				26
#define GCC_NSSNOC_PCNOC_1_CLK_ARES				27
#define GCC_NSSNOC_QOSGEN_REF_CLK_ARES				28
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#define GCC_NSSNOC_SNOC_CLK_ARES				30
#define GCC_NSSNOC_TIMEOUT_REF_CLK_ARES				31
#define GCC_NSSNOC_XO_DCD_CLK_ARES				32
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#define GCC_PCIE0_AUX_CLK_ARES					38
#define GCC_PCIE0_AUX_RESET					39
#define GCC_PCIE0_AXI_M_CLK_ARES				40
#define GCC_PCIE0_AXI_M_RESET					41
#define GCC_PCIE0_AXI_M_STICKY_RESET				42
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#define GCC_PCIE0_AXI_S_CLK_ARES				44
#define GCC_PCIE0_AXI_S_RESET					45
#define GCC_PCIE0_AXI_S_STICKY_RESET				46
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#define GCC_USB_BCR						203
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#endif