xref: /linux/scripts/dtc/include-prefixes/dt-bindings/reset/qcom,ipq5210-gcc.h (revision e65f4718a577fcc84d40431f022985898b6dbf2e)

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#ifndef _DT_BINDINGS_RESET_IPQ_GCC_IPQ5210_H
#define _DT_BINDINGS_RESET_IPQ_GCC_IPQ5210_H

#define GCC_ADSS_BCR						0
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#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR			2
#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_GPLL0_ARES		3
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#define GCC_APSS_AXI_ARES					6
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#define GCC_BOOT_ROM_BCR					9
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#define GCC_GP3_ARES						14
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#define GCC_MDIO_BCR						16
#define GCC_MDIO_GEPHY_AHB_ARES					17
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#define GCC_NSS_TS_ARES						19
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#define GCC_NSSCFG_ARES						21
#define GCC_NSSNOC_ATB_ARES					22
#define GCC_NSSNOC_MEMNOC_1_ARES				23
#define GCC_NSSNOC_MEMNOC_ARES					24
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#define GCC_NSSNOC_PCNOC_1_ARES					26
#define GCC_NSSNOC_QOSGEN_REF_ARES				27
#define GCC_NSSNOC_SNOC_1_ARES					28
#define GCC_NSSNOC_SNOC_ARES					29
#define GCC_NSSNOC_TIMEOUT_REF_ARES				30
#define GCC_NSSNOC_XO_DCD_ARES					31
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#define GCC_PCIE0_AXI_M_ARES					34
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#define GCC_PCIE0_AXI_S_ARES					36
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#define GCC_PCIE1_AXI_S_BRIDGE_ARES				45
#define GCC_PCIE1_AXI_S_ARES					46
#define GCC_PCIE1_BCR						47
#define GCC_PCIE1_LINK_DOWN_BCR					48
#define GCC_PCIE1_PHY_BCR					49
#define GCC_PCIE1_PIPE_ARES					50
#define GCC_PCIE1PHY_PHY_BCR					51
#define GCC_QRNG_AHB_ARES					52
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#define GCC_USB0_PIPE_ARES					93
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#define GCC_USB3PHY_0_PHY_BCR					95
#define GCC_USB_BCR						96
#define GCC_PCIE0_PIPE_RESET					97
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#define GCC_UNIPHY2_XPCS_ARES					115
#define GCC_QDSS_BCR						116

#endif