10fadcdfdSBjorn Andersson /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ 20fadcdfdSBjorn Andersson /* 30fadcdfdSBjorn Andersson * Copyright (c) 2018-2019, The Linux Foundation. All rights reserved. 40fadcdfdSBjorn Andersson * Copyright (c) 2021, Linaro Ltd. 50fadcdfdSBjorn Andersson */ 60fadcdfdSBjorn Andersson 70fadcdfdSBjorn Andersson #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SC8180X_H 80fadcdfdSBjorn Andersson #define _DT_BINDINGS_CLK_QCOM_GCC_SC8180X_H 90fadcdfdSBjorn Andersson 100fadcdfdSBjorn Andersson #define GCC_AGGRE_NOC_PCIE_TBU_CLK 0 110fadcdfdSBjorn Andersson #define GCC_AGGRE_UFS_CARD_AXI_CLK 1 120fadcdfdSBjorn Andersson #define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK 2 130fadcdfdSBjorn Andersson #define GCC_AGGRE_UFS_PHY_AXI_CLK 3 140fadcdfdSBjorn Andersson #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 4 150fadcdfdSBjorn Andersson #define GCC_AGGRE_USB3_MP_AXI_CLK 5 160fadcdfdSBjorn Andersson #define GCC_AGGRE_USB3_PRIM_AXI_CLK 6 170fadcdfdSBjorn Andersson #define GCC_AGGRE_USB3_SEC_AXI_CLK 7 180fadcdfdSBjorn Andersson #define GCC_BOOT_ROM_AHB_CLK 8 190fadcdfdSBjorn Andersson #define GCC_CAMERA_HF_AXI_CLK 9 200fadcdfdSBjorn Andersson #define GCC_CAMERA_SF_AXI_CLK 10 210fadcdfdSBjorn Andersson #define GCC_CFG_NOC_USB3_MP_AXI_CLK 11 220fadcdfdSBjorn Andersson #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK 12 230fadcdfdSBjorn Andersson #define GCC_CFG_NOC_USB3_SEC_AXI_CLK 13 240fadcdfdSBjorn Andersson #define GCC_CPUSS_AHB_CLK 14 250fadcdfdSBjorn Andersson #define GCC_CPUSS_AHB_CLK_SRC 15 260fadcdfdSBjorn Andersson #define GCC_CPUSS_RBCPR_CLK 16 270fadcdfdSBjorn Andersson #define GCC_DDRSS_GPU_AXI_CLK 17 280fadcdfdSBjorn Andersson #define GCC_DISP_HF_AXI_CLK 18 290fadcdfdSBjorn Andersson #define GCC_DISP_SF_AXI_CLK 19 300fadcdfdSBjorn Andersson #define GCC_EMAC_AXI_CLK 20 310fadcdfdSBjorn Andersson #define GCC_EMAC_PTP_CLK 21 320fadcdfdSBjorn Andersson #define GCC_EMAC_PTP_CLK_SRC 22 330fadcdfdSBjorn Andersson #define GCC_EMAC_RGMII_CLK 23 340fadcdfdSBjorn Andersson #define GCC_EMAC_RGMII_CLK_SRC 24 350fadcdfdSBjorn Andersson #define GCC_EMAC_SLV_AHB_CLK 25 360fadcdfdSBjorn Andersson #define GCC_GP1_CLK 26 370fadcdfdSBjorn Andersson #define GCC_GP1_CLK_SRC 27 380fadcdfdSBjorn Andersson #define GCC_GP2_CLK 28 390fadcdfdSBjorn Andersson #define GCC_GP2_CLK_SRC 29 400fadcdfdSBjorn Andersson #define GCC_GP3_CLK 30 410fadcdfdSBjorn Andersson #define GCC_GP3_CLK_SRC 31 420fadcdfdSBjorn Andersson #define GCC_GP4_CLK 32 430fadcdfdSBjorn Andersson #define GCC_GP4_CLK_SRC 33 440fadcdfdSBjorn Andersson #define GCC_GP5_CLK 34 450fadcdfdSBjorn Andersson #define GCC_GP5_CLK_SRC 35 460fadcdfdSBjorn Andersson #define GCC_GPU_GPLL0_CLK_SRC 36 470fadcdfdSBjorn Andersson #define GCC_GPU_GPLL0_DIV_CLK_SRC 37 480fadcdfdSBjorn Andersson #define GCC_GPU_MEMNOC_GFX_CLK 38 490fadcdfdSBjorn Andersson #define GCC_GPU_SNOC_DVM_GFX_CLK 39 500fadcdfdSBjorn Andersson #define GCC_NPU_AT_CLK 40 510fadcdfdSBjorn Andersson #define GCC_NPU_AXI_CLK 41 520fadcdfdSBjorn Andersson #define GCC_NPU_AXI_CLK_SRC 42 530fadcdfdSBjorn Andersson #define GCC_NPU_GPLL0_CLK_SRC 43 540fadcdfdSBjorn Andersson #define GCC_NPU_GPLL0_DIV_CLK_SRC 44 550fadcdfdSBjorn Andersson #define GCC_NPU_TRIG_CLK 45 560fadcdfdSBjorn Andersson #define GCC_PCIE0_PHY_REFGEN_CLK 46 570fadcdfdSBjorn Andersson #define GCC_PCIE1_PHY_REFGEN_CLK 47 580fadcdfdSBjorn Andersson #define GCC_PCIE2_PHY_REFGEN_CLK 48 590fadcdfdSBjorn Andersson #define GCC_PCIE3_PHY_REFGEN_CLK 49 600fadcdfdSBjorn Andersson #define GCC_PCIE_0_AUX_CLK 50 610fadcdfdSBjorn Andersson #define GCC_PCIE_0_AUX_CLK_SRC 51 620fadcdfdSBjorn Andersson #define GCC_PCIE_0_CFG_AHB_CLK 52 630fadcdfdSBjorn Andersson #define GCC_PCIE_0_MSTR_AXI_CLK 53 640fadcdfdSBjorn Andersson #define GCC_PCIE_0_PIPE_CLK 54 650fadcdfdSBjorn Andersson #define GCC_PCIE_0_SLV_AXI_CLK 55 660fadcdfdSBjorn Andersson #define GCC_PCIE_0_SLV_Q2A_AXI_CLK 56 670fadcdfdSBjorn Andersson #define GCC_PCIE_1_AUX_CLK 57 680fadcdfdSBjorn Andersson #define GCC_PCIE_1_AUX_CLK_SRC 58 690fadcdfdSBjorn Andersson #define GCC_PCIE_1_CFG_AHB_CLK 59 700fadcdfdSBjorn Andersson #define GCC_PCIE_1_MSTR_AXI_CLK 60 710fadcdfdSBjorn Andersson #define GCC_PCIE_1_PIPE_CLK 61 720fadcdfdSBjorn Andersson #define GCC_PCIE_1_SLV_AXI_CLK 62 730fadcdfdSBjorn Andersson #define GCC_PCIE_1_SLV_Q2A_AXI_CLK 63 740fadcdfdSBjorn Andersson #define GCC_PCIE_2_AUX_CLK 64 750fadcdfdSBjorn Andersson #define GCC_PCIE_2_AUX_CLK_SRC 65 760fadcdfdSBjorn Andersson #define GCC_PCIE_2_CFG_AHB_CLK 66 770fadcdfdSBjorn Andersson #define GCC_PCIE_2_MSTR_AXI_CLK 67 780fadcdfdSBjorn Andersson #define GCC_PCIE_2_PIPE_CLK 68 790fadcdfdSBjorn Andersson #define GCC_PCIE_2_SLV_AXI_CLK 69 800fadcdfdSBjorn Andersson #define GCC_PCIE_2_SLV_Q2A_AXI_CLK 70 810fadcdfdSBjorn Andersson #define GCC_PCIE_3_AUX_CLK 71 820fadcdfdSBjorn Andersson #define GCC_PCIE_3_AUX_CLK_SRC 72 830fadcdfdSBjorn Andersson #define GCC_PCIE_3_CFG_AHB_CLK 73 840fadcdfdSBjorn Andersson #define GCC_PCIE_3_MSTR_AXI_CLK 74 850fadcdfdSBjorn Andersson #define GCC_PCIE_3_PIPE_CLK 75 860fadcdfdSBjorn Andersson #define GCC_PCIE_3_SLV_AXI_CLK 76 870fadcdfdSBjorn Andersson #define GCC_PCIE_3_SLV_Q2A_AXI_CLK 77 880fadcdfdSBjorn Andersson #define GCC_PCIE_PHY_AUX_CLK 78 890fadcdfdSBjorn Andersson #define GCC_PCIE_PHY_REFGEN_CLK_SRC 79 900fadcdfdSBjorn Andersson #define GCC_PDM2_CLK 80 910fadcdfdSBjorn Andersson #define GCC_PDM2_CLK_SRC 81 920fadcdfdSBjorn Andersson #define GCC_PDM_AHB_CLK 82 930fadcdfdSBjorn Andersson #define GCC_PDM_XO4_CLK 83 940fadcdfdSBjorn Andersson #define GCC_PRNG_AHB_CLK 84 950fadcdfdSBjorn Andersson #define GCC_QMIP_CAMERA_NRT_AHB_CLK 85 960fadcdfdSBjorn Andersson #define GCC_QMIP_CAMERA_RT_AHB_CLK 86 970fadcdfdSBjorn Andersson #define GCC_QMIP_DISP_AHB_CLK 87 980fadcdfdSBjorn Andersson #define GCC_QMIP_VIDEO_CVP_AHB_CLK 88 990fadcdfdSBjorn Andersson #define GCC_QMIP_VIDEO_VCODEC_AHB_CLK 89 1000fadcdfdSBjorn Andersson #define GCC_QSPI_1_CNOC_PERIPH_AHB_CLK 90 1010fadcdfdSBjorn Andersson #define GCC_QSPI_1_CORE_CLK 91 1020fadcdfdSBjorn Andersson #define GCC_QSPI_1_CORE_CLK_SRC 92 1030fadcdfdSBjorn Andersson #define GCC_QSPI_CNOC_PERIPH_AHB_CLK 93 1040fadcdfdSBjorn Andersson #define GCC_QSPI_CORE_CLK 94 1050fadcdfdSBjorn Andersson #define GCC_QSPI_CORE_CLK_SRC 95 1060fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S0_CLK 96 1070fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S0_CLK_SRC 97 1080fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S1_CLK 98 1090fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S1_CLK_SRC 99 1100fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S2_CLK 100 1110fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S2_CLK_SRC 101 1120fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S3_CLK 102 1130fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S3_CLK_SRC 103 1140fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S4_CLK 104 1150fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S4_CLK_SRC 105 1160fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S5_CLK 106 1170fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S5_CLK_SRC 107 1180fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S6_CLK 108 1190fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S6_CLK_SRC 109 1200fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S7_CLK 110 1210fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP0_S7_CLK_SRC 111 1220fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S0_CLK 112 1230fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S0_CLK_SRC 113 1240fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S1_CLK 114 1250fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S1_CLK_SRC 115 1260fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S2_CLK 116 1270fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S2_CLK_SRC 117 1280fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S3_CLK 118 1290fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S3_CLK_SRC 119 1300fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S4_CLK 120 1310fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S4_CLK_SRC 121 1320fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S5_CLK 122 1330fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP1_S5_CLK_SRC 123 1340fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S0_CLK 124 1350fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S0_CLK_SRC 125 1360fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S1_CLK 126 1370fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S1_CLK_SRC 127 1380fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S2_CLK 128 1390fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S2_CLK_SRC 129 1400fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S3_CLK 130 1410fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S3_CLK_SRC 131 1420fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S4_CLK 132 1430fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S4_CLK_SRC 133 1440fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S5_CLK 134 1450fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP2_S5_CLK_SRC 135 1460fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_0_M_AHB_CLK 136 1470fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_0_S_AHB_CLK 137 1480fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_1_M_AHB_CLK 138 1490fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_1_S_AHB_CLK 139 1500fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_2_M_AHB_CLK 140 1510fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAP_2_S_AHB_CLK 141 1520fadcdfdSBjorn Andersson #define GCC_SDCC2_AHB_CLK 142 1530fadcdfdSBjorn Andersson #define GCC_SDCC2_APPS_CLK 143 1540fadcdfdSBjorn Andersson #define GCC_SDCC2_APPS_CLK_SRC 144 1550fadcdfdSBjorn Andersson #define GCC_SDCC4_AHB_CLK 145 1560fadcdfdSBjorn Andersson #define GCC_SDCC4_APPS_CLK 146 1570fadcdfdSBjorn Andersson #define GCC_SDCC4_APPS_CLK_SRC 147 1580fadcdfdSBjorn Andersson #define GCC_SYS_NOC_CPUSS_AHB_CLK 148 1590fadcdfdSBjorn Andersson #define GCC_TSIF_AHB_CLK 149 1600fadcdfdSBjorn Andersson #define GCC_TSIF_INACTIVITY_TIMERS_CLK 150 1610fadcdfdSBjorn Andersson #define GCC_TSIF_REF_CLK 151 1620fadcdfdSBjorn Andersson #define GCC_TSIF_REF_CLK_SRC 152 1630fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_AHB_CLK 153 1640fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_AXI_CLK 154 1650fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_AXI_CLK_SRC 155 1660fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_ICE_CORE_CLK 156 1670fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_ICE_CORE_CLK_SRC 157 1680fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_PHY_AUX_CLK 158 1690fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_PHY_AUX_CLK_SRC 159 1700fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_RX_SYMBOL_0_CLK 160 1710fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_RX_SYMBOL_1_CLK 161 1720fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_TX_SYMBOL_0_CLK 162 1730fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_UNIPRO_CORE_CLK 163 1740fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_UNIPRO_CORE_CLK_SRC 164 1750fadcdfdSBjorn Andersson #define GCC_UFS_CARD_AHB_CLK 165 1760fadcdfdSBjorn Andersson #define GCC_UFS_CARD_AXI_CLK 166 1770fadcdfdSBjorn Andersson #define GCC_UFS_CARD_AXI_CLK_SRC 167 1780fadcdfdSBjorn Andersson #define GCC_UFS_CARD_AXI_HW_CTL_CLK 168 1790fadcdfdSBjorn Andersson #define GCC_UFS_CARD_ICE_CORE_CLK 169 1800fadcdfdSBjorn Andersson #define GCC_UFS_CARD_ICE_CORE_CLK_SRC 170 1810fadcdfdSBjorn Andersson #define GCC_UFS_CARD_ICE_CORE_HW_CTL_CLK 171 1820fadcdfdSBjorn Andersson #define GCC_UFS_CARD_PHY_AUX_CLK 172 1830fadcdfdSBjorn Andersson #define GCC_UFS_CARD_PHY_AUX_CLK_SRC 173 1840fadcdfdSBjorn Andersson #define GCC_UFS_CARD_PHY_AUX_HW_CTL_CLK 174 1850fadcdfdSBjorn Andersson #define GCC_UFS_CARD_RX_SYMBOL_0_CLK 175 1860fadcdfdSBjorn Andersson #define GCC_UFS_CARD_RX_SYMBOL_1_CLK 176 1870fadcdfdSBjorn Andersson #define GCC_UFS_CARD_TX_SYMBOL_0_CLK 177 1880fadcdfdSBjorn Andersson #define GCC_UFS_CARD_UNIPRO_CORE_CLK 178 1890fadcdfdSBjorn Andersson #define GCC_UFS_CARD_UNIPRO_CORE_CLK_SRC 179 1900fadcdfdSBjorn Andersson #define GCC_UFS_CARD_UNIPRO_CORE_HW_CTL_CLK 180 1910fadcdfdSBjorn Andersson #define GCC_UFS_PHY_AHB_CLK 181 1920fadcdfdSBjorn Andersson #define GCC_UFS_PHY_AXI_CLK 182 1930fadcdfdSBjorn Andersson #define GCC_UFS_PHY_AXI_CLK_SRC 183 1940fadcdfdSBjorn Andersson #define GCC_UFS_PHY_AXI_HW_CTL_CLK 184 1950fadcdfdSBjorn Andersson #define GCC_UFS_PHY_ICE_CORE_CLK 185 1960fadcdfdSBjorn Andersson #define GCC_UFS_PHY_ICE_CORE_CLK_SRC 186 1970fadcdfdSBjorn Andersson #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK 187 1980fadcdfdSBjorn Andersson #define GCC_UFS_PHY_PHY_AUX_CLK 188 1990fadcdfdSBjorn Andersson #define GCC_UFS_PHY_PHY_AUX_CLK_SRC 189 2000fadcdfdSBjorn Andersson #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK 190 2010fadcdfdSBjorn Andersson #define GCC_UFS_PHY_RX_SYMBOL_0_CLK 191 2020fadcdfdSBjorn Andersson #define GCC_UFS_PHY_RX_SYMBOL_1_CLK 192 2030fadcdfdSBjorn Andersson #define GCC_UFS_PHY_TX_SYMBOL_0_CLK 193 2040fadcdfdSBjorn Andersson #define GCC_UFS_PHY_UNIPRO_CORE_CLK 194 2050fadcdfdSBjorn Andersson #define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC 195 2060fadcdfdSBjorn Andersson #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK 196 2070fadcdfdSBjorn Andersson #define GCC_USB30_MP_MASTER_CLK 197 2080fadcdfdSBjorn Andersson #define GCC_USB30_MP_MASTER_CLK_SRC 198 2090fadcdfdSBjorn Andersson #define GCC_USB30_MP_MOCK_UTMI_CLK 199 2100fadcdfdSBjorn Andersson #define GCC_USB30_MP_MOCK_UTMI_CLK_SRC 200 2110fadcdfdSBjorn Andersson #define GCC_USB30_MP_SLEEP_CLK 201 2120fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_MASTER_CLK 202 2130fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_MASTER_CLK_SRC 203 2140fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_MOCK_UTMI_CLK 204 2150fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC 205 2160fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_SLEEP_CLK 206 2170fadcdfdSBjorn Andersson #define GCC_USB30_SEC_MASTER_CLK 207 2180fadcdfdSBjorn Andersson #define GCC_USB30_SEC_MASTER_CLK_SRC 208 2190fadcdfdSBjorn Andersson #define GCC_USB30_SEC_MOCK_UTMI_CLK 209 2200fadcdfdSBjorn Andersson #define GCC_USB30_SEC_MOCK_UTMI_CLK_SRC 210 2210fadcdfdSBjorn Andersson #define GCC_USB30_SEC_SLEEP_CLK 211 2220fadcdfdSBjorn Andersson #define GCC_USB3_MP_PHY_AUX_CLK 212 2230fadcdfdSBjorn Andersson #define GCC_USB3_MP_PHY_AUX_CLK_SRC 213 2240fadcdfdSBjorn Andersson #define GCC_USB3_MP_PHY_COM_AUX_CLK 214 2250fadcdfdSBjorn Andersson #define GCC_USB3_MP_PHY_PIPE_0_CLK 215 2260fadcdfdSBjorn Andersson #define GCC_USB3_MP_PHY_PIPE_1_CLK 216 2270fadcdfdSBjorn Andersson #define GCC_USB3_PRIM_PHY_AUX_CLK 217 2280fadcdfdSBjorn Andersson #define GCC_USB3_PRIM_PHY_AUX_CLK_SRC 218 2290fadcdfdSBjorn Andersson #define GCC_USB3_PRIM_PHY_COM_AUX_CLK 219 2300fadcdfdSBjorn Andersson #define GCC_USB3_PRIM_PHY_PIPE_CLK 220 2310fadcdfdSBjorn Andersson #define GCC_USB3_SEC_PHY_AUX_CLK 221 2320fadcdfdSBjorn Andersson #define GCC_USB3_SEC_PHY_AUX_CLK_SRC 222 2330fadcdfdSBjorn Andersson #define GCC_USB3_SEC_PHY_COM_AUX_CLK 223 2340fadcdfdSBjorn Andersson #define GCC_USB3_SEC_PHY_PIPE_CLK 224 2350fadcdfdSBjorn Andersson #define GCC_VIDEO_AXI0_CLK 225 2360fadcdfdSBjorn Andersson #define GCC_VIDEO_AXI1_CLK 226 2370fadcdfdSBjorn Andersson #define GCC_VIDEO_AXIC_CLK 227 2380fadcdfdSBjorn Andersson #define GPLL0 228 2390fadcdfdSBjorn Andersson #define GPLL0_OUT_EVEN 229 2400fadcdfdSBjorn Andersson #define GPLL1 230 2410fadcdfdSBjorn Andersson #define GPLL4 231 2420fadcdfdSBjorn Andersson #define GPLL7 232 2430fadcdfdSBjorn Andersson #define GCC_PCIE_0_CLKREF_CLK 233 2440fadcdfdSBjorn Andersson #define GCC_PCIE_1_CLKREF_CLK 234 2450fadcdfdSBjorn Andersson #define GCC_PCIE_2_CLKREF_CLK 235 2460fadcdfdSBjorn Andersson #define GCC_PCIE_3_CLKREF_CLK 236 2470fadcdfdSBjorn Andersson #define GCC_USB3_PRIM_CLKREF_CLK 237 2480fadcdfdSBjorn Andersson #define GCC_USB3_SEC_CLKREF_CLK 238 24926447dadSManivannan Sadhasivam #define GCC_UFS_MEM_CLKREF_EN 239 25026447dadSManivannan Sadhasivam #define GCC_UFS_CARD_CLKREF_EN 240 251*648b4bdeSSatya Priya Kakitapalli #define GPLL9 241 2520fadcdfdSBjorn Andersson 2530fadcdfdSBjorn Andersson #define GCC_EMAC_BCR 0 2540fadcdfdSBjorn Andersson #define GCC_GPU_BCR 1 2550fadcdfdSBjorn Andersson #define GCC_MMSS_BCR 2 2560fadcdfdSBjorn Andersson #define GCC_NPU_BCR 3 2570fadcdfdSBjorn Andersson #define GCC_PCIE_0_BCR 4 2580fadcdfdSBjorn Andersson #define GCC_PCIE_0_PHY_BCR 5 2590fadcdfdSBjorn Andersson #define GCC_PCIE_1_BCR 6 2600fadcdfdSBjorn Andersson #define GCC_PCIE_1_PHY_BCR 7 2610fadcdfdSBjorn Andersson #define GCC_PCIE_2_BCR 8 2620fadcdfdSBjorn Andersson #define GCC_PCIE_2_PHY_BCR 9 2630fadcdfdSBjorn Andersson #define GCC_PCIE_3_BCR 10 2640fadcdfdSBjorn Andersson #define GCC_PCIE_3_PHY_BCR 11 2650fadcdfdSBjorn Andersson #define GCC_PCIE_PHY_BCR 12 2660fadcdfdSBjorn Andersson #define GCC_PDM_BCR 13 2670fadcdfdSBjorn Andersson #define GCC_PRNG_BCR 14 2680fadcdfdSBjorn Andersson #define GCC_QSPI_1_BCR 15 2690fadcdfdSBjorn Andersson #define GCC_QSPI_BCR 16 2700fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAPPER_0_BCR 17 2710fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAPPER_1_BCR 18 2720fadcdfdSBjorn Andersson #define GCC_QUPV3_WRAPPER_2_BCR 19 2730fadcdfdSBjorn Andersson #define GCC_QUSB2PHY_5_BCR 20 2740fadcdfdSBjorn Andersson #define GCC_QUSB2PHY_MP0_BCR 21 2750fadcdfdSBjorn Andersson #define GCC_QUSB2PHY_MP1_BCR 22 2760fadcdfdSBjorn Andersson #define GCC_QUSB2PHY_PRIM_BCR 23 2770fadcdfdSBjorn Andersson #define GCC_QUSB2PHY_SEC_BCR 24 2780fadcdfdSBjorn Andersson #define GCC_USB3_PHY_PRIM_SP0_BCR 25 2790fadcdfdSBjorn Andersson #define GCC_USB3_PHY_PRIM_SP1_BCR 26 2800fadcdfdSBjorn Andersson #define GCC_USB3_DP_PHY_PRIM_SP0_BCR 27 2810fadcdfdSBjorn Andersson #define GCC_USB3_DP_PHY_PRIM_SP1_BCR 28 2820fadcdfdSBjorn Andersson #define GCC_USB3_PHY_SEC_BCR 29 2830fadcdfdSBjorn Andersson #define GCC_USB3PHY_PHY_SEC_BCR 30 2840fadcdfdSBjorn Andersson #define GCC_SDCC2_BCR 31 2850fadcdfdSBjorn Andersson #define GCC_SDCC4_BCR 32 2860fadcdfdSBjorn Andersson #define GCC_TSIF_BCR 33 2870fadcdfdSBjorn Andersson #define GCC_UFS_CARD_2_BCR 34 2880fadcdfdSBjorn Andersson #define GCC_UFS_CARD_BCR 35 2890fadcdfdSBjorn Andersson #define GCC_UFS_PHY_BCR 36 2900fadcdfdSBjorn Andersson #define GCC_USB30_MP_BCR 37 2910fadcdfdSBjorn Andersson #define GCC_USB30_PRIM_BCR 38 2920fadcdfdSBjorn Andersson #define GCC_USB30_SEC_BCR 39 2930fadcdfdSBjorn Andersson #define GCC_USB_PHY_CFG_AHB2PHY_BCR 40 2940fadcdfdSBjorn Andersson #define GCC_VIDEO_AXIC_CLK_BCR 41 2950fadcdfdSBjorn Andersson #define GCC_VIDEO_AXI0_CLK_BCR 42 2960fadcdfdSBjorn Andersson #define GCC_VIDEO_AXI1_CLK_BCR 43 2970fadcdfdSBjorn Andersson #define GCC_USB3_DP_PHY_SEC_BCR 44 29839b5ffc9SBjorn Andersson #define GCC_USB3_UNIPHY_MP0_BCR 45 29939b5ffc9SBjorn Andersson #define GCC_USB3_UNIPHY_MP1_BCR 46 30039b5ffc9SBjorn Andersson #define GCC_USB3UNIPHY_PHY_MP0_BCR 47 30139b5ffc9SBjorn Andersson #define GCC_USB3UNIPHY_PHY_MP1_BCR 48 3020fadcdfdSBjorn Andersson 3030fadcdfdSBjorn Andersson /* GCC GDSCRs */ 3040fadcdfdSBjorn Andersson #define EMAC_GDSC 0 3050fadcdfdSBjorn Andersson #define PCIE_0_GDSC 1 3060fadcdfdSBjorn Andersson #define PCIE_1_GDSC 2 3070fadcdfdSBjorn Andersson #define PCIE_2_GDSC 3 3080fadcdfdSBjorn Andersson #define PCIE_3_GDSC 4 3090fadcdfdSBjorn Andersson #define UFS_CARD_2_GDSC 5 3100fadcdfdSBjorn Andersson #define UFS_CARD_GDSC 6 3110fadcdfdSBjorn Andersson #define UFS_PHY_GDSC 7 3120fadcdfdSBjorn Andersson #define USB30_MP_GDSC 8 3130fadcdfdSBjorn Andersson #define USB30_PRIM_GDSC 9 3140fadcdfdSBjorn Andersson #define USB30_SEC_GDSC 10 3150fadcdfdSBjorn Andersson 3160fadcdfdSBjorn Andersson #endif 317