xref: /linux/drivers/gpu/drm/nouveau/nvkm/engine/gr/ctxgm107.c (revision 26fbb4c8c7c3ee9a4c3b4de555a8587b5a19154e) 
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2  * Copyright 2013 Red Hat Inc.
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21  *
22  * Authors: Ben Skeggs <bskeggs@redhat.com>
23  */
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25 
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28 
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30  * PGRAPH context register lists
31  ******************************************************************************/
32 
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219 	{ 0x000792,   1, 0x01, 0x00000001 },
220 	{ 0x000794,   3, 0x01, 0x00000001 },
221 	{ 0x000797,   1, 0x01, 0x000000cf },
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289 	{}
290 };
291 
292 static const struct gf100_gr_pack
293 gm107_grctx_pack_icmd[] = {
294 	{ gm107_grctx_init_icmd_0 },
295 	{}
296 };
297 
298 static const struct gf100_gr_init
299 gm107_grctx_init_b097_0[] = {
300 	{ 0x000800,   8, 0x40, 0x00000000 },
301 	{ 0x000804,   8, 0x40, 0x00000000 },
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313 	{ 0x001c0c,  16, 0x10, 0x00000000 },
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339 	{ 0x000700,   4, 0x10, 0x00000000 },
340 	{ 0x000704,   4, 0x10, 0x00000000 },
341 	{ 0x000708,   4, 0x10, 0x00000000 },
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343 	{ 0x000a00,  16, 0x20, 0x00000000 },
344 	{ 0x000a04,  16, 0x20, 0x00000000 },
345 	{ 0x000a08,  16, 0x20, 0x00000000 },
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350 	{ 0x000c04,  16, 0x10, 0x00000000 },
351 	{ 0x000c08,  16, 0x10, 0x00000000 },
352 	{ 0x000c0c,  16, 0x10, 0x3f800000 },
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354 	{ 0x000d04,   8, 0x08, 0xffff0000 },
355 	{ 0x000e00,  16, 0x10, 0x00000000 },
356 	{ 0x000e04,  16, 0x10, 0xffff0000 },
357 	{ 0x000e08,  16, 0x10, 0xffff0000 },
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359 	{ 0x000d44,   4, 0x08, 0x00000000 },
360 	{ 0x001e00,   8, 0x20, 0x00000001 },
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374 	{ 0x000d68,   1, 0x04, 0x0000ffff },
375 	{ 0x00121c,   1, 0x04, 0x0fac6881 },
376 	{ 0x000fac,   1, 0x04, 0x00000001 },
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378 	{ 0x000fe0,   2, 0x04, 0x00000000 },
379 	{ 0x000fe8,   1, 0x04, 0x00000014 },
380 	{ 0x000fec,   1, 0x04, 0x00000040 },
381 	{ 0x000ff0,   1, 0x04, 0x00000000 },
382 	{ 0x00179c,   1, 0x04, 0x00000000 },
383 	{ 0x001228,   1, 0x04, 0x00000400 },
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387 	{ 0x0015b4,   1, 0x04, 0x00000001 },
388 	{ 0x0015cc,   1, 0x04, 0x00000000 },
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390 	{ 0x000754,   1, 0x04, 0x00000001 },
391 	{ 0x000fb0,   1, 0x04, 0x00000000 },
392 	{ 0x0015d0,   1, 0x04, 0x00000000 },
393 	{ 0x00153c,   1, 0x04, 0x00000000 },
394 	{ 0x0016b4,   1, 0x04, 0x00000003 },
395 	{ 0x000fbc,   4, 0x04, 0x0000ffff },
396 	{ 0x000df8,   2, 0x04, 0x00000000 },
397 	{ 0x001948,   1, 0x04, 0x00000000 },
398 	{ 0x001970,   1, 0x04, 0x00000001 },
399 	{ 0x00161c,   1, 0x04, 0x000009f0 },
400 	{ 0x000dcc,   1, 0x04, 0x00000010 },
401 	{ 0x0015e4,   1, 0x04, 0x00000000 },
402 	{ 0x001160,  32, 0x04, 0x25e00040 },
403 	{ 0x001880,  32, 0x04, 0x00000000 },
404 	{ 0x000f84,   2, 0x04, 0x00000000 },
405 	{ 0x0017c8,   2, 0x04, 0x00000000 },
406 	{ 0x0017d0,   1, 0x04, 0x000000ff },
407 	{ 0x0017d4,   1, 0x04, 0xffffffff },
408 	{ 0x0017d8,   1, 0x04, 0x00000002 },
409 	{ 0x0017dc,   1, 0x04, 0x00000000 },
410 	{ 0x0015f4,   2, 0x04, 0x00000000 },
411 	{ 0x001434,   2, 0x04, 0x00000000 },
412 	{ 0x000d74,   1, 0x04, 0x00000000 },
413 	{ 0x0013a4,   1, 0x04, 0x00000000 },
414 	{ 0x001318,   1, 0x04, 0x00000001 },
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615 static const struct gf100_gr_pack
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617 	{ gm107_grctx_init_b097_0, 0xb097 },
618 	{ gf100_grctx_init_902d_0, 0x902d },
619 	{}
620 };
621 
622 static const struct gf100_gr_init
623 gm107_grctx_init_fe_0[] = {
624 	{ 0x404004,   8, 0x04, 0x00000000 },
625 	{ 0x404024,   1, 0x04, 0x0000e000 },
626 	{ 0x404028,   8, 0x04, 0x00000000 },
627 	{ 0x4040a8,   8, 0x04, 0x00000000 },
628 	{ 0x4040c8,   1, 0x04, 0xf800008f },
629 	{ 0x4040d0,   6, 0x04, 0x00000000 },
630 	{ 0x4040f8,   1, 0x04, 0x00000000 },
631 	{ 0x404100,  10, 0x04, 0x00000000 },
632 	{ 0x404130,   2, 0x04, 0x00000000 },
633 	{ 0x404150,   1, 0x04, 0x0000002e },
634 	{ 0x404154,   1, 0x04, 0x00000400 },
635 	{ 0x404158,   1, 0x04, 0x00000200 },
636 	{ 0x404164,   1, 0x04, 0x00000045 },
637 	{ 0x40417c,   2, 0x04, 0x00000000 },
638 	{ 0x404194,   1, 0x04, 0x01000700 },
639 	{ 0x4041a0,   4, 0x04, 0x00000000 },
640 	{ 0x404200,   4, 0x04, 0x00000000 },
641 	{}
642 };
643 
644 static const struct gf100_gr_init
645 gm107_grctx_init_ds_0[] = {
646 	{ 0x405800,   1, 0x04, 0x0f8001bf },
647 	{ 0x405830,   1, 0x04, 0x0aa01000 },
648 	{ 0x405834,   1, 0x04, 0x08000000 },
649 	{ 0x405838,   1, 0x04, 0x00000000 },
650 	{ 0x405854,   1, 0x04, 0x00000000 },
651 	{ 0x405870,   4, 0x04, 0x00000001 },
652 	{ 0x405a00,   2, 0x04, 0x00000000 },
653 	{ 0x405a18,   1, 0x04, 0x00000000 },
654 	{ 0x405a1c,   1, 0x04, 0x000000ff },
655 	{}
656 };
657 
658 static const struct gf100_gr_init
659 gm107_grctx_init_pd_0[] = {
660 	{ 0x406020,   1, 0x04, 0x07410001 },
661 	{ 0x406028,   4, 0x04, 0x00000001 },
662 	{ 0x4064a8,   1, 0x04, 0x00000000 },
663 	{ 0x4064ac,   1, 0x04, 0x00003fff },
664 	{ 0x4064b0,   3, 0x04, 0x00000000 },
665 	{ 0x4064c0,   1, 0x04, 0x80400280 },
666 	{ 0x4064c4,   1, 0x04, 0x0400ffff },
667 	{ 0x4064c8,   1, 0x04, 0x018001ff },
668 	{ 0x4064cc,   9, 0x04, 0x00000000 },
669 	{ 0x4064fc,   1, 0x04, 0x0000022a },
670 	{ 0x406500,   1, 0x04, 0x00000000 },
671 	{}
672 };
673 
674 static const struct gf100_gr_init
675 gm107_grctx_init_be_0[] = {
676 	{ 0x408800,   1, 0x04, 0x32802a3c },
677 	{ 0x408804,   1, 0x04, 0x00000040 },
678 	{ 0x408808,   1, 0x04, 0x1003e005 },
679 	{ 0x408840,   1, 0x04, 0x0000000b },
680 	{ 0x408900,   1, 0x04, 0xb080b801 },
681 	{ 0x408904,   1, 0x04, 0x63038001 },
682 	{ 0x408908,   1, 0x04, 0x02c8102f },
683 	{ 0x408980,   1, 0x04, 0x0000011d },
684 	{}
685 };
686 
687 static const struct gf100_gr_pack
688 gm107_grctx_pack_hub[] = {
689 	{ gf100_grctx_init_main_0 },
690 	{ gm107_grctx_init_fe_0 },
691 	{ gk110_grctx_init_pri_0 },
692 	{ gk104_grctx_init_memfmt_0 },
693 	{ gm107_grctx_init_ds_0 },
694 	{ gk110_grctx_init_cwd_0 },
695 	{ gm107_grctx_init_pd_0 },
696 	{ gk208_grctx_init_rstr2d_0 },
697 	{ gk104_grctx_init_scc_0 },
698 	{ gm107_grctx_init_be_0 },
699 	{}
700 };
701 
702 const struct gf100_gr_init
703 gm107_grctx_init_gpc_unk_0[] = {
704 	{ 0x418380,   1, 0x04, 0x00000056 },
705 	{}
706 };
707 
708 static const struct gf100_gr_init
709 gm107_grctx_init_gpc_unk_1[] = {
710 	{ 0x418600,   1, 0x04, 0x0000007f },
711 	{ 0x418684,   1, 0x04, 0x0000001f },
712 	{ 0x418700,   1, 0x04, 0x00000002 },
713 	{ 0x418704,   1, 0x04, 0x00000080 },
714 	{ 0x418708,   1, 0x04, 0x40000000 },
715 	{ 0x41870c,   2, 0x04, 0x00000000 },
716 	{}
717 };
718 
719 static const struct gf100_gr_init
720 gm107_grctx_init_setup_0[] = {
721 	{ 0x418800,   1, 0x04, 0x7006863a },
722 	{ 0x418810,   1, 0x04, 0x00000000 },
723 	{ 0x418828,   1, 0x04, 0x00000044 },
724 	{ 0x418830,   1, 0x04, 0x10000001 },
725 	{ 0x4188d8,   1, 0x04, 0x00000008 },
726 	{ 0x4188e0,   1, 0x04, 0x01000000 },
727 	{ 0x4188e8,   5, 0x04, 0x00000000 },
728 	{ 0x4188fc,   1, 0x04, 0x20100058 },
729 	{}
730 };
731 
732 static const struct gf100_gr_init
733 gm107_grctx_init_gpc_unk_2[] = {
734 	{ 0x418d24,   1, 0x04, 0x00000000 },
735 	{ 0x418e00,   1, 0x04, 0x90000000 },
736 	{ 0x418e24,   1, 0x04, 0x00000000 },
737 	{ 0x418e28,   1, 0x04, 0x00000030 },
738 	{ 0x418e30,   1, 0x04, 0x00000000 },
739 	{ 0x418e34,   1, 0x04, 0x00010000 },
740 	{ 0x418e38,   1, 0x04, 0x00000000 },
741 	{ 0x418e40,  22, 0x04, 0x00000000 },
742 	{ 0x418ea0,   2, 0x04, 0x00000000 },
743 	{}
744 };
745 
746 static const struct gf100_gr_pack
747 gm107_grctx_pack_gpc_0[] = {
748 	{ gm107_grctx_init_gpc_unk_0 },
749 	{ gk208_grctx_init_prop_0 },
750 	{ gm107_grctx_init_gpc_unk_1 },
751 	{ gm107_grctx_init_setup_0 },
752 	{ gf100_grctx_init_zcull_0 },
753 	{}
754 };
755 
756 static const struct gf100_gr_pack
757 gm107_grctx_pack_gpc_1[] = {
758 	{ gk208_grctx_init_crstr_0 },
759 	{ gk104_grctx_init_gpm_0 },
760 	{ gm107_grctx_init_gpc_unk_2 },
761 	{ gf100_grctx_init_gcc_0 },
762 	{}
763 };
764 
765 static const struct gf100_gr_init
766 gm107_grctx_init_tex_0[] = {
767 	{ 0x419a00,   1, 0x04, 0x000300f0 },
768 	{ 0x419a04,   1, 0x04, 0x00000005 },
769 	{ 0x419a08,   1, 0x04, 0x00000421 },
770 	{ 0x419a0c,   1, 0x04, 0x00120000 },
771 	{ 0x419a10,   1, 0x04, 0x00000000 },
772 	{ 0x419a14,   1, 0x04, 0x00002200 },
773 	{ 0x419a1c,   1, 0x04, 0x0000c000 },
774 	{ 0x419a20,   1, 0x04, 0x20008a00 },
775 	{ 0x419a30,   1, 0x04, 0x00000001 },
776 	{ 0x419a3c,   1, 0x04, 0x00000002 },
777 	{ 0x419ac4,   1, 0x04, 0x00000000 },
778 	{}
779 };
780 
781 static const struct gf100_gr_init
782 gm107_grctx_init_mpc_0[] = {
783 	{ 0x419c00,   1, 0x04, 0x0000001a },
784 	{ 0x419c04,   1, 0x04, 0x80000006 },
785 	{ 0x419c08,   1, 0x04, 0x00000002 },
786 	{ 0x419c20,   1, 0x04, 0x00000000 },
787 	{ 0x419c24,   1, 0x04, 0x00084210 },
788 	{ 0x419c28,   1, 0x04, 0x3efbefbe },
789 	{ 0x419c2c,   1, 0x04, 0x00000000 },
790 	{ 0x419c34,   1, 0x04, 0x01ff1ff3 },
791 	{ 0x419c3c,   1, 0x04, 0x00001919 },
792 	{}
793 };
794 
795 static const struct gf100_gr_init
796 gm107_grctx_init_l1c_0[] = {
797 	{ 0x419c84,   1, 0x04, 0x00000020 },
798 	{}
799 };
800 
801 static const struct gf100_gr_init
802 gm107_grctx_init_sm_0[] = {
803 	{ 0x419e04,   3, 0x04, 0x00000000 },
804 	{ 0x419e10,   1, 0x04, 0x00001c02 },
805 	{ 0x419e44,   1, 0x04, 0x00d3eff2 },
806 	{ 0x419e48,   1, 0x04, 0x00000000 },
807 	{ 0x419e4c,   1, 0x04, 0x0000007f },
808 	{ 0x419e50,   1, 0x04, 0x00000000 },
809 	{ 0x419e60,   4, 0x04, 0x00000000 },
810 	{ 0x419e74,  10, 0x04, 0x00000000 },
811 	{ 0x419eac,   1, 0x04, 0x0001cf8b },
812 	{ 0x419eb0,   1, 0x04, 0x00030300 },
813 	{ 0x419eb8,   1, 0x04, 0x00000000 },
814 	{ 0x419ef0,  24, 0x04, 0x00000000 },
815 	{ 0x419f68,   2, 0x04, 0x00000000 },
816 	{ 0x419f70,   1, 0x04, 0x00000020 },
817 	{ 0x419f78,   1, 0x04, 0x000003eb },
818 	{ 0x419f7c,   1, 0x04, 0x00000000 },
819 	{}
820 };
821 
822 static const struct gf100_gr_pack
823 gm107_grctx_pack_tpc[] = {
824 	{ gf117_grctx_init_pe_0 },
825 	{ gm107_grctx_init_tex_0 },
826 	{ gm107_grctx_init_mpc_0 },
827 	{ gm107_grctx_init_l1c_0 },
828 	{ gm107_grctx_init_sm_0 },
829 	{}
830 };
831 
832 static const struct gf100_gr_init
833 gm107_grctx_init_cbm_0[] = {
834 	{ 0x41bec0,   1, 0x04, 0x00000000 },
835 	{ 0x41bec4,   1, 0x04, 0x01050000 },
836 	{ 0x41bee4,   1, 0x04, 0x00000000 },
837 	{ 0x41bef0,   1, 0x04, 0x000003ff },
838 	{ 0x41bef4,   2, 0x04, 0x00000000 },
839 	{}
840 };
841 
842 const struct gf100_gr_init
843 gm107_grctx_init_wwdx_0[] = {
844 	{ 0x41bf00,   1, 0x04, 0x0a418820 },
845 	{ 0x41bf04,   1, 0x04, 0x062080e6 },
846 	{ 0x41bf08,   1, 0x04, 0x020398a4 },
847 	{ 0x41bf0c,   1, 0x04, 0x0e629062 },
848 	{ 0x41bf10,   1, 0x04, 0x0a418820 },
849 	{ 0x41bf14,   1, 0x04, 0x000000e6 },
850 	{ 0x41bfd0,   1, 0x04, 0x00900103 },
851 	{ 0x41bfe0,   1, 0x04, 0x80000000 },
852 	{ 0x41bfe4,   1, 0x04, 0x00000000 },
853 	{}
854 };
855 
856 static const struct gf100_gr_pack
857 gm107_grctx_pack_ppc[] = {
858 	{ gk104_grctx_init_pes_0 },
859 	{ gm107_grctx_init_cbm_0 },
860 	{ gm107_grctx_init_wwdx_0 },
861 	{}
862 };
863 
864 /*******************************************************************************
865  * PGRAPH context implementation
866  ******************************************************************************/
867 
868 static void
869 gm107_grctx_generate_r419e00(struct gf100_gr *gr)
870 {
871 	struct nvkm_device *device = gr->base.engine.subdev.device;
872 	nvkm_mask(device, 0x419e00, 0x00808080, 0x00808080);
873 	nvkm_mask(device, 0x419ccc, 0x80000000, 0x80000000);
874 	nvkm_mask(device, 0x419f80, 0x80000000, 0x80000000);
875 	nvkm_mask(device, 0x419f88, 0x80000000, 0x80000000);
876 }
877 
878 void
879 gm107_grctx_generate_bundle(struct gf100_grctx *info)
880 {
881 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
882 	const u32 state_limit = min(grctx->bundle_min_gpm_fifo_depth,
883 				    grctx->bundle_size / 0x20);
884 	const u32 token_limit = grctx->bundle_token_limit;
885 	const int s = 8;
886 	const int b = mmio_vram(info, grctx->bundle_size, (1 << s), true);
887 	mmio_refn(info, 0x408004, 0x00000000, s, b);
888 	mmio_wr32(info, 0x408008, 0x80000000 | (grctx->bundle_size >> s));
889 	mmio_refn(info, 0x418e24, 0x00000000, s, b);
890 	mmio_wr32(info, 0x418e28, 0x80000000 | (grctx->bundle_size >> s));
891 	mmio_wr32(info, 0x4064c8, (state_limit << 16) | token_limit);
892 }
893 
894 void
895 gm107_grctx_generate_pagepool(struct gf100_grctx *info)
896 {
897 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
898 	const int s = 8;
899 	const int b = mmio_vram(info, grctx->pagepool_size, (1 << s), true);
900 	mmio_refn(info, 0x40800c, 0x00000000, s, b);
901 	mmio_wr32(info, 0x408010, 0x80000000);
902 	mmio_refn(info, 0x419004, 0x00000000, s, b);
903 	mmio_wr32(info, 0x419008, 0x00000000);
904 	mmio_wr32(info, 0x4064cc, 0x80000000);
905 	mmio_wr32(info, 0x418e30, 0x80000000); /* guess at it being related */
906 }
907 
908 void
909 gm107_grctx_generate_attrib(struct gf100_grctx *info)
910 {
911 	struct gf100_gr *gr = info->gr;
912 	const struct gf100_grctx_func *grctx = gr->func->grctx;
913 	const u32  alpha = grctx->alpha_nr;
914 	const u32 attrib = grctx->attrib_nr;
915 	const u32   size = 0x20 * (grctx->attrib_nr_max + grctx->alpha_nr_max);
916 	const int s = 12;
917 	const int b = mmio_vram(info, size * gr->tpc_total, (1 << s), false);
918 	const int max_batches = 0xffff;
919 	u32 bo = 0;
920 	u32 ao = bo + grctx->attrib_nr_max * gr->tpc_total;
921 	int gpc, ppc, n = 0;
922 
923 	mmio_refn(info, 0x418810, 0x80000000, s, b);
924 	mmio_refn(info, 0x419848, 0x10000000, s, b);
925 	mmio_refn(info, 0x419c2c, 0x10000000, s, b);
926 	mmio_wr32(info, 0x405830, (attrib << 16) | alpha);
927 	mmio_wr32(info, 0x4064c4, ((alpha / 4) << 16) | max_batches);
928 
929 	for (gpc = 0; gpc < gr->gpc_nr; gpc++) {
930 		for (ppc = 0; ppc < gr->ppc_nr[gpc]; ppc++, n++) {
931 			const u32 as =  alpha * gr->ppc_tpc_nr[gpc][ppc];
932 			const u32 bs = attrib * gr->ppc_tpc_nr[gpc][ppc];
933 			const u32 u = 0x418ea0 + (n * 0x04);
934 			const u32 o = PPC_UNIT(gpc, ppc, 0);
935 			if (!(gr->ppc_mask[gpc] & (1 << ppc)))
936 				continue;
937 			mmio_wr32(info, o + 0xc0, bs);
938 			mmio_wr32(info, o + 0xf4, bo);
939 			bo += grctx->attrib_nr_max * gr->ppc_tpc_nr[gpc][ppc];
940 			mmio_wr32(info, o + 0xe4, as);
941 			mmio_wr32(info, o + 0xf8, ao);
942 			ao += grctx->alpha_nr_max * gr->ppc_tpc_nr[gpc][ppc];
943 			mmio_wr32(info, u, ((bs / 3) << 16) | bs);
944 		}
945 	}
946 }
947 
948 static void
949 gm107_grctx_generate_r406500(struct gf100_gr *gr)
950 {
951 	nvkm_wr32(gr->base.engine.subdev.device, 0x406500, 0x00000001);
952 }
953 
954 void
955 gm107_grctx_generate_sm_id(struct gf100_gr *gr, int gpc, int tpc, int sm)
956 {
957 	struct nvkm_device *device = gr->base.engine.subdev.device;
958 	nvkm_wr32(device, TPC_UNIT(gpc, tpc, 0x698), sm);
959 	nvkm_wr32(device, GPC_UNIT(gpc, 0x0c10 + tpc * 4), sm);
960 	nvkm_wr32(device, TPC_UNIT(gpc, tpc, 0x088), sm);
961 }
962 
963 const struct gf100_grctx_func
964 gm107_grctx = {
965 	.main  = gf100_grctx_generate_main,
966 	.unkn  = gk104_grctx_generate_unkn,
967 	.hub   = gm107_grctx_pack_hub,
968 	.gpc_0 = gm107_grctx_pack_gpc_0,
969 	.gpc_1 = gm107_grctx_pack_gpc_1,
970 	.zcull = gf100_grctx_pack_zcull,
971 	.tpc   = gm107_grctx_pack_tpc,
972 	.ppc   = gm107_grctx_pack_ppc,
973 	.icmd  = gm107_grctx_pack_icmd,
974 	.mthd  = gm107_grctx_pack_mthd,
975 	.bundle = gm107_grctx_generate_bundle,
976 	.bundle_size = 0x3000,
977 	.bundle_min_gpm_fifo_depth = 0x180,
978 	.bundle_token_limit = 0x2c0,
979 	.pagepool = gm107_grctx_generate_pagepool,
980 	.pagepool_size = 0x8000,
981 	.attrib = gm107_grctx_generate_attrib,
982 	.attrib_nr_max = 0xff0,
983 	.attrib_nr = 0xaa0,
984 	.alpha_nr_max = 0x1800,
985 	.alpha_nr = 0x1000,
986 	.sm_id = gm107_grctx_generate_sm_id,
987 	.tpc_nr = gf100_grctx_generate_tpc_nr,
988 	.rop_mapping = gf117_grctx_generate_rop_mapping,
989 	.alpha_beta_tables = gk104_grctx_generate_alpha_beta_tables,
990 	.dist_skip_table = gf117_grctx_generate_dist_skip_table,
991 	.r406500 = gm107_grctx_generate_r406500,
992 	.gpc_tpc_nr = gk104_grctx_generate_gpc_tpc_nr,
993 	.r419e00 = gm107_grctx_generate_r419e00,
994 };
995