xref: /linux/drivers/pinctrl/renesas/pfc-sh7734.c (revision 1ac731c529cd4d6adbce134754b51ff7d822b145)
1 // SPDX-License-Identifier: GPL-2.0
2 /*
3  * SH7734 processor support - PFC hardware block
4  *
5  * Copyright (C) 2012  Renesas Solutions Corp.
6  * Copyright (C) 2012  Nobuhiro Iwamatsu <nobuhiro.iwamatsu.yj@renesas.com>
7  */
8 #include <linux/kernel.h>
9 #include <cpu/sh7734.h>
10 
11 #include "sh_pfc.h"
12 
13 #define CPU_ALL_GP(fn, sfx)						\
14 	PORT_GP_32(0, fn, sfx),						\
15 	PORT_GP_32(1, fn, sfx),						\
16 	PORT_GP_32(2, fn, sfx),						\
17 	PORT_GP_32(3, fn, sfx),						\
18 	PORT_GP_32(4, fn, sfx),						\
19 	PORT_GP_12(5, fn, sfx)
20 
21 #undef _GP_DATA
22 #define _GP_DATA(bank, pin, name, sfx, cfg)				\
23 	PINMUX_DATA(name##_DATA, name##_FN, name##_IN, name##_OUT)
24 
25 #define _GP_INOUTSEL(bank, pin, name, sfx, cfg)	name##_IN, name##_OUT
26 #define _GP_INDT(bank, pin, name, sfx, cfg)	name##_DATA
27 #define GP_INOUTSEL(bank)	PORT_GP_32_REV(bank, _GP_INOUTSEL, unused)
28 #define GP_INDT(bank)		PORT_GP_32_REV(bank, _GP_INDT, unused)
29 
30 enum {
31 	PINMUX_RESERVED = 0,
32 
33 	PINMUX_DATA_BEGIN,
34 	GP_ALL(DATA), /* GP_0_0_DATA -> GP_5_11_DATA */
35 	PINMUX_DATA_END,
36 
37 	PINMUX_INPUT_BEGIN,
38 	GP_ALL(IN), /* GP_0_0_IN -> GP_5_11_IN */
39 	PINMUX_INPUT_END,
40 
41 	PINMUX_OUTPUT_BEGIN,
42 	GP_ALL(OUT), /* GP_0_0_OUT -> GP_5_11_OUT */
43 	PINMUX_OUTPUT_END,
44 
45 	PINMUX_FUNCTION_BEGIN,
46 	GP_ALL(FN), /* GP_0_0_FN -> GP_5_11_FN */
47 
48 	/* GPSR0 */
49 	FN_IP1_9_8, FN_IP1_11_10, FN_IP1_13_12, FN_IP1_15_14,
50 	FN_IP0_7_6, FN_IP0_9_8, FN_IP0_11_10, FN_IP0_13_12,
51 	FN_IP0_15_14, FN_IP0_17_16, FN_IP0_19_18, FN_IP0_21_20,
52 	FN_IP0_23_22, FN_IP0_25_24, FN_IP0_27_26, FN_IP0_29_28,
53 	FN_IP0_31_30, FN_IP1_1_0, FN_IP1_3_2, FN_IP1_5_4,
54 	FN_IP1_7_6, FN_IP11_28, FN_IP0_1_0, FN_IP0_3_2,
55 	FN_IP0_5_4, FN_IP1_17_16, FN_IP1_19_18, FN_IP1_22_20,
56 	FN_IP1_25_23, FN_IP1_28_26, FN_IP1_31_29, FN_IP2_2_0,
57 
58 	/* GPSR1 */
59 	FN_IP3_20, FN_IP3_29_27, FN_IP11_20_19, FN_IP11_22_21,
60 	FN_IP2_16_14, FN_IP2_19_17, FN_IP2_22_20, FN_IP2_24_23,
61 	FN_IP2_27_25, FN_IP2_30_28, FN_IP3_1_0, FN_CLKOUT,
62 	FN_BS, FN_CS0, FN_IP3_2, FN_EX_CS0,
63 	FN_IP3_5_3, FN_IP3_8_6, FN_IP3_11_9, FN_IP3_14_12,
64 	FN_IP3_17_15, FN_RD, FN_IP3_19_18, FN_WE0,
65 	FN_WE1, FN_IP2_4_3, FN_IP3_23_21, FN_IP3_26_24,
66 	FN_IP2_7_5, FN_IP2_10_8, FN_IP2_13_11, FN_IP11_25_23,
67 
68 	/* GPSR2 */
69 	FN_IP11_6_4, FN_IP11_9_7, FN_IP11_11_10, FN_IP4_2_0,
70 	FN_IP8_29_28, FN_IP11_27_26, FN_IP8_22_20, FN_IP8_25_23,
71 	FN_IP11_12, FN_IP8_27_26, FN_IP4_5_3, FN_IP4_8_6,
72 	FN_IP4_11_9, FN_IP4_14_12, FN_IP4_17_15, FN_IP4_19_18,
73 	FN_IP4_21_20, FN_IP4_23_22, FN_IP4_25_24, FN_IP4_27_26,
74 	FN_IP4_29_28, FN_IP4_31_30, FN_IP5_2_0, FN_IP5_5_3,
75 	FN_IP5_8_6, FN_IP5_11_9, FN_IP5_14_12, FN_IP5_17_15,
76 	FN_IP5_20_18, FN_IP5_22_21, FN_IP5_24_23, FN_IP5_26_25,
77 
78 	/* GPSR3 */
79 	FN_IP6_2_0, FN_IP6_5_3, FN_IP6_7_6, FN_IP6_9_8,
80 	FN_IP6_11_10, FN_IP6_13_12, FN_IP6_15_14, FN_IP6_17_16,
81 	FN_IP6_20_18, FN_IP6_23_21, FN_IP7_2_0, FN_IP7_5_3,
82 	FN_IP7_8_6, FN_IP7_11_9, FN_IP7_14_12, FN_IP7_17_15,
83 	FN_IP7_20_18, FN_IP7_23_21, FN_IP7_26_24, FN_IP7_28_27,
84 	FN_IP7_30_29, FN_IP8_1_0, FN_IP8_3_2, FN_IP8_5_4,
85 	FN_IP8_7_6, FN_IP8_9_8, FN_IP8_11_10, FN_IP8_13_12,
86 	FN_IP8_15_14, FN_IP8_17_16, FN_IP8_19_18, FN_IP9_1_0,
87 
88 	/* GPSR4 */
89 	FN_IP9_19_18, FN_IP9_21_20, FN_IP9_23_22, FN_IP9_25_24,
90 	FN_IP9_11_10, FN_IP9_13_12, FN_IP9_15_14, FN_IP9_17_16,
91 	FN_IP9_3_2, FN_IP9_5_4, FN_IP9_7_6, FN_IP9_9_8,
92 	FN_IP9_27_26, FN_IP9_29_28, FN_IP10_2_0, FN_IP10_5_3,
93 	FN_IP10_8_6, FN_IP10_11_9, FN_IP10_14_12, FN_IP10_15,
94 	FN_IP10_18_16, FN_IP10_21_19, FN_IP11_0, FN_IP11_1,
95 	FN_SCL0, FN_IP11_2, FN_PENC0, FN_IP11_15_13, /* Need check*/
96 	FN_USB_OVC0, FN_IP11_18_16,
97 	FN_IP10_22, FN_IP10_24_23,
98 
99 	/* GPSR5 */
100 	FN_IP10_25, FN_IP11_3, FN_IRQ2_B, FN_IRQ3_B,
101 	FN_IP10_27_26, /* 10 */
102 	FN_IP10_29_28, /* 11 */
103 
104 	/* IPSR0 */
105 	FN_A15, FN_ST0_VCO_CLKIN, FN_LCD_DATA15_A, FN_TIOC3D_C,
106 	FN_A14, FN_LCD_DATA14_A, FN_TIOC3C_C,
107 	FN_A13, FN_LCD_DATA13_A, FN_TIOC3B_C,
108 	FN_A12, FN_LCD_DATA12_A, FN_TIOC3A_C,
109 	FN_A11, FN_ST0_D7, FN_LCD_DATA11_A, FN_TIOC2B_C,
110 	FN_A10, FN_ST0_D6, FN_LCD_DATA10_A, FN_TIOC2A_C,
111 	FN_A9, FN_ST0_D5, FN_LCD_DATA9_A, FN_TIOC1B_C,
112 	FN_A8, FN_ST0_D4, FN_LCD_DATA8_A, FN_TIOC1A_C,
113 	FN_A7, FN_ST0_D3, FN_LCD_DATA7_A, FN_TIOC0D_C,
114 	FN_A6, FN_ST0_D2, FN_LCD_DATA6_A, FN_TIOC0C_C,
115 	FN_A5, FN_ST0_D1, FN_LCD_DATA5_A, FN_TIOC0B_C,
116 	FN_A4, FN_ST0_D0, FN_LCD_DATA4_A, FN_TIOC0A_C,
117 	FN_A3, FN_ST0_VLD, FN_LCD_DATA3_A, FN_TCLKD_C,
118 	FN_A2, FN_ST0_SYC, FN_LCD_DATA2_A, FN_TCLKC_C,
119 	FN_A1, FN_ST0_REQ, FN_LCD_DATA1_A, FN_TCLKB_C,
120 	FN_A0, FN_ST0_CLKIN, FN_LCD_DATA0_A, FN_TCLKA_C,
121 
122 	/* IPSR1 */
123 	FN_D3, FN_SD0_DAT3_A, FN_MMC_D3_A, FN_ST1_D6, FN_FD3_A,
124 	FN_D2, FN_SD0_DAT2_A, FN_MMC_D2_A, FN_ST1_D5, FN_FD2_A,
125 	FN_D1, FN_SD0_DAT1_A, FN_MMC_D1_A, FN_ST1_D4, FN_FD1_A,
126 	FN_D0, FN_SD0_DAT0_A, FN_MMC_D0_A, FN_ST1_D3, FN_FD0_A,
127 	FN_A25, FN_TX2_D, FN_ST1_D2,
128 	FN_A24, FN_RX2_D, FN_ST1_D1,
129 	FN_A23, FN_ST1_D0, FN_LCD_M_DISP_A,
130 	FN_A22, FN_ST1_VLD, FN_LCD_VEPWC_A,
131 	FN_A21, FN_ST1_SYC, FN_LCD_VCPWC_A,
132 	FN_A20, FN_ST1_REQ, FN_LCD_FLM_A,
133 	FN_A19, FN_ST1_CLKIN, FN_LCD_CLK_A,	FN_TIOC4D_C,
134 	FN_A18, FN_ST1_PWM, FN_LCD_CL2_A, FN_TIOC4C_C,
135 	FN_A17, FN_ST1_VCO_CLKIN, FN_LCD_CL1_A,	FN_TIOC4B_C,
136 	FN_A16, FN_ST0_PWM, FN_LCD_DON_A, FN_TIOC4A_C,
137 
138 	/* IPSR2 */
139 	FN_D14, FN_TX2_B, FN_FSE_A, FN_ET0_TX_CLK_B,
140 	FN_D13, FN_RX2_B, FN_FRB_A,	FN_ET0_ETXD6_B,
141 	FN_D12, FN_FWE_A, FN_ET0_ETXD5_B,
142 	FN_D11, FN_RSPI_MISO_A, FN_QMI_QIO1_A, FN_FRE_A,
143 		FN_ET0_ETXD3_B,
144 	FN_D10, FN_RSPI_MOSI_A, FN_QMO_QIO0_A, FN_FALE_A,
145 		FN_ET0_ETXD2_B,
146 	FN_D9, FN_SD0_CMD_A, FN_MMC_CMD_A, FN_QIO3_A, FN_FCLE_A,
147 		FN_ET0_ETXD1_B,
148 	FN_D8, FN_SD0_CLK_A, FN_MMC_CLK_A, FN_QIO2_A, FN_FCE_A,
149 		FN_ET0_GTX_CLK_B,
150 	FN_D7, FN_RSPI_SSL_A, FN_MMC_D7_A, FN_QSSL_A, FN_FD7_A,
151 	FN_D6, FN_RSPI_RSPCK_A, FN_MMC_D6_A, FN_QSPCLK_A, FN_FD6_A,
152 	FN_D5, FN_SD0_WP_A, FN_MMC_D5_A, FN_FD5_A,
153 	FN_D4, FN_SD0_CD_A, FN_MMC_D4_A, FN_ST1_D7, FN_FD4_A,
154 
155 	/* IPSR3 */
156 	FN_DRACK0, FN_SD1_DAT2_A, FN_ATAG, FN_TCLK1_A, FN_ET0_ETXD7,
157 	FN_EX_WAIT2, FN_SD1_DAT1_A, FN_DACK2, FN_CAN1_RX_C,
158 		FN_ET0_MAGIC_C, FN_ET0_ETXD6_A,
159 	FN_EX_WAIT1, FN_SD1_DAT0_A, FN_DREQ2, FN_CAN1_TX_C,
160 		FN_ET0_LINK_C, FN_ET0_ETXD5_A,
161 	FN_EX_WAIT0, FN_TCLK1_B,
162 	FN_RD_WR, FN_TCLK0, FN_CAN_CLK_B, FN_ET0_ETXD4,
163 	FN_EX_CS5, FN_SD1_CMD_A, FN_ATADIR, FN_QSSL_B, FN_ET0_ETXD3_A,
164 	FN_EX_CS4, FN_SD1_WP_A, FN_ATAWR, FN_QMI_QIO1_B, FN_ET0_ETXD2_A,
165 	FN_EX_CS3, FN_SD1_CD_A, FN_ATARD, FN_QMO_QIO0_B, FN_ET0_ETXD1_A,
166 	FN_EX_CS2, FN_TX3_B, FN_ATACS1, FN_QSPCLK_B, FN_ET0_GTX_CLK_A,
167 	FN_EX_CS1, FN_RX3_B, FN_ATACS0, FN_QIO2_B, FN_ET0_ETXD0,
168 	FN_CS1_A26, FN_QIO3_B,
169 	FN_D15, FN_SCK2_B,
170 
171 	/* IPSR4 */
172 	FN_SCK2_A, FN_VI0_G3,
173 	FN_RTS1_B, FN_VI0_G2,
174 	FN_CTS1_B, FN_VI0_DATA7_VI0_G1,
175 	FN_TX1_B, FN_VI0_DATA6_VI0_G0, FN_ET0_PHY_INT_A,
176 	FN_RX1_B, FN_VI0_DATA5_VI0_B5, FN_ET0_MAGIC_A,
177 	FN_SCK1_B, FN_VI0_DATA4_VI0_B4, FN_ET0_LINK_A,
178 	FN_RTS0_B, FN_VI0_DATA3_VI0_B3, FN_ET0_MDIO_A,
179 	FN_CTS0_B, FN_VI0_DATA2_VI0_B2, FN_RMII0_MDIO_A, FN_ET0_MDC,
180 	FN_HTX0_A, FN_TX1_A, FN_VI0_DATA1_VI0_B1, FN_RMII0_MDC_A, FN_ET0_COL,
181 	FN_HRX0_A, FN_RX1_A, FN_VI0_DATA0_VI0_B0, FN_RMII0_CRS_DV_A, FN_ET0_CRS,
182 	FN_HSCK0_A, FN_SCK1_A, FN_VI0_VSYNC, FN_RMII0_RX_ER_A, FN_ET0_RX_ER,
183 	FN_HRTS0_A, FN_RTS1_A, FN_VI0_HSYNC, FN_RMII0_TXD_EN_A, FN_ET0_RX_DV,
184 	FN_HCTS0_A, FN_CTS1_A, FN_VI0_FIELD, FN_RMII0_RXD1_A, FN_ET0_ERXD7,
185 
186 	/* IPSR5 */
187 	FN_SD2_CLK_A, FN_RX2_A, FN_VI0_G4, FN_ET0_RX_CLK_B,
188 	FN_SD2_CMD_A, FN_TX2_A, FN_VI0_G5, FN_ET0_ERXD2_B,
189 	FN_SD2_DAT0_A, FN_RX3_A, FN_VI0_R0, FN_ET0_ERXD3_B,
190 	FN_SD2_DAT1_A, FN_TX3_A, FN_VI0_R1, FN_ET0_MDIO_B,
191 	FN_SD2_DAT2_A, FN_RX4_A, FN_VI0_R2, FN_ET0_LINK_B,
192 	FN_SD2_DAT3_A, FN_TX4_A, FN_VI0_R3, FN_ET0_MAGIC_B,
193 	FN_SD2_CD_A, FN_RX5_A, FN_VI0_R4, FN_ET0_PHY_INT_B,
194 	FN_SD2_WP_A, FN_TX5_A, FN_VI0_R5,
195 	FN_REF125CK, FN_ADTRG, FN_RX5_C,
196 	FN_REF50CK, FN_CTS1_E, FN_HCTS0_D,
197 
198 	/* IPSR6 */
199 	FN_DU0_DR0, FN_SCIF_CLK_B, FN_HRX0_D, FN_IETX_A, FN_TCLKA_A, FN_HIFD00,
200 	FN_DU0_DR1, FN_SCK0_B, FN_HTX0_D, FN_IERX_A, FN_TCLKB_A, FN_HIFD01,
201 	FN_DU0_DR2, FN_RX0_B, FN_TCLKC_A, FN_HIFD02,
202 	FN_DU0_DR3, FN_TX0_B, FN_TCLKD_A, FN_HIFD03,
203 	FN_DU0_DR4, FN_CTS0_C, FN_TIOC0A_A, FN_HIFD04,
204 	FN_DU0_DR5, FN_RTS0_C, FN_TIOC0B_A, FN_HIFD05,
205 	FN_DU0_DR6, FN_SCK1_C, FN_TIOC0C_A, FN_HIFD06,
206 	FN_DU0_DR7, FN_RX1_C, FN_TIOC0D_A, FN_HIFD07,
207 	FN_DU0_DG0, FN_TX1_C, FN_HSCK0_D, FN_IECLK_A, FN_TIOC1A_A, FN_HIFD08,
208 	FN_DU0_DG1, FN_CTS1_C, FN_HRTS0_D, FN_TIOC1B_A, FN_HIFD09,
209 
210 	/* IPSR7 */
211 	FN_DU0_DG2, FN_RTS1_C, FN_RMII0_MDC_B, FN_TIOC2A_A, FN_HIFD10,
212 	FN_DU0_DG3, FN_SCK2_C, FN_RMII0_MDIO_B, FN_TIOC2B_A, FN_HIFD11,
213 	FN_DU0_DG4, FN_RX2_C, FN_RMII0_CRS_DV_B, FN_TIOC3A_A, FN_HIFD12,
214 	FN_DU0_DG5, FN_TX2_C, FN_RMII0_RX_ER_B, FN_TIOC3B_A, FN_HIFD13,
215 	FN_DU0_DG6, FN_RX3_C, FN_RMII0_RXD0_B, FN_TIOC3C_A, FN_HIFD14,
216 	FN_DU0_DG7, FN_TX3_C, FN_RMII0_RXD1_B, FN_TIOC3D_A, FN_HIFD15,
217 	FN_DU0_DB0, FN_RX4_C, FN_RMII0_TXD_EN_B, FN_TIOC4A_A, FN_HIFCS,
218 	FN_DU0_DB1, FN_TX4_C, FN_RMII0_TXD0_B, FN_TIOC4B_A, FN_HIFRS,
219 	FN_DU0_DB2, FN_RX5_B, FN_RMII0_TXD1_B, FN_TIOC4C_A, FN_HIFWR,
220 	FN_DU0_DB3, FN_TX5_B, FN_TIOC4D_A, FN_HIFRD,
221 	FN_DU0_DB4, FN_HIFINT,
222 
223 	/* IPSR8 */
224 	FN_DU0_DB5, FN_HIFDREQ,
225 	FN_DU0_DB6, FN_HIFRDY,
226 	FN_DU0_DB7, FN_SSI_SCK0_B, FN_HIFEBL_B,
227 	FN_DU0_DOTCLKIN, FN_HSPI_CS0_C, FN_SSI_WS0_B,
228 	FN_DU0_DOTCLKOUT, FN_HSPI_CLK0_C, FN_SSI_SDATA0_B,
229 	FN_DU0_EXHSYNC_DU0_HSYNC, FN_HSPI_TX0_C, FN_SSI_SCK1_B,
230 	FN_DU0_EXVSYNC_DU0_VSYNC, FN_HSPI_RX0_C, FN_SSI_WS1_B,
231 	FN_DU0_EXODDF_DU0_ODDF, FN_CAN0_RX_B, FN_HSCK0_B, FN_SSI_SDATA1_B,
232 	FN_DU0_DISP, FN_CAN0_TX_B, FN_HRX0_B, FN_AUDIO_CLKA_B,
233 	FN_DU0_CDE, FN_HTX0_B, FN_AUDIO_CLKB_B, FN_LCD_VCPWC_B,
234 	FN_IRQ0_A, FN_HSPI_TX_B, FN_RX3_E, FN_ET0_ERXD0,
235 	FN_IRQ1_A, FN_HSPI_RX_B, FN_TX3_E, FN_ET0_ERXD1,
236 	FN_IRQ2_A, FN_CTS0_A, FN_HCTS0_B, FN_ET0_ERXD2_A,
237 	FN_IRQ3_A, FN_RTS0_A, FN_HRTS0_B, FN_ET0_ERXD3_A,
238 
239 	/* IPSR9 */
240 	FN_VI1_CLK_A, FN_FD0_B, FN_LCD_DATA0_B,
241 	FN_VI1_0_A, FN_FD1_B, FN_LCD_DATA1_B,
242 	FN_VI1_1_A, FN_FD2_B, FN_LCD_DATA2_B,
243 	FN_VI1_2_A, FN_FD3_B, FN_LCD_DATA3_B,
244 	FN_VI1_3_A, FN_FD4_B, FN_LCD_DATA4_B,
245 	FN_VI1_4_A, FN_FD5_B, FN_LCD_DATA5_B,
246 	FN_VI1_5_A, FN_FD6_B, FN_LCD_DATA6_B,
247 	FN_VI1_6_A, FN_FD7_B, FN_LCD_DATA7_B,
248 	FN_VI1_7_A, FN_FCE_B, FN_LCD_DATA8_B,
249 	FN_SSI_SCK0_A, FN_TIOC1A_B, FN_LCD_DATA9_B,
250 	FN_SSI_WS0_A, FN_TIOC1B_B, FN_LCD_DATA10_B,
251 	FN_SSI_SDATA0_A, FN_VI1_0_B, FN_TIOC2A_B, FN_LCD_DATA11_B,
252 	FN_SSI_SCK1_A, FN_VI1_1_B, FN_TIOC2B_B, FN_LCD_DATA12_B,
253 	FN_SSI_WS1_A, FN_VI1_2_B, FN_LCD_DATA13_B,
254 	FN_SSI_SDATA1_A, FN_VI1_3_B, FN_LCD_DATA14_B,
255 
256 	/* IPSR10 */
257 	FN_SSI_SCK23, FN_VI1_4_B, FN_RX1_D, FN_FCLE_B, FN_LCD_DATA15_B,
258 	FN_SSI_WS23, FN_VI1_5_B, FN_TX1_D, FN_HSCK0_C, FN_FALE_B, FN_LCD_DON_B,
259 	FN_SSI_SDATA2, FN_VI1_6_B, FN_HRX0_C, FN_FRE_B, FN_LCD_CL1_B,
260 	FN_SSI_SDATA3, FN_VI1_7_B, FN_HTX0_C, FN_FWE_B, FN_LCD_CL2_B,
261 	FN_AUDIO_CLKA_A, FN_VI1_CLK_B, FN_SCK1_D, FN_IECLK_B, FN_LCD_FLM_B,
262 	FN_AUDIO_CLKB_A, FN_LCD_CLK_B,
263 	FN_AUDIO_CLKC, FN_SCK1_E, FN_HCTS0_C, FN_FRB_B, FN_LCD_VEPWC_B,
264 	FN_AUDIO_CLKOUT, FN_TX1_E, FN_HRTS0_C, FN_FSE_B, FN_LCD_M_DISP_B,
265 	FN_CAN_CLK_A, FN_RX4_D,
266 	FN_CAN0_TX_A, FN_TX4_D, FN_MLB_CLK,
267 	FN_CAN1_RX_A, FN_IRQ1_B,
268 	FN_CAN0_RX_A, FN_IRQ0_B, FN_MLB_SIG,
269 	FN_CAN1_TX_A, FN_TX5_C, FN_MLB_DAT,
270 
271 	/* IPSR11 */
272 	FN_SCL1, FN_SCIF_CLK_C,
273 	FN_SDA1, FN_RX1_E,
274 	FN_SDA0, FN_HIFEBL_A,
275 	FN_SDSELF, FN_RTS1_E,
276 	FN_SCIF_CLK_A, FN_HSPI_CLK_A, FN_VI0_CLK, FN_RMII0_TXD0_A, FN_ET0_ERXD4,
277 	FN_SCK0_A, FN_HSPI_CS_A, FN_VI0_CLKENB, FN_RMII0_TXD1_A, FN_ET0_ERXD5,
278 	FN_RX0_A, FN_HSPI_RX_A, FN_RMII0_RXD0_A, FN_ET0_ERXD6,
279 	FN_TX0_A, FN_HSPI_TX_A,
280 	FN_PENC1, FN_TX3_D, FN_CAN1_TX_B, FN_TX5_D, FN_IETX_B,
281 	FN_USB_OVC1, FN_RX3_D, FN_CAN1_RX_B, FN_RX5_D, FN_IERX_B,
282 	FN_DREQ0, FN_SD1_CLK_A, FN_ET0_TX_EN,
283 	FN_DACK0, FN_SD1_DAT3_A, FN_ET0_TX_ER,
284 	FN_DREQ1, FN_HSPI_CLK_B, FN_RX4_B, FN_ET0_PHY_INT_C, FN_ET0_TX_CLK_A,
285 	FN_DACK1, FN_HSPI_CS_B, FN_TX4_B, FN_ET0_RX_CLK_A,
286 	FN_PRESETOUT, FN_ST_CLKOUT,
287 
288 	/* MOD_SEL1 */
289 	FN_SEL_IEBUS_0, FN_SEL_IEBUS_1,
290 	FN_SEL_RQSPI_0, FN_SEL_RQSPI_1,
291 	FN_SEL_VIN1_0, FN_SEL_VIN1_1,
292 	FN_SEL_HIF_0, FN_SEL_HIF_1,
293 	FN_SEL_RSPI_0, FN_SEL_RSPI_1,
294 	FN_SEL_LCDC_0, FN_SEL_LCDC_1,
295 	FN_SEL_ET0_CTL_0, FN_SEL_ET0_CTL_1, FN_SEL_ET0_CTL_2,
296 	FN_SEL_ET0_0, FN_SEL_ET0_1,
297 	FN_SEL_RMII_0, FN_SEL_RMII_1,
298 	FN_SEL_TMU_0, FN_SEL_TMU_1,
299 	FN_SEL_HSPI_0, FN_SEL_HSPI_1, FN_SEL_HSPI_2,
300 	FN_SEL_HSCIF_0, FN_SEL_HSCIF_1, FN_SEL_HSCIF_2, FN_SEL_HSCIF_3,
301 	FN_SEL_RCAN_CLK_0, FN_SEL_RCAN_CLK_1,
302 	FN_SEL_RCAN1_0, FN_SEL_RCAN1_1, FN_SEL_RCAN1_2,
303 	FN_SEL_RCAN0_0, FN_SEL_RCAN0_1,
304 	FN_SEL_SDHI2_0, FN_SEL_SDHI2_1,
305 	FN_SEL_SDHI1_0, FN_SEL_SDHI1_1,
306 	FN_SEL_SDHI0_0, FN_SEL_SDHI0_1,
307 	FN_SEL_SSI1_0, FN_SEL_SSI1_1,
308 	FN_SEL_SSI0_0, FN_SEL_SSI0_1,
309 	FN_SEL_AUDIO_CLKB_0, FN_SEL_AUDIO_CLKB_1,
310 	FN_SEL_AUDIO_CLKA_0, FN_SEL_AUDIO_CLKA_1,
311 	FN_SEL_FLCTL_0, FN_SEL_FLCTL_1,
312 	FN_SEL_MMC_0, FN_SEL_MMC_1,
313 	FN_SEL_INTC_0, FN_SEL_INTC_1,
314 
315 	/* MOD_SEL2 */
316 	FN_SEL_MTU2_CLK_0, FN_SEL_MTU2_CLK_1,
317 	FN_SEL_MTU2_CH4_0, FN_SEL_MTU2_CH4_1,
318 	FN_SEL_MTU2_CH3_0, FN_SEL_MTU2_CH3_1,
319 	FN_SEL_MTU2_CH2_0, FN_SEL_MTU2_CH2_1, FN_SEL_MTU2_CH2_2,
320 	FN_SEL_MTU2_CH1_0, FN_SEL_MTU2_CH1_1, FN_SEL_MTU2_CH1_2,
321 	FN_SEL_MTU2_CH0_0, FN_SEL_MTU2_CH0_1,
322 	FN_SEL_SCIF5_0, FN_SEL_SCIF5_1,
323 	FN_SEL_SCIF5_2, FN_SEL_SCIF5_3,
324 	FN_SEL_SCIF4_0, FN_SEL_SCIF4_1,
325 	FN_SEL_SCIF4_2, FN_SEL_SCIF4_3,
326 	FN_SEL_SCIF3_0, FN_SEL_SCIF3_1, FN_SEL_SCIF3_2,
327 		FN_SEL_SCIF3_3, FN_SEL_SCIF3_4,
328 	FN_SEL_SCIF2_0, FN_SEL_SCIF2_1, FN_SEL_SCIF2_2,
329 		FN_SEL_SCIF2_3,
330 	FN_SEL_SCIF1_0, FN_SEL_SCIF1_1, FN_SEL_SCIF1_2,
331 		FN_SEL_SCIF1_3, FN_SEL_SCIF1_4,
332 	FN_SEL_SCIF0_0, FN_SEL_SCIF0_1, FN_SEL_SCIF0_2,
333 	FN_SEL_SCIF_CLK_0, FN_SEL_SCIF_CLK_1, FN_SEL_SCIF_CLK_2,
334 
335 	PINMUX_FUNCTION_END,
336 
337 	PINMUX_MARK_BEGIN,
338 
339 	CLKOUT_MARK, BS_MARK, CS0_MARK, EX_CS0_MARK, RD_MARK,
340 	WE0_MARK, WE1_MARK,
341 
342 	SCL0_MARK, PENC0_MARK, USB_OVC0_MARK,
343 
344 	IRQ2_B_MARK, IRQ3_B_MARK,
345 
346 	/* IPSR0 */
347 	A15_MARK, ST0_VCO_CLKIN_MARK, LCD_DATA15_A_MARK, TIOC3D_C_MARK,
348 	A14_MARK, LCD_DATA14_A_MARK, TIOC3C_C_MARK,
349 	A13_MARK, LCD_DATA13_A_MARK, TIOC3B_C_MARK,
350 	A12_MARK, LCD_DATA12_A_MARK, TIOC3A_C_MARK,
351 	A11_MARK, ST0_D7_MARK, LCD_DATA11_A_MARK, TIOC2B_C_MARK,
352 	A10_MARK, ST0_D6_MARK, LCD_DATA10_A_MARK, TIOC2A_C_MARK,
353 	A9_MARK, ST0_D5_MARK, LCD_DATA9_A_MARK, TIOC1B_C_MARK,
354 	A8_MARK, ST0_D4_MARK, LCD_DATA8_A_MARK, TIOC1A_C_MARK,
355 	A7_MARK, ST0_D3_MARK, LCD_DATA7_A_MARK, TIOC0D_C_MARK,
356 	A6_MARK, ST0_D2_MARK, LCD_DATA6_A_MARK, TIOC0C_C_MARK,
357 	A5_MARK, ST0_D1_MARK, LCD_DATA5_A_MARK, TIOC0B_C_MARK,
358 	A4_MARK, ST0_D0_MARK, LCD_DATA4_A_MARK, TIOC0A_C_MARK,
359 	A3_MARK, ST0_VLD_MARK, LCD_DATA3_A_MARK, TCLKD_C_MARK,
360 	A2_MARK, ST0_SYC_MARK, LCD_DATA2_A_MARK, TCLKC_C_MARK,
361 	A1_MARK, ST0_REQ_MARK, LCD_DATA1_A_MARK, TCLKB_C_MARK,
362 	A0_MARK, ST0_CLKIN_MARK, LCD_DATA0_A_MARK, TCLKA_C_MARK,
363 
364 	/* IPSR1 */
365 	D3_MARK, SD0_DAT3_A_MARK, MMC_D3_A_MARK, ST1_D6_MARK, FD3_A_MARK,
366 	D2_MARK, SD0_DAT2_A_MARK, MMC_D2_A_MARK, ST1_D5_MARK, FD2_A_MARK,
367 	D1_MARK, SD0_DAT1_A_MARK, MMC_D1_A_MARK, ST1_D4_MARK, FD1_A_MARK,
368 	D0_MARK, SD0_DAT0_A_MARK, MMC_D0_A_MARK, ST1_D3_MARK, FD0_A_MARK,
369 	A25_MARK, TX2_D_MARK, ST1_D2_MARK,
370 	A24_MARK, RX2_D_MARK, ST1_D1_MARK,
371 	A23_MARK, ST1_D0_MARK, LCD_M_DISP_A_MARK,
372 	A22_MARK, ST1_VLD_MARK, LCD_VEPWC_A_MARK,
373 	A21_MARK, ST1_SYC_MARK, LCD_VCPWC_A_MARK,
374 	A20_MARK, ST1_REQ_MARK, LCD_FLM_A_MARK,
375 	A19_MARK, ST1_CLKIN_MARK, LCD_CLK_A_MARK,	TIOC4D_C_MARK,
376 	A18_MARK, ST1_PWM_MARK, LCD_CL2_A_MARK, TIOC4C_C_MARK,
377 	A17_MARK, ST1_VCO_CLKIN_MARK, LCD_CL1_A_MARK, TIOC4B_C_MARK,
378 	A16_MARK, ST0_PWM_MARK, LCD_DON_A_MARK, TIOC4A_C_MARK,
379 
380 	/* IPSR2 */
381 	D14_MARK, TX2_B_MARK, FSE_A_MARK, ET0_TX_CLK_B_MARK,
382 	D13_MARK, RX2_B_MARK, FRB_A_MARK, ET0_ETXD6_B_MARK,
383 	D12_MARK, FWE_A_MARK, ET0_ETXD5_B_MARK,
384 	D11_MARK, RSPI_MISO_A_MARK, QMI_QIO1_A_MARK, FRE_A_MARK,
385 		ET0_ETXD3_B_MARK,
386 	D10_MARK, RSPI_MOSI_A_MARK, QMO_QIO0_A_MARK, FALE_A_MARK,
387 		ET0_ETXD2_B_MARK,
388 	D9_MARK, SD0_CMD_A_MARK, MMC_CMD_A_MARK, QIO3_A_MARK,
389 		FCLE_A_MARK, ET0_ETXD1_B_MARK,
390 	D8_MARK, SD0_CLK_A_MARK, MMC_CLK_A_MARK, QIO2_A_MARK,
391 		FCE_A_MARK, ET0_GTX_CLK_B_MARK,
392 	D7_MARK, RSPI_SSL_A_MARK, MMC_D7_A_MARK, QSSL_A_MARK,
393 		FD7_A_MARK,
394 	D6_MARK, RSPI_RSPCK_A_MARK, MMC_D6_A_MARK, QSPCLK_A_MARK,
395 		FD6_A_MARK,
396 	D5_MARK, SD0_WP_A_MARK, MMC_D5_A_MARK, FD5_A_MARK,
397 	D4_MARK, SD0_CD_A_MARK, MMC_D4_A_MARK, ST1_D7_MARK,
398 		FD4_A_MARK,
399 
400 	/* IPSR3 */
401 	DRACK0_MARK, SD1_DAT2_A_MARK, ATAG_MARK, TCLK1_A_MARK, ET0_ETXD7_MARK,
402 	EX_WAIT2_MARK, SD1_DAT1_A_MARK, DACK2_MARK, CAN1_RX_C_MARK,
403 		ET0_MAGIC_C_MARK, ET0_ETXD6_A_MARK,
404 	EX_WAIT1_MARK, SD1_DAT0_A_MARK, DREQ2_MARK, CAN1_TX_C_MARK,
405 		ET0_LINK_C_MARK, ET0_ETXD5_A_MARK,
406 	EX_WAIT0_MARK, TCLK1_B_MARK,
407 	RD_WR_MARK, TCLK0_MARK, CAN_CLK_B_MARK, ET0_ETXD4_MARK,
408 	EX_CS5_MARK, SD1_CMD_A_MARK, ATADIR_MARK, QSSL_B_MARK,
409 		ET0_ETXD3_A_MARK,
410 	EX_CS4_MARK, SD1_WP_A_MARK, ATAWR_MARK, QMI_QIO1_B_MARK,
411 		ET0_ETXD2_A_MARK,
412 	EX_CS3_MARK, SD1_CD_A_MARK, ATARD_MARK, QMO_QIO0_B_MARK,
413 		ET0_ETXD1_A_MARK,
414 	EX_CS2_MARK, TX3_B_MARK, ATACS1_MARK, QSPCLK_B_MARK,
415 		ET0_GTX_CLK_A_MARK,
416 	EX_CS1_MARK, RX3_B_MARK, ATACS0_MARK, QIO2_B_MARK,
417 		ET0_ETXD0_MARK,
418 	CS1_A26_MARK, QIO3_B_MARK,
419 	D15_MARK, SCK2_B_MARK,
420 
421 	/* IPSR4 */
422 	SCK2_A_MARK, VI0_G3_MARK,
423 	RTS1_B_MARK, VI0_G2_MARK,
424 	CTS1_B_MARK, VI0_DATA7_VI0_G1_MARK,
425 	TX1_B_MARK, VI0_DATA6_VI0_G0_MARK, ET0_PHY_INT_A_MARK,
426 	RX1_B_MARK, VI0_DATA5_VI0_B5_MARK, ET0_MAGIC_A_MARK,
427 	SCK1_B_MARK, VI0_DATA4_VI0_B4_MARK, ET0_LINK_A_MARK,
428 	RTS0_B_MARK, VI0_DATA3_VI0_B3_MARK, ET0_MDIO_A_MARK,
429 	CTS0_B_MARK, VI0_DATA2_VI0_B2_MARK, RMII0_MDIO_A_MARK,
430 		ET0_MDC_MARK,
431 	HTX0_A_MARK, TX1_A_MARK, VI0_DATA1_VI0_B1_MARK,
432 		RMII0_MDC_A_MARK, ET0_COL_MARK,
433 	HRX0_A_MARK, RX1_A_MARK, VI0_DATA0_VI0_B0_MARK,
434 		RMII0_CRS_DV_A_MARK, ET0_CRS_MARK,
435 	HSCK0_A_MARK, SCK1_A_MARK, VI0_VSYNC_MARK,
436 		RMII0_RX_ER_A_MARK, ET0_RX_ER_MARK,
437 	HRTS0_A_MARK, RTS1_A_MARK, VI0_HSYNC_MARK,
438 		RMII0_TXD_EN_A_MARK, ET0_RX_DV_MARK,
439 	HCTS0_A_MARK, CTS1_A_MARK, VI0_FIELD_MARK,
440 		RMII0_RXD1_A_MARK, ET0_ERXD7_MARK,
441 
442 	/* IPSR5 */
443 	SD2_CLK_A_MARK, RX2_A_MARK, VI0_G4_MARK, ET0_RX_CLK_B_MARK,
444 	SD2_CMD_A_MARK, TX2_A_MARK, VI0_G5_MARK, ET0_ERXD2_B_MARK,
445 	SD2_DAT0_A_MARK, RX3_A_MARK, VI0_R0_MARK, ET0_ERXD3_B_MARK,
446 	SD2_DAT1_A_MARK, TX3_A_MARK, VI0_R1_MARK, ET0_MDIO_B_MARK,
447 	SD2_DAT2_A_MARK, RX4_A_MARK, VI0_R2_MARK, ET0_LINK_B_MARK,
448 	SD2_DAT3_A_MARK, TX4_A_MARK, VI0_R3_MARK, ET0_MAGIC_B_MARK,
449 	SD2_CD_A_MARK, RX5_A_MARK, VI0_R4_MARK, ET0_PHY_INT_B_MARK,
450 	SD2_WP_A_MARK, TX5_A_MARK, VI0_R5_MARK,
451 	REF125CK_MARK, ADTRG_MARK, RX5_C_MARK,
452 	REF50CK_MARK, CTS1_E_MARK, HCTS0_D_MARK,
453 
454 	/* IPSR6 */
455 	DU0_DR0_MARK, SCIF_CLK_B_MARK, HRX0_D_MARK, IETX_A_MARK,
456 		TCLKA_A_MARK, HIFD00_MARK,
457 	DU0_DR1_MARK, SCK0_B_MARK, HTX0_D_MARK, IERX_A_MARK,
458 		TCLKB_A_MARK, HIFD01_MARK,
459 	DU0_DR2_MARK, RX0_B_MARK, TCLKC_A_MARK, HIFD02_MARK,
460 	DU0_DR3_MARK, TX0_B_MARK, TCLKD_A_MARK, HIFD03_MARK,
461 	DU0_DR4_MARK, CTS0_C_MARK, TIOC0A_A_MARK, HIFD04_MARK,
462 	DU0_DR5_MARK, RTS0_C_MARK, TIOC0B_A_MARK, HIFD05_MARK,
463 	DU0_DR6_MARK, SCK1_C_MARK, TIOC0C_A_MARK, HIFD06_MARK,
464 	DU0_DR7_MARK, RX1_C_MARK, TIOC0D_A_MARK, HIFD07_MARK,
465 	DU0_DG0_MARK, TX1_C_MARK, HSCK0_D_MARK, IECLK_A_MARK,
466 		TIOC1A_A_MARK, HIFD08_MARK,
467 	DU0_DG1_MARK, CTS1_C_MARK, HRTS0_D_MARK, TIOC1B_A_MARK,
468 		HIFD09_MARK,
469 
470 	/* IPSR7 */
471 	DU0_DG2_MARK, RTS1_C_MARK, RMII0_MDC_B_MARK, TIOC2A_A_MARK,
472 		HIFD10_MARK,
473 	DU0_DG3_MARK, SCK2_C_MARK, RMII0_MDIO_B_MARK, TIOC2B_A_MARK,
474 		HIFD11_MARK,
475 	DU0_DG4_MARK, RX2_C_MARK, RMII0_CRS_DV_B_MARK, TIOC3A_A_MARK,
476 		HIFD12_MARK,
477 	DU0_DG5_MARK, TX2_C_MARK, RMII0_RX_ER_B_MARK, TIOC3B_A_MARK,
478 		HIFD13_MARK,
479 	DU0_DG6_MARK, RX3_C_MARK, RMII0_RXD0_B_MARK, TIOC3C_A_MARK,
480 		HIFD14_MARK,
481 	DU0_DG7_MARK, TX3_C_MARK, RMII0_RXD1_B_MARK, TIOC3D_A_MARK,
482 		HIFD15_MARK,
483 	DU0_DB0_MARK, RX4_C_MARK, RMII0_TXD_EN_B_MARK, TIOC4A_A_MARK,
484 		HIFCS_MARK,
485 	DU0_DB1_MARK, TX4_C_MARK, RMII0_TXD0_B_MARK, TIOC4B_A_MARK,
486 		HIFRS_MARK,
487 	DU0_DB2_MARK, RX5_B_MARK, RMII0_TXD1_B_MARK, TIOC4C_A_MARK,
488 		HIFWR_MARK,
489 	DU0_DB3_MARK, TX5_B_MARK, TIOC4D_A_MARK, HIFRD_MARK,
490 	DU0_DB4_MARK, HIFINT_MARK,
491 
492 	/* IPSR8 */
493 	DU0_DB5_MARK, HIFDREQ_MARK,
494 	DU0_DB6_MARK, HIFRDY_MARK,
495 	DU0_DB7_MARK, SSI_SCK0_B_MARK, HIFEBL_B_MARK,
496 	DU0_DOTCLKIN_MARK, HSPI_CS0_C_MARK, SSI_WS0_B_MARK,
497 	DU0_DOTCLKOUT_MARK, HSPI_CLK0_C_MARK, SSI_SDATA0_B_MARK,
498 	DU0_EXHSYNC_DU0_HSYNC_MARK, HSPI_TX0_C_MARK, SSI_SCK1_B_MARK,
499 	DU0_EXVSYNC_DU0_VSYNC_MARK, HSPI_RX0_C_MARK, SSI_WS1_B_MARK,
500 	DU0_EXODDF_DU0_ODDF_MARK, CAN0_RX_B_MARK, HSCK0_B_MARK,
501 		SSI_SDATA1_B_MARK,
502 	DU0_DISP_MARK, CAN0_TX_B_MARK, HRX0_B_MARK, AUDIO_CLKA_B_MARK,
503 	DU0_CDE_MARK, HTX0_B_MARK, AUDIO_CLKB_B_MARK, LCD_VCPWC_B_MARK,
504 	IRQ0_A_MARK, HSPI_TX_B_MARK, RX3_E_MARK, ET0_ERXD0_MARK,
505 	IRQ1_A_MARK, HSPI_RX_B_MARK, TX3_E_MARK, ET0_ERXD1_MARK,
506 	IRQ2_A_MARK, CTS0_A_MARK, HCTS0_B_MARK, ET0_ERXD2_A_MARK,
507 	IRQ3_A_MARK, RTS0_A_MARK, HRTS0_B_MARK, ET0_ERXD3_A_MARK,
508 
509 	/* IPSR9 */
510 	VI1_CLK_A_MARK, FD0_B_MARK, LCD_DATA0_B_MARK,
511 	VI1_0_A_MARK, FD1_B_MARK, LCD_DATA1_B_MARK,
512 	VI1_1_A_MARK, FD2_B_MARK, LCD_DATA2_B_MARK,
513 	VI1_2_A_MARK, FD3_B_MARK, LCD_DATA3_B_MARK,
514 	VI1_3_A_MARK, FD4_B_MARK, LCD_DATA4_B_MARK,
515 	VI1_4_A_MARK, FD5_B_MARK, LCD_DATA5_B_MARK,
516 	VI1_5_A_MARK, FD6_B_MARK, LCD_DATA6_B_MARK,
517 	VI1_6_A_MARK, FD7_B_MARK, LCD_DATA7_B_MARK,
518 	VI1_7_A_MARK, FCE_B_MARK, LCD_DATA8_B_MARK,
519 	SSI_SCK0_A_MARK, TIOC1A_B_MARK, LCD_DATA9_B_MARK,
520 	SSI_WS0_A_MARK, TIOC1B_B_MARK, LCD_DATA10_B_MARK,
521 	SSI_SDATA0_A_MARK, VI1_0_B_MARK, TIOC2A_B_MARK, LCD_DATA11_B_MARK,
522 	SSI_SCK1_A_MARK, VI1_1_B_MARK, TIOC2B_B_MARK, LCD_DATA12_B_MARK,
523 	SSI_WS1_A_MARK, VI1_2_B_MARK, LCD_DATA13_B_MARK,
524 	SSI_SDATA1_A_MARK, VI1_3_B_MARK, LCD_DATA14_B_MARK,
525 
526 	/* IPSR10 */
527 	SSI_SCK23_MARK, VI1_4_B_MARK, RX1_D_MARK, FCLE_B_MARK,
528 		LCD_DATA15_B_MARK,
529 	SSI_WS23_MARK, VI1_5_B_MARK, TX1_D_MARK, HSCK0_C_MARK,
530 		FALE_B_MARK, LCD_DON_B_MARK,
531 	SSI_SDATA2_MARK, VI1_6_B_MARK, HRX0_C_MARK, FRE_B_MARK,
532 		LCD_CL1_B_MARK,
533 	SSI_SDATA3_MARK, VI1_7_B_MARK, HTX0_C_MARK, FWE_B_MARK,
534 		LCD_CL2_B_MARK,
535 	AUDIO_CLKA_A_MARK, VI1_CLK_B_MARK, SCK1_D_MARK, IECLK_B_MARK,
536 		LCD_FLM_B_MARK,
537 	AUDIO_CLKB_A_MARK, LCD_CLK_B_MARK,
538 	AUDIO_CLKC_MARK, SCK1_E_MARK, HCTS0_C_MARK, FRB_B_MARK,
539 		LCD_VEPWC_B_MARK,
540 	AUDIO_CLKOUT_MARK, TX1_E_MARK, HRTS0_C_MARK, FSE_B_MARK,
541 		LCD_M_DISP_B_MARK,
542 	CAN_CLK_A_MARK, RX4_D_MARK,
543 	CAN0_TX_A_MARK, TX4_D_MARK, MLB_CLK_MARK,
544 	CAN1_RX_A_MARK, IRQ1_B_MARK,
545 	CAN0_RX_A_MARK, IRQ0_B_MARK, MLB_SIG_MARK,
546 	CAN1_TX_A_MARK, TX5_C_MARK, MLB_DAT_MARK,
547 
548 	/* IPSR11 */
549 	SCL1_MARK, SCIF_CLK_C_MARK,
550 	SDA1_MARK, RX1_E_MARK,
551 	SDA0_MARK, HIFEBL_A_MARK,
552 	SDSELF_MARK, RTS1_E_MARK,
553 	SCIF_CLK_A_MARK, HSPI_CLK_A_MARK, VI0_CLK_MARK, RMII0_TXD0_A_MARK,
554 		ET0_ERXD4_MARK,
555 	SCK0_A_MARK, HSPI_CS_A_MARK, VI0_CLKENB_MARK, RMII0_TXD1_A_MARK,
556 		ET0_ERXD5_MARK,
557 	RX0_A_MARK, HSPI_RX_A_MARK, RMII0_RXD0_A_MARK, ET0_ERXD6_MARK,
558 	TX0_A_MARK, HSPI_TX_A_MARK,
559 	PENC1_MARK, TX3_D_MARK, CAN1_TX_B_MARK, TX5_D_MARK,
560 		IETX_B_MARK,
561 	USB_OVC1_MARK, RX3_D_MARK, CAN1_RX_B_MARK, RX5_D_MARK,
562 		IERX_B_MARK,
563 	DREQ0_MARK, SD1_CLK_A_MARK, ET0_TX_EN_MARK,
564 	DACK0_MARK, SD1_DAT3_A_MARK, ET0_TX_ER_MARK,
565 	DREQ1_MARK, HSPI_CLK_B_MARK, RX4_B_MARK, ET0_PHY_INT_C_MARK,
566 		ET0_TX_CLK_A_MARK,
567 	DACK1_MARK, HSPI_CS_B_MARK, TX4_B_MARK, ET0_RX_CLK_A_MARK,
568 	PRESETOUT_MARK, ST_CLKOUT_MARK,
569 
570 	PINMUX_MARK_END,
571 };
572 
573 static const u16 pinmux_data[] = {
574 	PINMUX_DATA_GP_ALL(), /* PINMUX_DATA(GP_M_N_DATA, GP_M_N_FN...), */
575 
576 	PINMUX_SINGLE(CLKOUT),
577 	PINMUX_SINGLE(BS),
578 	PINMUX_SINGLE(CS0),
579 	PINMUX_SINGLE(EX_CS0),
580 	PINMUX_SINGLE(RD),
581 	PINMUX_SINGLE(WE0),
582 	PINMUX_SINGLE(WE1),
583 	PINMUX_SINGLE(SCL0),
584 	PINMUX_SINGLE(PENC0),
585 	PINMUX_SINGLE(USB_OVC0),
586 	PINMUX_SINGLE(IRQ2_B),
587 	PINMUX_SINGLE(IRQ3_B),
588 
589 	/* IPSR0 */
590 	PINMUX_IPSR_GPSR(IP0_1_0, A0),
591 	PINMUX_IPSR_GPSR(IP0_1_0, ST0_CLKIN),
592 	PINMUX_IPSR_MSEL(IP0_1_0, LCD_DATA0_A, SEL_LCDC_0),
593 	PINMUX_IPSR_MSEL(IP0_1_0, TCLKA_C, SEL_MTU2_CLK_1),
594 
595 	PINMUX_IPSR_GPSR(IP0_3_2, A1),
596 	PINMUX_IPSR_GPSR(IP0_3_2, ST0_REQ),
597 	PINMUX_IPSR_MSEL(IP0_3_2, LCD_DATA1_A, SEL_LCDC_0),
598 	PINMUX_IPSR_MSEL(IP0_3_2, TCLKB_C, SEL_MTU2_CLK_1),
599 
600 	PINMUX_IPSR_GPSR(IP0_5_4, A2),
601 	PINMUX_IPSR_GPSR(IP0_5_4, ST0_SYC),
602 	PINMUX_IPSR_MSEL(IP0_5_4, LCD_DATA2_A, SEL_LCDC_0),
603 	PINMUX_IPSR_MSEL(IP0_5_4, TCLKC_C, SEL_MTU2_CLK_1),
604 
605 	PINMUX_IPSR_GPSR(IP0_7_6, A3),
606 	PINMUX_IPSR_GPSR(IP0_7_6, ST0_VLD),
607 	PINMUX_IPSR_MSEL(IP0_7_6, LCD_DATA3_A, SEL_LCDC_0),
608 	PINMUX_IPSR_MSEL(IP0_7_6, TCLKD_C, SEL_MTU2_CLK_1),
609 
610 	PINMUX_IPSR_GPSR(IP0_9_8, A4),
611 	PINMUX_IPSR_GPSR(IP0_9_8, ST0_D0),
612 	PINMUX_IPSR_MSEL(IP0_9_8, LCD_DATA4_A, SEL_LCDC_0),
613 	PINMUX_IPSR_MSEL(IP0_9_8, TIOC0A_C, SEL_MTU2_CH0_1),
614 
615 	PINMUX_IPSR_GPSR(IP0_11_10, A5),
616 	PINMUX_IPSR_GPSR(IP0_11_10, ST0_D1),
617 	PINMUX_IPSR_MSEL(IP0_11_10, LCD_DATA5_A, SEL_LCDC_0),
618 	PINMUX_IPSR_MSEL(IP0_11_10, TIOC0B_C, SEL_MTU2_CH0_1),
619 
620 	PINMUX_IPSR_GPSR(IP0_13_12, A6),
621 	PINMUX_IPSR_GPSR(IP0_13_12, ST0_D2),
622 	PINMUX_IPSR_MSEL(IP0_13_12, LCD_DATA6_A, SEL_LCDC_0),
623 	PINMUX_IPSR_MSEL(IP0_13_12, TIOC0C_C, SEL_MTU2_CH0_1),
624 
625 	PINMUX_IPSR_GPSR(IP0_15_14, A7),
626 	PINMUX_IPSR_GPSR(IP0_15_14, ST0_D3),
627 	PINMUX_IPSR_MSEL(IP0_15_14, LCD_DATA7_A, SEL_LCDC_0),
628 	PINMUX_IPSR_MSEL(IP0_15_14, TIOC0D_C, SEL_MTU2_CH0_1),
629 
630 	PINMUX_IPSR_GPSR(IP0_17_16, A8),
631 	PINMUX_IPSR_GPSR(IP0_17_16, ST0_D4),
632 	PINMUX_IPSR_MSEL(IP0_17_16, LCD_DATA8_A, SEL_LCDC_0),
633 	PINMUX_IPSR_MSEL(IP0_17_16, TIOC1A_C, SEL_MTU2_CH1_2),
634 
635 	PINMUX_IPSR_GPSR(IP0_19_18, A9),
636 	PINMUX_IPSR_GPSR(IP0_19_18, ST0_D5),
637 	PINMUX_IPSR_MSEL(IP0_19_18, LCD_DATA9_A, SEL_LCDC_0),
638 	PINMUX_IPSR_MSEL(IP0_19_18, TIOC1B_C, SEL_MTU2_CH1_2),
639 
640 	PINMUX_IPSR_GPSR(IP0_21_20, A10),
641 	PINMUX_IPSR_GPSR(IP0_21_20, ST0_D6),
642 	PINMUX_IPSR_MSEL(IP0_21_20, LCD_DATA10_A, SEL_LCDC_0),
643 	PINMUX_IPSR_MSEL(IP0_21_20, TIOC2A_C, SEL_MTU2_CH2_2),
644 
645 	PINMUX_IPSR_GPSR(IP0_23_22, A11),
646 	PINMUX_IPSR_GPSR(IP0_23_22, ST0_D7),
647 	PINMUX_IPSR_MSEL(IP0_23_22, LCD_DATA11_A, SEL_LCDC_0),
648 	PINMUX_IPSR_MSEL(IP0_23_22, TIOC2B_C, SEL_MTU2_CH2_2),
649 
650 	PINMUX_IPSR_GPSR(IP0_25_24, A12),
651 	PINMUX_IPSR_MSEL(IP0_25_24, LCD_DATA12_A, SEL_LCDC_0),
652 	PINMUX_IPSR_MSEL(IP0_25_24, TIOC3A_C, SEL_MTU2_CH3_1),
653 
654 	PINMUX_IPSR_GPSR(IP0_27_26, A13),
655 	PINMUX_IPSR_MSEL(IP0_27_26, LCD_DATA13_A, SEL_LCDC_0),
656 	PINMUX_IPSR_MSEL(IP0_27_26, TIOC3B_C, SEL_MTU2_CH3_1),
657 
658 	PINMUX_IPSR_GPSR(IP0_29_28, A14),
659 	PINMUX_IPSR_MSEL(IP0_29_28, LCD_DATA14_A, SEL_LCDC_0),
660 	PINMUX_IPSR_MSEL(IP0_29_28, TIOC3C_C, SEL_MTU2_CH3_1),
661 
662 	PINMUX_IPSR_GPSR(IP0_31_30, A15),
663 	PINMUX_IPSR_GPSR(IP0_31_30, ST0_VCO_CLKIN),
664 	PINMUX_IPSR_MSEL(IP0_31_30, LCD_DATA15_A, SEL_LCDC_0),
665 	PINMUX_IPSR_MSEL(IP0_31_30, TIOC3D_C, SEL_MTU2_CH3_1),
666 
667 
668 	/* IPSR1 */
669 	PINMUX_IPSR_GPSR(IP1_1_0, A16),
670 	PINMUX_IPSR_GPSR(IP1_1_0, ST0_PWM),
671 	PINMUX_IPSR_MSEL(IP1_1_0, LCD_DON_A, SEL_LCDC_0),
672 	PINMUX_IPSR_MSEL(IP1_1_0, TIOC4A_C, SEL_MTU2_CH4_1),
673 
674 	PINMUX_IPSR_GPSR(IP1_3_2, A17),
675 	PINMUX_IPSR_GPSR(IP1_3_2, ST1_VCO_CLKIN),
676 	PINMUX_IPSR_MSEL(IP1_3_2, LCD_CL1_A, SEL_LCDC_0),
677 	PINMUX_IPSR_MSEL(IP1_3_2, TIOC4B_C, SEL_MTU2_CH4_1),
678 
679 	PINMUX_IPSR_GPSR(IP1_5_4, A18),
680 	PINMUX_IPSR_GPSR(IP1_5_4, ST1_PWM),
681 	PINMUX_IPSR_MSEL(IP1_5_4, LCD_CL2_A, SEL_LCDC_0),
682 	PINMUX_IPSR_MSEL(IP1_5_4, TIOC4C_C, SEL_MTU2_CH4_1),
683 
684 	PINMUX_IPSR_GPSR(IP1_7_6, A19),
685 	PINMUX_IPSR_GPSR(IP1_7_6, ST1_CLKIN),
686 	PINMUX_IPSR_MSEL(IP1_7_6, LCD_CLK_A, SEL_LCDC_0),
687 	PINMUX_IPSR_MSEL(IP1_7_6, TIOC4D_C, SEL_MTU2_CH4_1),
688 
689 	PINMUX_IPSR_GPSR(IP1_9_8, A20),
690 	PINMUX_IPSR_GPSR(IP1_9_8, ST1_REQ),
691 	PINMUX_IPSR_MSEL(IP1_9_8, LCD_FLM_A, SEL_LCDC_0),
692 
693 	PINMUX_IPSR_GPSR(IP1_11_10, A21),
694 	PINMUX_IPSR_GPSR(IP1_11_10, ST1_SYC),
695 	PINMUX_IPSR_MSEL(IP1_11_10, LCD_VCPWC_A, SEL_LCDC_0),
696 
697 	PINMUX_IPSR_GPSR(IP1_13_12, A22),
698 	PINMUX_IPSR_GPSR(IP1_13_12, ST1_VLD),
699 	PINMUX_IPSR_MSEL(IP1_13_12, LCD_VEPWC_A, SEL_LCDC_0),
700 
701 	PINMUX_IPSR_GPSR(IP1_15_14, A23),
702 	PINMUX_IPSR_GPSR(IP1_15_14, ST1_D0),
703 	PINMUX_IPSR_MSEL(IP1_15_14, LCD_M_DISP_A, SEL_LCDC_0),
704 
705 	PINMUX_IPSR_GPSR(IP1_17_16, A24),
706 	PINMUX_IPSR_MSEL(IP1_17_16, RX2_D, SEL_SCIF2_3),
707 	PINMUX_IPSR_GPSR(IP1_17_16, ST1_D1),
708 
709 	PINMUX_IPSR_GPSR(IP1_19_18, A25),
710 	PINMUX_IPSR_MSEL(IP1_17_16, RX2_D, SEL_SCIF2_3),
711 	PINMUX_IPSR_GPSR(IP1_17_16, ST1_D2),
712 
713 	PINMUX_IPSR_GPSR(IP1_22_20, D0),
714 	PINMUX_IPSR_MSEL(IP1_22_20, SD0_DAT0_A, SEL_SDHI0_0),
715 	PINMUX_IPSR_MSEL(IP1_22_20, MMC_D0_A, SEL_MMC_0),
716 	PINMUX_IPSR_GPSR(IP1_22_20, ST1_D3),
717 	PINMUX_IPSR_MSEL(IP1_22_20, FD0_A, SEL_FLCTL_0),
718 
719 	PINMUX_IPSR_GPSR(IP1_25_23, D1),
720 	PINMUX_IPSR_MSEL(IP1_25_23, SD0_DAT0_A, SEL_SDHI0_0),
721 	PINMUX_IPSR_MSEL(IP1_25_23, MMC_D1_A, SEL_MMC_0),
722 	PINMUX_IPSR_GPSR(IP1_25_23, ST1_D4),
723 	PINMUX_IPSR_MSEL(IP1_25_23, FD1_A, SEL_FLCTL_0),
724 
725 	PINMUX_IPSR_GPSR(IP1_28_26, D2),
726 	PINMUX_IPSR_MSEL(IP1_28_26, SD0_DAT0_A, SEL_SDHI0_0),
727 	PINMUX_IPSR_MSEL(IP1_28_26, MMC_D2_A, SEL_MMC_0),
728 	PINMUX_IPSR_GPSR(IP1_28_26, ST1_D5),
729 	PINMUX_IPSR_MSEL(IP1_28_26, FD2_A, SEL_FLCTL_0),
730 
731 	PINMUX_IPSR_GPSR(IP1_31_29, D3),
732 	PINMUX_IPSR_MSEL(IP1_31_29, SD0_DAT0_A, SEL_SDHI0_0),
733 	PINMUX_IPSR_MSEL(IP1_31_29, MMC_D3_A, SEL_MMC_0),
734 	PINMUX_IPSR_GPSR(IP1_31_29, ST1_D6),
735 	PINMUX_IPSR_MSEL(IP1_31_29, FD3_A, SEL_FLCTL_0),
736 
737 	/* IPSR2 */
738 	PINMUX_IPSR_GPSR(IP2_2_0, D4),
739 	PINMUX_IPSR_MSEL(IP2_2_0, SD0_CD_A, SEL_SDHI0_0),
740 	PINMUX_IPSR_MSEL(IP2_2_0, MMC_D4_A, SEL_MMC_0),
741 	PINMUX_IPSR_GPSR(IP2_2_0, ST1_D7),
742 	PINMUX_IPSR_MSEL(IP2_2_0, FD4_A, SEL_FLCTL_0),
743 
744 	PINMUX_IPSR_GPSR(IP2_4_3, D5),
745 	PINMUX_IPSR_MSEL(IP2_4_3, SD0_WP_A, SEL_SDHI0_0),
746 	PINMUX_IPSR_MSEL(IP2_4_3, MMC_D5_A, SEL_MMC_0),
747 	PINMUX_IPSR_MSEL(IP2_4_3, FD5_A, SEL_FLCTL_0),
748 
749 	PINMUX_IPSR_GPSR(IP2_7_5, D6),
750 	PINMUX_IPSR_MSEL(IP2_7_5, RSPI_RSPCK_A, SEL_RSPI_0),
751 	PINMUX_IPSR_MSEL(IP2_7_5, MMC_D6_A, SEL_MMC_0),
752 	PINMUX_IPSR_MSEL(IP2_7_5, QSPCLK_A, SEL_RQSPI_0),
753 	PINMUX_IPSR_MSEL(IP2_7_5, FD6_A, SEL_FLCTL_0),
754 
755 	PINMUX_IPSR_GPSR(IP2_10_8, D7),
756 	PINMUX_IPSR_MSEL(IP2_10_8, RSPI_SSL_A, SEL_RSPI_0),
757 	PINMUX_IPSR_MSEL(IP2_10_8, MMC_D7_A, SEL_MMC_0),
758 	PINMUX_IPSR_MSEL(IP2_10_8, QSSL_A, SEL_RQSPI_0),
759 	PINMUX_IPSR_MSEL(IP2_10_8, FD7_A, SEL_FLCTL_0),
760 
761 	PINMUX_IPSR_GPSR(IP2_13_11, D8),
762 	PINMUX_IPSR_MSEL(IP2_13_11, SD0_CLK_A, SEL_SDHI0_0),
763 	PINMUX_IPSR_MSEL(IP2_13_11, MMC_CLK_A, SEL_MMC_0),
764 	PINMUX_IPSR_MSEL(IP2_13_11, QIO2_A, SEL_RQSPI_0),
765 	PINMUX_IPSR_MSEL(IP2_13_11, FCE_A, SEL_FLCTL_0),
766 	PINMUX_IPSR_MSEL(IP2_13_11, ET0_GTX_CLK_B, SEL_ET0_1),
767 
768 	PINMUX_IPSR_GPSR(IP2_16_14, D9),
769 	PINMUX_IPSR_MSEL(IP2_16_14, SD0_CMD_A, SEL_SDHI0_0),
770 	PINMUX_IPSR_MSEL(IP2_16_14, MMC_CMD_A, SEL_MMC_0),
771 	PINMUX_IPSR_MSEL(IP2_16_14, QIO3_A, SEL_RQSPI_0),
772 	PINMUX_IPSR_MSEL(IP2_16_14, FCLE_A, SEL_FLCTL_0),
773 	PINMUX_IPSR_MSEL(IP2_16_14, ET0_ETXD1_B, SEL_ET0_1),
774 
775 	PINMUX_IPSR_GPSR(IP2_19_17, D10),
776 	PINMUX_IPSR_MSEL(IP2_19_17, RSPI_MOSI_A, SEL_RSPI_0),
777 	PINMUX_IPSR_MSEL(IP2_19_17, QMO_QIO0_A, SEL_RQSPI_0),
778 	PINMUX_IPSR_MSEL(IP2_19_17, FALE_A, SEL_FLCTL_0),
779 	PINMUX_IPSR_MSEL(IP2_19_17, ET0_ETXD2_B, SEL_ET0_1),
780 
781 	PINMUX_IPSR_GPSR(IP2_22_20, D11),
782 	PINMUX_IPSR_MSEL(IP2_22_20, RSPI_MISO_A, SEL_RSPI_0),
783 	PINMUX_IPSR_MSEL(IP2_22_20, QMI_QIO1_A, SEL_RQSPI_0),
784 	PINMUX_IPSR_MSEL(IP2_22_20, FRE_A, SEL_FLCTL_0),
785 
786 	PINMUX_IPSR_GPSR(IP2_24_23, D12),
787 	PINMUX_IPSR_MSEL(IP2_24_23, FWE_A, SEL_FLCTL_0),
788 	PINMUX_IPSR_MSEL(IP2_24_23, ET0_ETXD5_B, SEL_ET0_1),
789 
790 	PINMUX_IPSR_GPSR(IP2_27_25, D13),
791 	PINMUX_IPSR_MSEL(IP2_27_25, RX2_B, SEL_SCIF2_1),
792 	PINMUX_IPSR_MSEL(IP2_27_25, FRB_A, SEL_FLCTL_0),
793 	PINMUX_IPSR_MSEL(IP2_27_25, ET0_ETXD6_B, SEL_ET0_1),
794 
795 	PINMUX_IPSR_GPSR(IP2_30_28, D14),
796 	PINMUX_IPSR_MSEL(IP2_30_28, TX2_B, SEL_SCIF2_1),
797 	PINMUX_IPSR_MSEL(IP2_30_28, FSE_A, SEL_FLCTL_0),
798 	PINMUX_IPSR_MSEL(IP2_30_28, ET0_TX_CLK_B, SEL_ET0_1),
799 
800 	/* IPSR3 */
801 	PINMUX_IPSR_GPSR(IP3_1_0, D15),
802 	PINMUX_IPSR_MSEL(IP3_1_0, SCK2_B, SEL_SCIF2_1),
803 
804 	PINMUX_IPSR_GPSR(IP3_2, CS1_A26),
805 	PINMUX_IPSR_MSEL(IP3_2, QIO3_B, SEL_RQSPI_1),
806 
807 	PINMUX_IPSR_GPSR(IP3_5_3, EX_CS1),
808 	PINMUX_IPSR_MSEL(IP3_5_3, RX3_B, SEL_SCIF2_1),
809 	PINMUX_IPSR_GPSR(IP3_5_3, ATACS0),
810 	PINMUX_IPSR_MSEL(IP3_5_3, QIO2_B, SEL_RQSPI_1),
811 	PINMUX_IPSR_GPSR(IP3_5_3, ET0_ETXD0),
812 
813 	PINMUX_IPSR_GPSR(IP3_8_6, EX_CS2),
814 	PINMUX_IPSR_MSEL(IP3_8_6, TX3_B, SEL_SCIF3_1),
815 	PINMUX_IPSR_GPSR(IP3_8_6, ATACS1),
816 	PINMUX_IPSR_MSEL(IP3_8_6, QSPCLK_B, SEL_RQSPI_1),
817 	PINMUX_IPSR_MSEL(IP3_8_6, ET0_GTX_CLK_A, SEL_ET0_0),
818 
819 	PINMUX_IPSR_GPSR(IP3_11_9, EX_CS3),
820 	PINMUX_IPSR_MSEL(IP3_11_9, SD1_CD_A, SEL_SDHI1_0),
821 	PINMUX_IPSR_GPSR(IP3_11_9, ATARD),
822 	PINMUX_IPSR_MSEL(IP3_11_9, QMO_QIO0_B, SEL_RQSPI_1),
823 	PINMUX_IPSR_MSEL(IP3_11_9, ET0_ETXD1_A, SEL_ET0_0),
824 
825 	PINMUX_IPSR_GPSR(IP3_14_12, EX_CS4),
826 	PINMUX_IPSR_MSEL(IP3_14_12, SD1_WP_A, SEL_SDHI1_0),
827 	PINMUX_IPSR_GPSR(IP3_14_12, ATAWR),
828 	PINMUX_IPSR_MSEL(IP3_14_12, QMI_QIO1_B, SEL_RQSPI_1),
829 	PINMUX_IPSR_MSEL(IP3_14_12, ET0_ETXD2_A, SEL_ET0_0),
830 
831 	PINMUX_IPSR_GPSR(IP3_17_15, EX_CS5),
832 	PINMUX_IPSR_MSEL(IP3_17_15, SD1_CMD_A, SEL_SDHI1_0),
833 	PINMUX_IPSR_GPSR(IP3_17_15, ATADIR),
834 	PINMUX_IPSR_MSEL(IP3_17_15, QSSL_B, SEL_RQSPI_1),
835 	PINMUX_IPSR_MSEL(IP3_17_15, ET0_ETXD3_A, SEL_ET0_0),
836 
837 	PINMUX_IPSR_GPSR(IP3_19_18, RD_WR),
838 	PINMUX_IPSR_GPSR(IP3_19_18, TCLK0),
839 	PINMUX_IPSR_MSEL(IP3_19_18, CAN_CLK_B, SEL_RCAN_CLK_1),
840 	PINMUX_IPSR_GPSR(IP3_19_18, ET0_ETXD4),
841 
842 	PINMUX_IPSR_GPSR(IP3_20, EX_WAIT0),
843 	PINMUX_IPSR_MSEL(IP3_20, TCLK1_B, SEL_TMU_1),
844 
845 	PINMUX_IPSR_GPSR(IP3_23_21, EX_WAIT1),
846 	PINMUX_IPSR_MSEL(IP3_23_21, SD1_DAT0_A, SEL_SDHI1_0),
847 	PINMUX_IPSR_GPSR(IP3_23_21, DREQ2),
848 	PINMUX_IPSR_MSEL(IP3_23_21, CAN1_TX_C, SEL_RCAN1_2),
849 	PINMUX_IPSR_MSEL(IP3_23_21, ET0_LINK_C, SEL_ET0_CTL_2),
850 	PINMUX_IPSR_MSEL(IP3_23_21, ET0_ETXD5_A, SEL_ET0_0),
851 
852 	PINMUX_IPSR_GPSR(IP3_26_24, EX_WAIT2),
853 	PINMUX_IPSR_MSEL(IP3_26_24, SD1_DAT1_A, SEL_SDHI1_0),
854 	PINMUX_IPSR_GPSR(IP3_26_24, DACK2),
855 	PINMUX_IPSR_MSEL(IP3_26_24, CAN1_RX_C, SEL_RCAN1_2),
856 	PINMUX_IPSR_MSEL(IP3_26_24, ET0_MAGIC_C, SEL_ET0_CTL_2),
857 	PINMUX_IPSR_MSEL(IP3_26_24, ET0_ETXD6_A, SEL_ET0_0),
858 
859 	PINMUX_IPSR_GPSR(IP3_29_27, DRACK0),
860 	PINMUX_IPSR_MSEL(IP3_29_27, SD1_DAT2_A, SEL_SDHI1_0),
861 	PINMUX_IPSR_GPSR(IP3_29_27, ATAG),
862 	PINMUX_IPSR_MSEL(IP3_29_27, TCLK1_A, SEL_TMU_0),
863 	PINMUX_IPSR_GPSR(IP3_29_27, ET0_ETXD7),
864 
865 	/* IPSR4 */
866 	PINMUX_IPSR_MSEL(IP4_2_0, HCTS0_A, SEL_HSCIF_0),
867 	PINMUX_IPSR_MSEL(IP4_2_0, CTS1_A, SEL_SCIF1_0),
868 	PINMUX_IPSR_GPSR(IP4_2_0, VI0_FIELD),
869 	PINMUX_IPSR_MSEL(IP4_2_0, RMII0_RXD1_A, SEL_RMII_0),
870 	PINMUX_IPSR_GPSR(IP4_2_0, ET0_ERXD7),
871 
872 	PINMUX_IPSR_MSEL(IP4_5_3, HRTS0_A, SEL_HSCIF_0),
873 	PINMUX_IPSR_MSEL(IP4_5_3, RTS1_A, SEL_SCIF1_0),
874 	PINMUX_IPSR_GPSR(IP4_5_3, VI0_HSYNC),
875 	PINMUX_IPSR_MSEL(IP4_5_3, RMII0_TXD_EN_A, SEL_RMII_0),
876 	PINMUX_IPSR_GPSR(IP4_5_3, ET0_RX_DV),
877 
878 	PINMUX_IPSR_MSEL(IP4_8_6, HSCK0_A, SEL_HSCIF_0),
879 	PINMUX_IPSR_MSEL(IP4_8_6, SCK1_A, SEL_SCIF1_0),
880 	PINMUX_IPSR_GPSR(IP4_8_6, VI0_VSYNC),
881 	PINMUX_IPSR_MSEL(IP4_8_6, RMII0_RX_ER_A, SEL_RMII_0),
882 	PINMUX_IPSR_GPSR(IP4_8_6, ET0_RX_ER),
883 
884 	PINMUX_IPSR_MSEL(IP4_11_9, HRX0_A, SEL_HSCIF_0),
885 	PINMUX_IPSR_MSEL(IP4_11_9, RX1_A, SEL_SCIF1_0),
886 	PINMUX_IPSR_GPSR(IP4_11_9, VI0_DATA0_VI0_B0),
887 	PINMUX_IPSR_MSEL(IP4_11_9, RMII0_CRS_DV_A, SEL_RMII_0),
888 	PINMUX_IPSR_GPSR(IP4_11_9, ET0_CRS),
889 
890 	PINMUX_IPSR_MSEL(IP4_14_12, HTX0_A, SEL_HSCIF_0),
891 	PINMUX_IPSR_MSEL(IP4_14_12, TX1_A, SEL_SCIF1_0),
892 	PINMUX_IPSR_GPSR(IP4_14_12, VI0_DATA1_VI0_B1),
893 	PINMUX_IPSR_MSEL(IP4_14_12, RMII0_MDC_A, SEL_RMII_0),
894 	PINMUX_IPSR_GPSR(IP4_14_12, ET0_COL),
895 
896 	PINMUX_IPSR_MSEL(IP4_17_15, CTS0_B, SEL_SCIF0_1),
897 	PINMUX_IPSR_GPSR(IP4_17_15, VI0_DATA2_VI0_B2),
898 	PINMUX_IPSR_MSEL(IP4_17_15, RMII0_MDIO_A, SEL_RMII_0),
899 	PINMUX_IPSR_GPSR(IP4_17_15, ET0_MDC),
900 
901 	PINMUX_IPSR_MSEL(IP4_19_18, RTS0_B, SEL_SCIF0_1),
902 	PINMUX_IPSR_GPSR(IP4_19_18, VI0_DATA3_VI0_B3),
903 	PINMUX_IPSR_MSEL(IP4_19_18, ET0_MDIO_A, SEL_ET0_0),
904 
905 	PINMUX_IPSR_MSEL(IP4_21_20, SCK1_B, SEL_SCIF1_1),
906 	PINMUX_IPSR_GPSR(IP4_21_20, VI0_DATA4_VI0_B4),
907 	PINMUX_IPSR_MSEL(IP4_21_20, ET0_LINK_A, SEL_ET0_CTL_0),
908 
909 	PINMUX_IPSR_MSEL(IP4_23_22, RX1_B, SEL_SCIF1_1),
910 	PINMUX_IPSR_GPSR(IP4_23_22, VI0_DATA5_VI0_B5),
911 	PINMUX_IPSR_MSEL(IP4_23_22, ET0_MAGIC_A, SEL_ET0_CTL_0),
912 
913 	PINMUX_IPSR_MSEL(IP4_25_24, TX1_B, SEL_SCIF1_1),
914 	PINMUX_IPSR_GPSR(IP4_25_24, VI0_DATA6_VI0_G0),
915 	PINMUX_IPSR_MSEL(IP4_25_24, ET0_PHY_INT_A, SEL_ET0_CTL_0),
916 
917 	PINMUX_IPSR_MSEL(IP4_27_26, CTS1_B, SEL_SCIF1_1),
918 	PINMUX_IPSR_GPSR(IP4_27_26, VI0_DATA7_VI0_G1),
919 
920 	PINMUX_IPSR_MSEL(IP4_29_28, RTS1_B, SEL_SCIF1_1),
921 	PINMUX_IPSR_GPSR(IP4_29_28, VI0_G2),
922 
923 	PINMUX_IPSR_MSEL(IP4_31_30, SCK2_A, SEL_SCIF2_0),
924 	PINMUX_IPSR_GPSR(IP4_31_30, VI0_G3),
925 
926 	/* IPSR5 */
927 	PINMUX_IPSR_MSEL(IP5_2_0, SD2_CLK_A, SEL_SDHI2_0),
928 	PINMUX_IPSR_MSEL(IP5_2_0, RX2_A, SEL_SCIF2_0),
929 	PINMUX_IPSR_GPSR(IP5_2_0, VI0_G4),
930 	PINMUX_IPSR_MSEL(IP5_2_0, ET0_RX_CLK_B, SEL_ET0_1),
931 
932 	PINMUX_IPSR_MSEL(IP5_5_3, SD2_CMD_A, SEL_SDHI2_0),
933 	PINMUX_IPSR_MSEL(IP5_5_3, TX2_A, SEL_SCIF2_0),
934 	PINMUX_IPSR_GPSR(IP5_5_3, VI0_G5),
935 	PINMUX_IPSR_MSEL(IP5_5_3, ET0_ERXD2_B, SEL_ET0_1),
936 
937 	PINMUX_IPSR_MSEL(IP5_8_6, SD2_DAT0_A, SEL_SDHI2_0),
938 	PINMUX_IPSR_MSEL(IP5_8_6, RX3_A, SEL_SCIF3_0),
939 	PINMUX_IPSR_GPSR(IP4_8_6, VI0_R0),
940 	PINMUX_IPSR_MSEL(IP4_8_6, ET0_ERXD2_B, SEL_ET0_1),
941 
942 	PINMUX_IPSR_MSEL(IP5_11_9, SD2_DAT1_A, SEL_SDHI2_0),
943 	PINMUX_IPSR_MSEL(IP5_11_9, TX3_A, SEL_SCIF3_0),
944 	PINMUX_IPSR_GPSR(IP5_11_9, VI0_R1),
945 	PINMUX_IPSR_MSEL(IP5_11_9, ET0_MDIO_B, SEL_ET0_1),
946 
947 	PINMUX_IPSR_MSEL(IP5_14_12, SD2_DAT2_A, SEL_SDHI2_0),
948 	PINMUX_IPSR_MSEL(IP5_14_12, RX4_A, SEL_SCIF4_0),
949 	PINMUX_IPSR_GPSR(IP5_14_12, VI0_R2),
950 	PINMUX_IPSR_MSEL(IP5_14_12, ET0_LINK_B, SEL_ET0_CTL_1),
951 
952 	PINMUX_IPSR_MSEL(IP5_17_15, SD2_DAT3_A, SEL_SDHI2_0),
953 	PINMUX_IPSR_MSEL(IP5_17_15, TX4_A, SEL_SCIF4_0),
954 	PINMUX_IPSR_GPSR(IP5_17_15, VI0_R3),
955 	PINMUX_IPSR_MSEL(IP5_17_15, ET0_MAGIC_B, SEL_ET0_CTL_1),
956 
957 	PINMUX_IPSR_MSEL(IP5_20_18, SD2_CD_A, SEL_SDHI2_0),
958 	PINMUX_IPSR_MSEL(IP5_20_18, RX5_A, SEL_SCIF5_0),
959 	PINMUX_IPSR_GPSR(IP5_20_18, VI0_R4),
960 	PINMUX_IPSR_MSEL(IP5_20_18, ET0_PHY_INT_B, SEL_ET0_CTL_1),
961 
962 	PINMUX_IPSR_MSEL(IP5_22_21, SD2_WP_A, SEL_SDHI2_0),
963 	PINMUX_IPSR_MSEL(IP5_22_21, TX5_A, SEL_SCIF5_0),
964 	PINMUX_IPSR_GPSR(IP5_22_21, VI0_R5),
965 
966 	PINMUX_IPSR_GPSR(IP5_24_23, REF125CK),
967 	PINMUX_IPSR_GPSR(IP5_24_23, ADTRG),
968 	PINMUX_IPSR_MSEL(IP5_24_23, RX5_C, SEL_SCIF5_2),
969 	PINMUX_IPSR_GPSR(IP5_26_25, REF50CK),
970 	PINMUX_IPSR_MSEL(IP5_26_25, CTS1_E, SEL_SCIF1_3),
971 	PINMUX_IPSR_MSEL(IP5_26_25, HCTS0_D, SEL_HSCIF_3),
972 
973 	/* IPSR6 */
974 	PINMUX_IPSR_GPSR(IP6_2_0, DU0_DR0),
975 	PINMUX_IPSR_MSEL(IP6_2_0, SCIF_CLK_B, SEL_SCIF_CLK_1),
976 	PINMUX_IPSR_MSEL(IP6_2_0, HRX0_D, SEL_HSCIF_3),
977 	PINMUX_IPSR_MSEL(IP6_2_0, IETX_A, SEL_IEBUS_0),
978 	PINMUX_IPSR_MSEL(IP6_2_0, TCLKA_A, SEL_MTU2_CLK_0),
979 	PINMUX_IPSR_GPSR(IP6_2_0, HIFD00),
980 
981 	PINMUX_IPSR_GPSR(IP6_5_3, DU0_DR1),
982 	PINMUX_IPSR_MSEL(IP6_5_3, SCK0_B, SEL_SCIF0_1),
983 	PINMUX_IPSR_MSEL(IP6_5_3, HTX0_D, SEL_HSCIF_3),
984 	PINMUX_IPSR_MSEL(IP6_5_3, IERX_A, SEL_IEBUS_0),
985 	PINMUX_IPSR_MSEL(IP6_5_3, TCLKB_A, SEL_MTU2_CLK_0),
986 	PINMUX_IPSR_GPSR(IP6_5_3, HIFD01),
987 
988 	PINMUX_IPSR_GPSR(IP6_7_6, DU0_DR2),
989 	PINMUX_IPSR_MSEL(IP6_7_6, RX0_B, SEL_SCIF0_1),
990 	PINMUX_IPSR_MSEL(IP6_7_6, TCLKC_A, SEL_MTU2_CLK_0),
991 	PINMUX_IPSR_GPSR(IP6_7_6, HIFD02),
992 
993 	PINMUX_IPSR_GPSR(IP6_9_8, DU0_DR3),
994 	PINMUX_IPSR_MSEL(IP6_9_8, TX0_B, SEL_SCIF0_1),
995 	PINMUX_IPSR_MSEL(IP6_9_8, TCLKD_A, SEL_MTU2_CLK_0),
996 	PINMUX_IPSR_GPSR(IP6_9_8, HIFD03),
997 
998 	PINMUX_IPSR_GPSR(IP6_11_10, DU0_DR4),
999 	PINMUX_IPSR_MSEL(IP6_11_10, CTS0_C, SEL_SCIF0_2),
1000 	PINMUX_IPSR_MSEL(IP6_11_10, TIOC0A_A, SEL_MTU2_CH0_0),
1001 	PINMUX_IPSR_GPSR(IP6_11_10, HIFD04),
1002 
1003 	PINMUX_IPSR_GPSR(IP6_13_12, DU0_DR5),
1004 	PINMUX_IPSR_MSEL(IP6_13_12, RTS0_C, SEL_SCIF0_1),
1005 	PINMUX_IPSR_MSEL(IP6_13_12, TIOC0B_A, SEL_MTU2_CH0_0),
1006 	PINMUX_IPSR_GPSR(IP6_13_12, HIFD05),
1007 
1008 	PINMUX_IPSR_GPSR(IP6_15_14, DU0_DR6),
1009 	PINMUX_IPSR_MSEL(IP6_15_14, SCK1_C, SEL_SCIF1_2),
1010 	PINMUX_IPSR_MSEL(IP6_15_14, TIOC0C_A, SEL_MTU2_CH0_0),
1011 	PINMUX_IPSR_GPSR(IP6_15_14, HIFD06),
1012 
1013 	PINMUX_IPSR_GPSR(IP6_17_16, DU0_DR7),
1014 	PINMUX_IPSR_MSEL(IP6_17_16, RX1_C, SEL_SCIF1_2),
1015 	PINMUX_IPSR_MSEL(IP6_17_16, TIOC0D_A, SEL_MTU2_CH0_0),
1016 	PINMUX_IPSR_GPSR(IP6_17_16, HIFD07),
1017 
1018 	PINMUX_IPSR_GPSR(IP6_20_18, DU0_DG0),
1019 	PINMUX_IPSR_MSEL(IP6_20_18, TX1_C, SEL_SCIF1_2),
1020 	PINMUX_IPSR_MSEL(IP6_20_18, HSCK0_D, SEL_HSCIF_3),
1021 	PINMUX_IPSR_MSEL(IP6_20_18, IECLK_A, SEL_IEBUS_0),
1022 	PINMUX_IPSR_MSEL(IP6_20_18, TIOC1A_A, SEL_MTU2_CH1_0),
1023 	PINMUX_IPSR_GPSR(IP6_20_18, HIFD08),
1024 
1025 	PINMUX_IPSR_GPSR(IP6_23_21, DU0_DG1),
1026 	PINMUX_IPSR_MSEL(IP6_23_21, CTS1_C, SEL_SCIF1_2),
1027 	PINMUX_IPSR_MSEL(IP6_23_21, HRTS0_D, SEL_HSCIF_3),
1028 	PINMUX_IPSR_MSEL(IP6_23_21, TIOC1B_A, SEL_MTU2_CH1_0),
1029 	PINMUX_IPSR_GPSR(IP6_23_21, HIFD09),
1030 
1031 	/* IPSR7 */
1032 	PINMUX_IPSR_GPSR(IP7_2_0, DU0_DG2),
1033 	PINMUX_IPSR_MSEL(IP7_2_0, RTS1_C, SEL_SCIF1_2),
1034 	PINMUX_IPSR_MSEL(IP7_2_0, RMII0_MDC_B, SEL_RMII_1),
1035 	PINMUX_IPSR_MSEL(IP7_2_0, TIOC2A_A, SEL_MTU2_CH2_0),
1036 	PINMUX_IPSR_GPSR(IP7_2_0, HIFD10),
1037 
1038 	PINMUX_IPSR_GPSR(IP7_5_3, DU0_DG3),
1039 	PINMUX_IPSR_MSEL(IP7_5_3, SCK2_C, SEL_SCIF2_2),
1040 	PINMUX_IPSR_MSEL(IP7_5_3, RMII0_MDIO_B, SEL_RMII_1),
1041 	PINMUX_IPSR_MSEL(IP7_5_3, TIOC2B_A, SEL_MTU2_CH2_0),
1042 	PINMUX_IPSR_GPSR(IP7_5_3, HIFD11),
1043 
1044 	PINMUX_IPSR_GPSR(IP7_8_6, DU0_DG4),
1045 	PINMUX_IPSR_MSEL(IP7_8_6, RX2_C, SEL_SCIF2_2),
1046 	PINMUX_IPSR_MSEL(IP7_8_6, RMII0_CRS_DV_B, SEL_RMII_1),
1047 	PINMUX_IPSR_MSEL(IP7_8_6, TIOC3A_A, SEL_MTU2_CH3_0),
1048 	PINMUX_IPSR_GPSR(IP7_8_6, HIFD12),
1049 
1050 	PINMUX_IPSR_GPSR(IP7_11_9, DU0_DG5),
1051 	PINMUX_IPSR_MSEL(IP7_11_9, TX2_C, SEL_SCIF2_2),
1052 	PINMUX_IPSR_MSEL(IP7_11_9, RMII0_RX_ER_B, SEL_RMII_1),
1053 	PINMUX_IPSR_MSEL(IP7_11_9, TIOC3B_A, SEL_MTU2_CH3_0),
1054 	PINMUX_IPSR_GPSR(IP7_11_9, HIFD13),
1055 
1056 	PINMUX_IPSR_GPSR(IP7_14_12, DU0_DG6),
1057 	PINMUX_IPSR_MSEL(IP7_14_12, RX3_C, SEL_SCIF3_2),
1058 	PINMUX_IPSR_MSEL(IP7_14_12, RMII0_RXD0_B, SEL_RMII_1),
1059 	PINMUX_IPSR_MSEL(IP7_14_12, TIOC3C_A, SEL_MTU2_CH3_0),
1060 	PINMUX_IPSR_GPSR(IP7_14_12, HIFD14),
1061 
1062 	PINMUX_IPSR_GPSR(IP7_17_15, DU0_DG7),
1063 	PINMUX_IPSR_MSEL(IP7_17_15, TX3_C, SEL_SCIF3_2),
1064 	PINMUX_IPSR_MSEL(IP7_17_15, RMII0_RXD1_B, SEL_RMII_1),
1065 	PINMUX_IPSR_MSEL(IP7_17_15, TIOC3D_A, SEL_MTU2_CH3_0),
1066 	PINMUX_IPSR_GPSR(IP7_17_15, HIFD15),
1067 
1068 	PINMUX_IPSR_GPSR(IP7_20_18, DU0_DB0),
1069 	PINMUX_IPSR_MSEL(IP7_20_18, RX4_C, SEL_SCIF4_2),
1070 	PINMUX_IPSR_MSEL(IP7_20_18, RMII0_TXD_EN_B, SEL_RMII_1),
1071 	PINMUX_IPSR_MSEL(IP7_20_18, TIOC4A_A, SEL_MTU2_CH4_0),
1072 	PINMUX_IPSR_GPSR(IP7_20_18, HIFCS),
1073 
1074 	PINMUX_IPSR_GPSR(IP7_23_21, DU0_DB1),
1075 	PINMUX_IPSR_MSEL(IP7_23_21, TX4_C, SEL_SCIF4_2),
1076 	PINMUX_IPSR_MSEL(IP7_23_21, RMII0_TXD0_B, SEL_RMII_1),
1077 	PINMUX_IPSR_MSEL(IP7_23_21, TIOC4B_A, SEL_MTU2_CH4_0),
1078 	PINMUX_IPSR_GPSR(IP7_23_21, HIFWR),
1079 
1080 	PINMUX_IPSR_GPSR(IP7_26_24, DU0_DB2),
1081 	PINMUX_IPSR_MSEL(IP7_26_24, RX5_B, SEL_SCIF5_1),
1082 	PINMUX_IPSR_MSEL(IP7_26_24, RMII0_TXD1_B, SEL_RMII_1),
1083 	PINMUX_IPSR_MSEL(IP7_26_24, TIOC4C_A, SEL_MTU2_CH4_0),
1084 
1085 	PINMUX_IPSR_GPSR(IP7_28_27, DU0_DB3),
1086 	PINMUX_IPSR_MSEL(IP7_28_27, TX5_B, SEL_SCIF5_1),
1087 	PINMUX_IPSR_MSEL(IP7_28_27, TIOC4D_A, SEL_MTU2_CH4_0),
1088 	PINMUX_IPSR_GPSR(IP7_28_27, HIFRD),
1089 
1090 	PINMUX_IPSR_GPSR(IP7_30_29, DU0_DB4),
1091 	PINMUX_IPSR_GPSR(IP7_30_29, HIFINT),
1092 
1093 	/* IPSR8 */
1094 	PINMUX_IPSR_GPSR(IP8_1_0, DU0_DB5),
1095 	PINMUX_IPSR_GPSR(IP8_1_0, HIFDREQ),
1096 
1097 	PINMUX_IPSR_GPSR(IP8_3_2, DU0_DB6),
1098 	PINMUX_IPSR_GPSR(IP8_3_2, HIFRDY),
1099 
1100 	PINMUX_IPSR_GPSR(IP8_5_4, DU0_DB7),
1101 	PINMUX_IPSR_MSEL(IP8_5_4, SSI_SCK0_B, SEL_SSI0_1),
1102 	PINMUX_IPSR_MSEL(IP8_5_4, HIFEBL_B, SEL_HIF_1),
1103 
1104 	PINMUX_IPSR_GPSR(IP8_7_6, DU0_DOTCLKIN),
1105 	PINMUX_IPSR_MSEL(IP8_7_6, HSPI_CS0_C, SEL_HSPI_2),
1106 	PINMUX_IPSR_MSEL(IP8_7_6, SSI_WS0_B, SEL_SSI0_1),
1107 
1108 	PINMUX_IPSR_GPSR(IP8_9_8, DU0_DOTCLKOUT),
1109 	PINMUX_IPSR_MSEL(IP8_9_8, HSPI_CLK0_C, SEL_HSPI_2),
1110 	PINMUX_IPSR_MSEL(IP8_9_8, SSI_SDATA0_B, SEL_SSI0_1),
1111 
1112 	PINMUX_IPSR_GPSR(IP8_11_10, DU0_EXHSYNC_DU0_HSYNC),
1113 	PINMUX_IPSR_MSEL(IP8_11_10, HSPI_TX0_C, SEL_HSPI_2),
1114 	PINMUX_IPSR_MSEL(IP8_11_10, SSI_SCK1_B, SEL_SSI1_1),
1115 
1116 	PINMUX_IPSR_GPSR(IP8_13_12, DU0_EXVSYNC_DU0_VSYNC),
1117 	PINMUX_IPSR_MSEL(IP8_13_12, HSPI_RX0_C, SEL_HSPI_2),
1118 	PINMUX_IPSR_MSEL(IP8_13_12, SSI_WS1_B, SEL_SSI1_1),
1119 
1120 	PINMUX_IPSR_GPSR(IP8_15_14, DU0_EXODDF_DU0_ODDF),
1121 	PINMUX_IPSR_MSEL(IP8_15_14, CAN0_RX_B, SEL_RCAN0_1),
1122 	PINMUX_IPSR_MSEL(IP8_15_14, HSCK0_B, SEL_HSCIF_1),
1123 	PINMUX_IPSR_MSEL(IP8_15_14, SSI_SDATA1_B, SEL_SSI1_1),
1124 
1125 	PINMUX_IPSR_GPSR(IP8_17_16, DU0_DISP),
1126 	PINMUX_IPSR_MSEL(IP8_17_16, CAN0_TX_B, SEL_RCAN0_1),
1127 	PINMUX_IPSR_MSEL(IP8_17_16, HRX0_B, SEL_HSCIF_1),
1128 	PINMUX_IPSR_MSEL(IP8_17_16, AUDIO_CLKA_B, SEL_AUDIO_CLKA_1),
1129 
1130 	PINMUX_IPSR_GPSR(IP8_19_18, DU0_CDE),
1131 	PINMUX_IPSR_MSEL(IP8_19_18, HTX0_B, SEL_HSCIF_1),
1132 	PINMUX_IPSR_MSEL(IP8_19_18, AUDIO_CLKB_B, SEL_AUDIO_CLKB_1),
1133 	PINMUX_IPSR_MSEL(IP8_19_18, LCD_VCPWC_B, SEL_LCDC_1),
1134 
1135 	PINMUX_IPSR_MSEL(IP8_22_20, IRQ0_A, SEL_INTC_0),
1136 	PINMUX_IPSR_MSEL(IP8_22_20, HSPI_TX_B, SEL_HSPI_1),
1137 	PINMUX_IPSR_MSEL(IP8_22_20, RX3_E, SEL_SCIF3_4),
1138 	PINMUX_IPSR_GPSR(IP8_22_20, ET0_ERXD0),
1139 
1140 	PINMUX_IPSR_MSEL(IP8_25_23, IRQ1_A, SEL_INTC_0),
1141 	PINMUX_IPSR_MSEL(IP8_25_23, HSPI_RX_B, SEL_HSPI_1),
1142 	PINMUX_IPSR_MSEL(IP8_25_23, TX3_E, SEL_SCIF3_4),
1143 	PINMUX_IPSR_GPSR(IP8_25_23, ET0_ERXD1),
1144 
1145 	PINMUX_IPSR_MSEL(IP8_27_26, IRQ2_A, SEL_INTC_0),
1146 	PINMUX_IPSR_MSEL(IP8_27_26, CTS0_A, SEL_SCIF0_0),
1147 	PINMUX_IPSR_MSEL(IP8_27_26, HCTS0_B, SEL_HSCIF_1),
1148 	PINMUX_IPSR_MSEL(IP8_27_26, ET0_ERXD2_A, SEL_ET0_0),
1149 
1150 	PINMUX_IPSR_MSEL(IP8_29_28, IRQ3_A, SEL_INTC_0),
1151 	PINMUX_IPSR_MSEL(IP8_29_28, RTS0_A, SEL_SCIF0_0),
1152 	PINMUX_IPSR_MSEL(IP8_29_28, HRTS0_B, SEL_HSCIF_1),
1153 	PINMUX_IPSR_MSEL(IP8_29_28, ET0_ERXD3_A, SEL_ET0_0),
1154 
1155 	/* IPSR9 */
1156 	PINMUX_IPSR_MSEL(IP9_1_0, VI1_CLK_A, SEL_VIN1_0),
1157 	PINMUX_IPSR_MSEL(IP9_1_0, FD0_B, SEL_FLCTL_1),
1158 	PINMUX_IPSR_MSEL(IP9_1_0, LCD_DATA0_B, SEL_LCDC_1),
1159 
1160 	PINMUX_IPSR_MSEL(IP9_3_2, VI1_0_A, SEL_VIN1_0),
1161 	PINMUX_IPSR_MSEL(IP9_3_2, FD1_B, SEL_FLCTL_1),
1162 	PINMUX_IPSR_MSEL(IP9_3_2, LCD_DATA1_B, SEL_LCDC_1),
1163 
1164 	PINMUX_IPSR_MSEL(IP9_5_4, VI1_1_A, SEL_VIN1_0),
1165 	PINMUX_IPSR_MSEL(IP9_5_4, FD2_B, SEL_FLCTL_1),
1166 	PINMUX_IPSR_MSEL(IP9_5_4, LCD_DATA2_B, SEL_LCDC_1),
1167 
1168 	PINMUX_IPSR_MSEL(IP9_7_6, VI1_2_A, SEL_VIN1_0),
1169 	PINMUX_IPSR_MSEL(IP9_7_6, FD3_B, SEL_FLCTL_1),
1170 	PINMUX_IPSR_MSEL(IP9_7_6, LCD_DATA3_B, SEL_LCDC_1),
1171 
1172 	PINMUX_IPSR_MSEL(IP9_9_8, VI1_3_A, SEL_VIN1_0),
1173 	PINMUX_IPSR_MSEL(IP9_9_8, FD4_B, SEL_FLCTL_1),
1174 	PINMUX_IPSR_MSEL(IP9_9_8, LCD_DATA4_B, SEL_LCDC_1),
1175 
1176 	PINMUX_IPSR_MSEL(IP9_11_10, VI1_4_A, SEL_VIN1_0),
1177 	PINMUX_IPSR_MSEL(IP9_11_10, FD5_B, SEL_FLCTL_1),
1178 	PINMUX_IPSR_MSEL(IP9_11_10, LCD_DATA5_B, SEL_LCDC_1),
1179 
1180 	PINMUX_IPSR_MSEL(IP9_13_12, VI1_5_A, SEL_VIN1_0),
1181 	PINMUX_IPSR_MSEL(IP9_13_12, FD6_B, SEL_FLCTL_1),
1182 	PINMUX_IPSR_MSEL(IP9_13_12, LCD_DATA6_B, SEL_LCDC_1),
1183 
1184 	PINMUX_IPSR_MSEL(IP9_15_14, VI1_6_A, SEL_VIN1_0),
1185 	PINMUX_IPSR_MSEL(IP9_15_14, FD7_B, SEL_FLCTL_1),
1186 	PINMUX_IPSR_MSEL(IP9_15_14, LCD_DATA7_B, SEL_LCDC_1),
1187 
1188 	PINMUX_IPSR_MSEL(IP9_17_16, VI1_7_A, SEL_VIN1_0),
1189 	PINMUX_IPSR_MSEL(IP9_17_16, FCE_B, SEL_FLCTL_1),
1190 	PINMUX_IPSR_MSEL(IP9_17_16, LCD_DATA8_B, SEL_LCDC_1),
1191 
1192 	PINMUX_IPSR_MSEL(IP9_19_18, SSI_SCK0_A, SEL_SSI0_0),
1193 	PINMUX_IPSR_MSEL(IP9_19_18, TIOC1A_B, SEL_MTU2_CH1_1),
1194 	PINMUX_IPSR_MSEL(IP9_19_18, LCD_DATA9_B, SEL_LCDC_1),
1195 
1196 	PINMUX_IPSR_MSEL(IP9_21_20, SSI_WS0_A, SEL_SSI0_0),
1197 	PINMUX_IPSR_MSEL(IP9_21_20, TIOC1B_B, SEL_MTU2_CH1_1),
1198 	PINMUX_IPSR_MSEL(IP9_21_20, LCD_DATA10_B, SEL_LCDC_1),
1199 
1200 	PINMUX_IPSR_MSEL(IP9_23_22, SSI_SDATA0_A, SEL_SSI0_0),
1201 	PINMUX_IPSR_MSEL(IP9_23_22, VI1_0_B, SEL_VIN1_1),
1202 	PINMUX_IPSR_MSEL(IP9_23_22, TIOC2A_B, SEL_MTU2_CH2_1),
1203 	PINMUX_IPSR_MSEL(IP9_23_22, LCD_DATA11_B, SEL_LCDC_1),
1204 
1205 	PINMUX_IPSR_MSEL(IP9_25_24, SSI_SCK1_A, SEL_SSI1_0),
1206 	PINMUX_IPSR_MSEL(IP9_25_24, VI1_1_B, SEL_VIN1_1),
1207 	PINMUX_IPSR_MSEL(IP9_25_24, TIOC2B_B, SEL_MTU2_CH2_1),
1208 	PINMUX_IPSR_MSEL(IP9_25_24, LCD_DATA12_B, SEL_LCDC_1),
1209 
1210 	PINMUX_IPSR_MSEL(IP9_27_26, SSI_WS1_A, SEL_SSI1_0),
1211 	PINMUX_IPSR_MSEL(IP9_27_26, VI1_2_B, SEL_VIN1_1),
1212 	PINMUX_IPSR_MSEL(IP9_27_26, LCD_DATA13_B, SEL_LCDC_1),
1213 
1214 	PINMUX_IPSR_MSEL(IP9_29_28, SSI_SDATA1_A, SEL_SSI1_0),
1215 	PINMUX_IPSR_MSEL(IP9_29_28, VI1_3_B, SEL_VIN1_1),
1216 	PINMUX_IPSR_MSEL(IP9_29_28, LCD_DATA14_B, SEL_LCDC_1),
1217 
1218 	/* IPSE10 */
1219 	PINMUX_IPSR_GPSR(IP10_2_0, SSI_SCK23),
1220 	PINMUX_IPSR_MSEL(IP10_2_0, VI1_4_B, SEL_VIN1_1),
1221 	PINMUX_IPSR_MSEL(IP10_2_0, RX1_D, SEL_SCIF1_3),
1222 	PINMUX_IPSR_MSEL(IP10_2_0, FCLE_B, SEL_FLCTL_1),
1223 	PINMUX_IPSR_MSEL(IP10_2_0, LCD_DATA15_B, SEL_LCDC_1),
1224 
1225 	PINMUX_IPSR_GPSR(IP10_5_3, SSI_WS23),
1226 	PINMUX_IPSR_MSEL(IP10_5_3, VI1_5_B, SEL_VIN1_1),
1227 	PINMUX_IPSR_MSEL(IP10_5_3, TX1_D, SEL_SCIF1_3),
1228 	PINMUX_IPSR_MSEL(IP10_5_3, HSCK0_C, SEL_HSCIF_2),
1229 	PINMUX_IPSR_MSEL(IP10_5_3, FALE_B, SEL_FLCTL_1),
1230 	PINMUX_IPSR_MSEL(IP10_5_3, LCD_DON_B, SEL_LCDC_1),
1231 
1232 	PINMUX_IPSR_GPSR(IP10_8_6, SSI_SDATA2),
1233 	PINMUX_IPSR_MSEL(IP10_8_6, VI1_6_B, SEL_VIN1_1),
1234 	PINMUX_IPSR_MSEL(IP10_8_6, HRX0_C, SEL_HSCIF_2),
1235 	PINMUX_IPSR_MSEL(IP10_8_6, FRE_B, SEL_FLCTL_1),
1236 	PINMUX_IPSR_MSEL(IP10_8_6, LCD_CL1_B, SEL_LCDC_1),
1237 
1238 	PINMUX_IPSR_GPSR(IP10_11_9, SSI_SDATA3),
1239 	PINMUX_IPSR_MSEL(IP10_11_9, VI1_7_B, SEL_VIN1_1),
1240 	PINMUX_IPSR_MSEL(IP10_11_9, HTX0_C, SEL_HSCIF_2),
1241 	PINMUX_IPSR_MSEL(IP10_11_9, FWE_B, SEL_FLCTL_1),
1242 	PINMUX_IPSR_MSEL(IP10_11_9, LCD_CL2_B, SEL_LCDC_1),
1243 
1244 	PINMUX_IPSR_MSEL(IP10_14_12, AUDIO_CLKA_A, SEL_AUDIO_CLKA_0),
1245 	PINMUX_IPSR_MSEL(IP10_14_12, VI1_CLK_B, SEL_VIN1_1),
1246 	PINMUX_IPSR_MSEL(IP10_14_12, SCK1_D, SEL_SCIF1_3),
1247 	PINMUX_IPSR_MSEL(IP10_14_12, IECLK_B, SEL_IEBUS_1),
1248 	PINMUX_IPSR_MSEL(IP10_14_12, LCD_FLM_B, SEL_LCDC_1),
1249 
1250 	PINMUX_IPSR_MSEL(IP10_15, AUDIO_CLKB_A, SEL_AUDIO_CLKB_0),
1251 	PINMUX_IPSR_MSEL(IP10_15, LCD_CLK_B, SEL_LCDC_1),
1252 
1253 	PINMUX_IPSR_GPSR(IP10_18_16, AUDIO_CLKC),
1254 	PINMUX_IPSR_MSEL(IP10_18_16, SCK1_E, SEL_SCIF1_4),
1255 	PINMUX_IPSR_MSEL(IP10_18_16, HCTS0_C, SEL_HSCIF_2),
1256 	PINMUX_IPSR_MSEL(IP10_18_16, FRB_B, SEL_FLCTL_1),
1257 	PINMUX_IPSR_MSEL(IP10_18_16, LCD_VEPWC_B, SEL_LCDC_1),
1258 
1259 	PINMUX_IPSR_GPSR(IP10_21_19, AUDIO_CLKOUT),
1260 	PINMUX_IPSR_MSEL(IP10_21_19, TX1_E, SEL_SCIF1_4),
1261 	PINMUX_IPSR_MSEL(IP10_21_19, HRTS0_C, SEL_HSCIF_2),
1262 	PINMUX_IPSR_MSEL(IP10_21_19, FSE_B, SEL_FLCTL_1),
1263 	PINMUX_IPSR_MSEL(IP10_21_19, LCD_M_DISP_B, SEL_LCDC_1),
1264 
1265 	PINMUX_IPSR_MSEL(IP10_22, CAN_CLK_A, SEL_RCAN_CLK_0),
1266 	PINMUX_IPSR_MSEL(IP10_22, RX4_D, SEL_SCIF4_3),
1267 
1268 	PINMUX_IPSR_MSEL(IP10_24_23, CAN0_TX_A, SEL_RCAN0_0),
1269 	PINMUX_IPSR_MSEL(IP10_24_23, TX4_D, SEL_SCIF4_3),
1270 	PINMUX_IPSR_GPSR(IP10_24_23, MLB_CLK),
1271 
1272 	PINMUX_IPSR_MSEL(IP10_25, CAN1_RX_A, SEL_RCAN1_0),
1273 	PINMUX_IPSR_MSEL(IP10_25, IRQ1_B, SEL_INTC_1),
1274 
1275 	PINMUX_IPSR_MSEL(IP10_27_26, CAN0_RX_A, SEL_RCAN0_0),
1276 	PINMUX_IPSR_MSEL(IP10_27_26, IRQ0_B, SEL_INTC_1),
1277 	PINMUX_IPSR_GPSR(IP10_27_26, MLB_SIG),
1278 
1279 	PINMUX_IPSR_MSEL(IP10_29_28, CAN1_TX_A, SEL_RCAN1_0),
1280 	PINMUX_IPSR_MSEL(IP10_29_28, TX5_C, SEL_SCIF1_2),
1281 	PINMUX_IPSR_GPSR(IP10_29_28, MLB_DAT),
1282 
1283 	/* IPSR11 */
1284 	PINMUX_IPSR_GPSR(IP11_0, SCL1),
1285 	PINMUX_IPSR_MSEL(IP11_0, SCIF_CLK_C, SEL_SCIF_CLK_2),
1286 
1287 	PINMUX_IPSR_GPSR(IP11_1, SDA1),
1288 	PINMUX_IPSR_MSEL(IP11_0, RX1_E, SEL_SCIF1_4),
1289 
1290 	PINMUX_IPSR_GPSR(IP11_2, SDA0),
1291 	PINMUX_IPSR_MSEL(IP11_2, HIFEBL_A, SEL_HIF_0),
1292 
1293 	PINMUX_IPSR_GPSR(IP11_3, SDSELF),
1294 	PINMUX_IPSR_MSEL(IP11_3, RTS1_E, SEL_SCIF1_3),
1295 
1296 	PINMUX_IPSR_MSEL(IP11_6_4, SCIF_CLK_A, SEL_SCIF_CLK_0),
1297 	PINMUX_IPSR_MSEL(IP11_6_4, HSPI_CLK_A, SEL_HSPI_0),
1298 	PINMUX_IPSR_GPSR(IP11_6_4, VI0_CLK),
1299 	PINMUX_IPSR_MSEL(IP11_6_4, RMII0_TXD0_A, SEL_RMII_0),
1300 	PINMUX_IPSR_GPSR(IP11_6_4, ET0_ERXD4),
1301 
1302 	PINMUX_IPSR_MSEL(IP11_9_7, SCK0_A, SEL_SCIF0_0),
1303 	PINMUX_IPSR_MSEL(IP11_9_7, HSPI_CS_A, SEL_HSPI_0),
1304 	PINMUX_IPSR_GPSR(IP11_9_7, VI0_CLKENB),
1305 	PINMUX_IPSR_MSEL(IP11_9_7, RMII0_TXD1_A, SEL_RMII_0),
1306 	PINMUX_IPSR_GPSR(IP11_9_7, ET0_ERXD5),
1307 
1308 	PINMUX_IPSR_MSEL(IP11_11_10, RX0_A, SEL_SCIF0_0),
1309 	PINMUX_IPSR_MSEL(IP11_11_10, HSPI_RX_A, SEL_HSPI_0),
1310 	PINMUX_IPSR_MSEL(IP11_11_10, RMII0_RXD0_A, SEL_RMII_0),
1311 	PINMUX_IPSR_GPSR(IP11_11_10, ET0_ERXD6),
1312 
1313 	PINMUX_IPSR_MSEL(IP11_12, TX0_A, SEL_SCIF0_0),
1314 	PINMUX_IPSR_MSEL(IP11_12, HSPI_TX_A, SEL_HSPI_0),
1315 
1316 	PINMUX_IPSR_GPSR(IP11_15_13, PENC1),
1317 	PINMUX_IPSR_MSEL(IP11_15_13, TX3_D, SEL_SCIF3_3),
1318 	PINMUX_IPSR_MSEL(IP11_15_13, CAN1_TX_B,  SEL_RCAN1_1),
1319 	PINMUX_IPSR_MSEL(IP11_15_13, TX5_D, SEL_SCIF5_3),
1320 	PINMUX_IPSR_MSEL(IP11_15_13, IETX_B, SEL_IEBUS_1),
1321 
1322 	PINMUX_IPSR_GPSR(IP11_18_16, USB_OVC1),
1323 	PINMUX_IPSR_MSEL(IP11_18_16, RX3_D, SEL_SCIF3_3),
1324 	PINMUX_IPSR_MSEL(IP11_18_16, CAN1_RX_B, SEL_RCAN1_1),
1325 	PINMUX_IPSR_MSEL(IP11_18_16, RX5_D, SEL_SCIF5_3),
1326 	PINMUX_IPSR_MSEL(IP11_18_16, IERX_B, SEL_IEBUS_1),
1327 
1328 	PINMUX_IPSR_GPSR(IP11_20_19, DREQ0),
1329 	PINMUX_IPSR_MSEL(IP11_20_19, SD1_CLK_A, SEL_SDHI1_0),
1330 	PINMUX_IPSR_GPSR(IP11_20_19, ET0_TX_EN),
1331 
1332 	PINMUX_IPSR_GPSR(IP11_22_21, DACK0),
1333 	PINMUX_IPSR_MSEL(IP11_22_21, SD1_DAT3_A, SEL_SDHI1_0),
1334 	PINMUX_IPSR_GPSR(IP11_22_21, ET0_TX_ER),
1335 
1336 	PINMUX_IPSR_GPSR(IP11_25_23, DREQ1),
1337 	PINMUX_IPSR_MSEL(IP11_25_23, HSPI_CLK_B, SEL_HSPI_1),
1338 	PINMUX_IPSR_MSEL(IP11_25_23, RX4_B, SEL_SCIF4_1),
1339 	PINMUX_IPSR_MSEL(IP11_25_23, ET0_PHY_INT_C, SEL_ET0_CTL_0),
1340 	PINMUX_IPSR_MSEL(IP11_25_23, ET0_TX_CLK_A, SEL_ET0_0),
1341 
1342 	PINMUX_IPSR_GPSR(IP11_27_26, DACK1),
1343 	PINMUX_IPSR_MSEL(IP11_27_26, HSPI_CS_B, SEL_HSPI_1),
1344 	PINMUX_IPSR_MSEL(IP11_27_26, TX4_B, SEL_SCIF3_1),
1345 	PINMUX_IPSR_MSEL(IP11_27_26, ET0_RX_CLK_A, SEL_ET0_0),
1346 
1347 	PINMUX_IPSR_GPSR(IP11_28, PRESETOUT),
1348 	PINMUX_IPSR_GPSR(IP11_28, ST_CLKOUT),
1349 };
1350 
1351 static const struct sh_pfc_pin pinmux_pins[] = {
1352 	PINMUX_GPIO_GP_ALL(),
1353 };
1354 
1355 #define PINMUX_FN_BASE	ARRAY_SIZE(pinmux_pins)
1356 
1357 static const struct pinmux_func pinmux_func_gpios[] = {
1358 	GPIO_FN(CLKOUT), GPIO_FN(BS), GPIO_FN(CS0), GPIO_FN(EX_CS0),
1359 	GPIO_FN(RD), GPIO_FN(WE0), GPIO_FN(WE1),
1360 	GPIO_FN(SCL0), GPIO_FN(PENC0), GPIO_FN(USB_OVC0),
1361 	GPIO_FN(IRQ2_B), GPIO_FN(IRQ3_B),
1362 
1363 	/* IPSR0 */
1364 	GPIO_FN(A0), GPIO_FN(ST0_CLKIN), GPIO_FN(LCD_DATA0_A),
1365 	GPIO_FN(TCLKA_C),
1366 	GPIO_FN(A1), GPIO_FN(ST0_REQ), GPIO_FN(LCD_DATA1_A),
1367 	GPIO_FN(TCLKB_C),
1368 	GPIO_FN(A2), GPIO_FN(ST0_SYC), GPIO_FN(LCD_DATA2_A),
1369 	GPIO_FN(TCLKC_C),
1370 	GPIO_FN(A3), GPIO_FN(ST0_VLD), GPIO_FN(LCD_DATA3_A),
1371 	GPIO_FN(TCLKD_C),
1372 	GPIO_FN(A4), GPIO_FN(ST0_D0), GPIO_FN(LCD_DATA4_A),
1373 	GPIO_FN(TIOC0A_C),
1374 	GPIO_FN(A5), GPIO_FN(ST0_D1), GPIO_FN(LCD_DATA5_A),
1375 	GPIO_FN(TIOC0B_C),
1376 	GPIO_FN(A6), GPIO_FN(ST0_D2), GPIO_FN(LCD_DATA6_A),
1377 	GPIO_FN(TIOC0C_C),
1378 	GPIO_FN(A7), GPIO_FN(ST0_D3), GPIO_FN(LCD_DATA7_A),
1379 	GPIO_FN(TIOC0D_C),
1380 	GPIO_FN(A8), GPIO_FN(ST0_D4), GPIO_FN(LCD_DATA8_A),
1381 	GPIO_FN(TIOC1A_C),
1382 	GPIO_FN(A9), GPIO_FN(ST0_D5), GPIO_FN(LCD_DATA9_A),
1383 	GPIO_FN(TIOC1B_C),
1384 	GPIO_FN(A10), GPIO_FN(ST0_D6), GPIO_FN(LCD_DATA10_A),
1385 	GPIO_FN(TIOC2A_C),
1386 	GPIO_FN(A11), GPIO_FN(ST0_D7), GPIO_FN(LCD_DATA11_A),
1387 	GPIO_FN(TIOC2B_C),
1388 	GPIO_FN(A12), GPIO_FN(LCD_DATA12_A), GPIO_FN(TIOC3A_C),
1389 	GPIO_FN(A13), GPIO_FN(LCD_DATA13_A), GPIO_FN(TIOC3B_C),
1390 	GPIO_FN(A14), GPIO_FN(LCD_DATA14_A), GPIO_FN(TIOC3C_C),
1391 	GPIO_FN(A15), GPIO_FN(ST0_VCO_CLKIN), GPIO_FN(LCD_DATA15_A),
1392 	GPIO_FN(TIOC3D_C),
1393 
1394 	/* IPSR1 */
1395 	GPIO_FN(A16), GPIO_FN(ST0_PWM), GPIO_FN(LCD_DON_A),
1396 	GPIO_FN(TIOC4A_C),
1397 	GPIO_FN(A17), GPIO_FN(ST1_VCO_CLKIN), GPIO_FN(LCD_CL1_A),
1398 	GPIO_FN(TIOC4B_C),
1399 	GPIO_FN(A18), GPIO_FN(ST1_PWM), GPIO_FN(LCD_CL2_A),
1400 	GPIO_FN(TIOC4C_C),
1401 	GPIO_FN(A19), GPIO_FN(ST1_CLKIN), GPIO_FN(LCD_CLK_A),
1402 	GPIO_FN(TIOC4D_C),
1403 	GPIO_FN(A20), GPIO_FN(ST1_REQ), GPIO_FN(LCD_FLM_A),
1404 	GPIO_FN(A21), GPIO_FN(ST1_SYC), GPIO_FN(LCD_VCPWC_A),
1405 	GPIO_FN(A22), GPIO_FN(ST1_VLD), GPIO_FN(LCD_VEPWC_A),
1406 	GPIO_FN(A23), GPIO_FN(ST1_D0), GPIO_FN(LCD_M_DISP_A),
1407 	GPIO_FN(A24), GPIO_FN(RX2_D), GPIO_FN(ST1_D1),
1408 	GPIO_FN(A25), GPIO_FN(TX2_D), GPIO_FN(ST1_D2),
1409 	GPIO_FN(D0), GPIO_FN(SD0_DAT0_A), GPIO_FN(MMC_D0_A),
1410 	GPIO_FN(ST1_D3), GPIO_FN(FD0_A),
1411 	GPIO_FN(D1), GPIO_FN(SD0_DAT1_A), GPIO_FN(MMC_D1_A),
1412 	GPIO_FN(ST1_D4), GPIO_FN(FD1_A),
1413 	GPIO_FN(D2), GPIO_FN(SD0_DAT2_A), GPIO_FN(MMC_D2_A),
1414 	GPIO_FN(ST1_D5), GPIO_FN(FD2_A),
1415 	GPIO_FN(D3), GPIO_FN(SD0_DAT3_A), GPIO_FN(MMC_D3_A),
1416 	GPIO_FN(ST1_D6), GPIO_FN(FD3_A),
1417 
1418 	/* IPSR2 */
1419 	GPIO_FN(D4), GPIO_FN(SD0_CD_A), GPIO_FN(MMC_D4_A), GPIO_FN(ST1_D7),
1420 	GPIO_FN(FD4_A),
1421 	GPIO_FN(D5), GPIO_FN(SD0_WP_A), GPIO_FN(MMC_D5_A), GPIO_FN(FD5_A),
1422 	GPIO_FN(D6), GPIO_FN(RSPI_RSPCK_A), GPIO_FN(MMC_D6_A),
1423 		GPIO_FN(QSPCLK_A),
1424 	GPIO_FN(FD6_A),
1425 	GPIO_FN(D7), GPIO_FN(RSPI_SSL_A), GPIO_FN(MMC_D7_A), GPIO_FN(QSSL_A),
1426 	GPIO_FN(FD7_A),
1427 	GPIO_FN(D8), GPIO_FN(SD0_CLK_A), GPIO_FN(MMC_CLK_A), GPIO_FN(QIO2_A),
1428 	GPIO_FN(FCE_A), GPIO_FN(ET0_GTX_CLK_B),
1429 	GPIO_FN(D9), GPIO_FN(SD0_CMD_A), GPIO_FN(MMC_CMD_A), GPIO_FN(QIO3_A),
1430 	GPIO_FN(FCLE_A), GPIO_FN(ET0_ETXD1_B),
1431 	GPIO_FN(D10), GPIO_FN(RSPI_MOSI_A), GPIO_FN(QMO_QIO0_A),
1432 		GPIO_FN(FALE_A), GPIO_FN(ET0_ETXD2_B),
1433 	GPIO_FN(D11), GPIO_FN(RSPI_MISO_A), GPIO_FN(QMI_QIO1_A), GPIO_FN(FRE_A),
1434 		GPIO_FN(ET0_ETXD3_B),
1435 	GPIO_FN(D12), GPIO_FN(FWE_A), GPIO_FN(ET0_ETXD5_B),
1436 	GPIO_FN(D13), GPIO_FN(RX2_B), GPIO_FN(FRB_A), GPIO_FN(ET0_ETXD6_B),
1437 	GPIO_FN(D14), GPIO_FN(TX2_B), GPIO_FN(FSE_A), GPIO_FN(ET0_TX_CLK_B),
1438 
1439 	/* IPSR3 */
1440 	GPIO_FN(D15), GPIO_FN(SCK2_B),
1441 	GPIO_FN(CS1_A26), GPIO_FN(QIO3_B),
1442 	GPIO_FN(EX_CS1), GPIO_FN(RX3_B), GPIO_FN(ATACS0), GPIO_FN(QIO2_B),
1443 	GPIO_FN(ET0_ETXD0),
1444 	GPIO_FN(EX_CS2), GPIO_FN(TX3_B), GPIO_FN(ATACS1), GPIO_FN(QSPCLK_B),
1445 	GPIO_FN(ET0_GTX_CLK_A),
1446 	GPIO_FN(EX_CS3), GPIO_FN(SD1_CD_A), GPIO_FN(ATARD), GPIO_FN(QMO_QIO0_B),
1447 	GPIO_FN(ET0_ETXD1_A),
1448 	GPIO_FN(EX_CS4), GPIO_FN(SD1_WP_A), GPIO_FN(ATAWR), GPIO_FN(QMI_QIO1_B),
1449 	GPIO_FN(ET0_ETXD2_A),
1450 	GPIO_FN(EX_CS5), GPIO_FN(SD1_CMD_A), GPIO_FN(ATADIR), GPIO_FN(QSSL_B),
1451 	GPIO_FN(ET0_ETXD3_A),
1452 	GPIO_FN(RD_WR), GPIO_FN(TCLK0), GPIO_FN(CAN_CLK_B), GPIO_FN(ET0_ETXD4),
1453 	GPIO_FN(EX_WAIT0), GPIO_FN(TCLK1_B),
1454 	GPIO_FN(EX_WAIT1), GPIO_FN(SD1_DAT0_A), GPIO_FN(DREQ2),
1455 		GPIO_FN(CAN1_TX_C), GPIO_FN(ET0_LINK_C), GPIO_FN(ET0_ETXD5_A),
1456 	GPIO_FN(EX_WAIT2), GPIO_FN(SD1_DAT1_A), GPIO_FN(DACK2),
1457 		GPIO_FN(CAN1_RX_C), GPIO_FN(ET0_MAGIC_C), GPIO_FN(ET0_ETXD6_A),
1458 	GPIO_FN(DRACK0), GPIO_FN(SD1_DAT2_A), GPIO_FN(ATAG), GPIO_FN(TCLK1_A),
1459 	GPIO_FN(ET0_ETXD7),
1460 
1461 	/* IPSR4 */
1462 	GPIO_FN(HCTS0_A), GPIO_FN(CTS1_A), GPIO_FN(VI0_FIELD),
1463 		GPIO_FN(RMII0_RXD1_A), GPIO_FN(ET0_ERXD7),
1464 	GPIO_FN(HRTS0_A), GPIO_FN(RTS1_A), GPIO_FN(VI0_HSYNC),
1465 		GPIO_FN(RMII0_TXD_EN_A), GPIO_FN(ET0_RX_DV),
1466 	GPIO_FN(HSCK0_A), GPIO_FN(SCK1_A), GPIO_FN(VI0_VSYNC),
1467 		GPIO_FN(RMII0_RX_ER_A), GPIO_FN(ET0_RX_ER),
1468 	GPIO_FN(HRX0_A), GPIO_FN(RX1_A), GPIO_FN(VI0_DATA0_VI0_B0),
1469 		GPIO_FN(RMII0_CRS_DV_A), GPIO_FN(ET0_CRS),
1470 	GPIO_FN(HTX0_A), GPIO_FN(TX1_A), GPIO_FN(VI0_DATA1_VI0_B1),
1471 		GPIO_FN(RMII0_MDC_A), GPIO_FN(ET0_COL),
1472 	GPIO_FN(CTS0_B), GPIO_FN(VI0_DATA2_VI0_B2), GPIO_FN(RMII0_MDIO_A),
1473 		GPIO_FN(ET0_MDC),
1474 	GPIO_FN(RTS0_B), GPIO_FN(VI0_DATA3_VI0_B3), GPIO_FN(ET0_MDIO_A),
1475 	GPIO_FN(SCK1_B), GPIO_FN(VI0_DATA4_VI0_B4), GPIO_FN(ET0_LINK_A),
1476 	GPIO_FN(RX1_B), GPIO_FN(VI0_DATA5_VI0_B5), GPIO_FN(ET0_MAGIC_A),
1477 	GPIO_FN(TX1_B), GPIO_FN(VI0_DATA6_VI0_G0), GPIO_FN(ET0_PHY_INT_A),
1478 	GPIO_FN(CTS1_B), GPIO_FN(VI0_DATA7_VI0_G1),
1479 	GPIO_FN(RTS1_B), GPIO_FN(VI0_G2),
1480 	GPIO_FN(SCK2_A), GPIO_FN(VI0_G3),
1481 
1482 	/* IPSR5 */
1483 	GPIO_FN(REF50CK), GPIO_FN(CTS1_E), GPIO_FN(HCTS0_D),
1484 	GPIO_FN(REF125CK), GPIO_FN(ADTRG), GPIO_FN(RX5_C),
1485 	GPIO_FN(SD2_WP_A), GPIO_FN(TX5_A), GPIO_FN(VI0_R5),
1486 	GPIO_FN(SD2_CD_A), GPIO_FN(RX5_A), GPIO_FN(VI0_R4),
1487 		GPIO_FN(ET0_PHY_INT_B),
1488 	GPIO_FN(SD2_DAT3_A), GPIO_FN(TX4_A), GPIO_FN(VI0_R3),
1489 		GPIO_FN(ET0_MAGIC_B),
1490 	GPIO_FN(SD2_DAT2_A), GPIO_FN(RX4_A), GPIO_FN(VI0_R2),
1491 		GPIO_FN(ET0_LINK_B),
1492 	GPIO_FN(SD2_DAT1_A), GPIO_FN(TX3_A), GPIO_FN(VI0_R1),
1493 		GPIO_FN(ET0_MDIO_B),
1494 	GPIO_FN(SD2_DAT0_A), GPIO_FN(RX3_A), GPIO_FN(VI0_R0),
1495 		GPIO_FN(ET0_ERXD3_B),
1496 	GPIO_FN(SD2_CMD_A), GPIO_FN(TX2_A), GPIO_FN(VI0_G5),
1497 		GPIO_FN(ET0_ERXD2_B),
1498 	GPIO_FN(SD2_CLK_A), GPIO_FN(RX2_A), GPIO_FN(VI0_G4),
1499 		GPIO_FN(ET0_RX_CLK_B),
1500 
1501 	/* IPSR6 */
1502 	GPIO_FN(DU0_DG1), GPIO_FN(CTS1_C), GPIO_FN(HRTS0_D),
1503 		GPIO_FN(TIOC1B_A), GPIO_FN(HIFD09),
1504 	GPIO_FN(DU0_DG0), GPIO_FN(TX1_C), GPIO_FN(HSCK0_D),
1505 		GPIO_FN(IECLK_A), GPIO_FN(TIOC1A_A), GPIO_FN(HIFD08),
1506 	GPIO_FN(DU0_DR7), GPIO_FN(RX1_C), GPIO_FN(TIOC0D_A),
1507 		GPIO_FN(HIFD07),
1508 	GPIO_FN(DU0_DR6), GPIO_FN(SCK1_C), GPIO_FN(TIOC0C_A),
1509 		GPIO_FN(HIFD06),
1510 	GPIO_FN(DU0_DR5), GPIO_FN(RTS0_C), GPIO_FN(TIOC0B_A),
1511 		GPIO_FN(HIFD05),
1512 	GPIO_FN(DU0_DR4), GPIO_FN(CTS0_C), GPIO_FN(TIOC0A_A),
1513 		GPIO_FN(HIFD04),
1514 	GPIO_FN(DU0_DR3), GPIO_FN(TX0_B), GPIO_FN(TCLKD_A), GPIO_FN(HIFD03),
1515 	GPIO_FN(DU0_DR2), GPIO_FN(RX0_B), GPIO_FN(TCLKC_A), GPIO_FN(HIFD02),
1516 	GPIO_FN(DU0_DR1), GPIO_FN(SCK0_B), GPIO_FN(HTX0_D),
1517 		GPIO_FN(IERX_A), GPIO_FN(TCLKB_A), GPIO_FN(HIFD01),
1518 	GPIO_FN(DU0_DR0), GPIO_FN(SCIF_CLK_B), GPIO_FN(HRX0_D),
1519 		GPIO_FN(IETX_A), GPIO_FN(TCLKA_A), GPIO_FN(HIFD00),
1520 
1521 	/* IPSR7 */
1522 	GPIO_FN(DU0_DB4), GPIO_FN(HIFINT),
1523 	GPIO_FN(DU0_DB3), GPIO_FN(TX5_B), GPIO_FN(TIOC4D_A), GPIO_FN(HIFRD),
1524 	GPIO_FN(DU0_DB2), GPIO_FN(RX5_B), GPIO_FN(RMII0_TXD1_B),
1525 		GPIO_FN(TIOC4C_A), GPIO_FN(HIFWR),
1526 	GPIO_FN(DU0_DB1), GPIO_FN(TX4_C), GPIO_FN(RMII0_TXD0_B),
1527 		GPIO_FN(TIOC4B_A), GPIO_FN(HIFRS),
1528 	GPIO_FN(DU0_DB0), GPIO_FN(RX4_C), GPIO_FN(RMII0_TXD_EN_B),
1529 		GPIO_FN(TIOC4A_A), GPIO_FN(HIFCS),
1530 	GPIO_FN(DU0_DG7), GPIO_FN(TX3_C), GPIO_FN(RMII0_RXD1_B),
1531 		GPIO_FN(TIOC3D_A), GPIO_FN(HIFD15),
1532 	GPIO_FN(DU0_DG6), GPIO_FN(RX3_C), GPIO_FN(RMII0_RXD0_B),
1533 		GPIO_FN(TIOC3C_A), GPIO_FN(HIFD14),
1534 	GPIO_FN(DU0_DG5), GPIO_FN(TX2_C), GPIO_FN(RMII0_RX_ER_B),
1535 		GPIO_FN(TIOC3B_A), GPIO_FN(HIFD13),
1536 	GPIO_FN(DU0_DG4), GPIO_FN(RX2_C), GPIO_FN(RMII0_CRS_DV_B),
1537 		GPIO_FN(TIOC3A_A), GPIO_FN(HIFD12),
1538 	GPIO_FN(DU0_DG3), GPIO_FN(SCK2_C), GPIO_FN(RMII0_MDIO_B),
1539 		GPIO_FN(TIOC2B_A), GPIO_FN(HIFD11),
1540 	GPIO_FN(DU0_DG2), GPIO_FN(RTS1_C), GPIO_FN(RMII0_MDC_B),
1541 		GPIO_FN(TIOC2A_A), GPIO_FN(HIFD10),
1542 
1543 	/* IPSR8 */
1544 	GPIO_FN(IRQ3_A), GPIO_FN(RTS0_A), GPIO_FN(HRTS0_B),
1545 		GPIO_FN(ET0_ERXD3_A),
1546 	GPIO_FN(IRQ2_A), GPIO_FN(CTS0_A), GPIO_FN(HCTS0_B),
1547 		GPIO_FN(ET0_ERXD2_A),
1548 	GPIO_FN(IRQ1_A), GPIO_FN(HSPI_RX_B), GPIO_FN(TX3_E),
1549 		GPIO_FN(ET0_ERXD1),
1550 	GPIO_FN(IRQ0_A), GPIO_FN(HSPI_TX_B), GPIO_FN(RX3_E),
1551 		GPIO_FN(ET0_ERXD0),
1552 	GPIO_FN(DU0_CDE), GPIO_FN(HTX0_B), GPIO_FN(AUDIO_CLKB_B),
1553 		GPIO_FN(LCD_VCPWC_B),
1554 	GPIO_FN(DU0_DISP), GPIO_FN(CAN0_TX_B), GPIO_FN(HRX0_B),
1555 		GPIO_FN(AUDIO_CLKA_B),
1556 	GPIO_FN(DU0_EXODDF_DU0_ODDF), GPIO_FN(CAN0_RX_B), GPIO_FN(HSCK0_B),
1557 		GPIO_FN(SSI_SDATA1_B),
1558 	GPIO_FN(DU0_EXVSYNC_DU0_VSYNC), GPIO_FN(HSPI_RX0_C),
1559 		GPIO_FN(SSI_WS1_B),
1560 	GPIO_FN(DU0_EXHSYNC_DU0_HSYNC), GPIO_FN(HSPI_TX0_C),
1561 		GPIO_FN(SSI_SCK1_B),
1562 	GPIO_FN(DU0_DOTCLKOUT), GPIO_FN(HSPI_CLK0_C),
1563 		GPIO_FN(SSI_SDATA0_B),
1564 	GPIO_FN(DU0_DOTCLKIN), GPIO_FN(HSPI_CS0_C),
1565 		GPIO_FN(SSI_WS0_B),
1566 	GPIO_FN(DU0_DB7), GPIO_FN(SSI_SCK0_B), GPIO_FN(HIFEBL_B),
1567 	GPIO_FN(DU0_DB6), GPIO_FN(HIFRDY),
1568 	GPIO_FN(DU0_DB5), GPIO_FN(HIFDREQ),
1569 
1570 	/* IPSR9 */
1571 	GPIO_FN(SSI_SDATA1_A), GPIO_FN(VI1_3_B), GPIO_FN(LCD_DATA14_B),
1572 	GPIO_FN(SSI_WS1_A), GPIO_FN(VI1_2_B), GPIO_FN(LCD_DATA13_B),
1573 	GPIO_FN(SSI_SCK1_A), GPIO_FN(VI1_1_B), GPIO_FN(TIOC2B_B),
1574 		GPIO_FN(LCD_DATA12_B),
1575 	GPIO_FN(SSI_SDATA0_A), GPIO_FN(VI1_0_B), GPIO_FN(TIOC2A_B),
1576 		GPIO_FN(LCD_DATA11_B),
1577 	GPIO_FN(SSI_WS0_A), GPIO_FN(TIOC1B_B), GPIO_FN(LCD_DATA10_B),
1578 	GPIO_FN(SSI_SCK0_A), GPIO_FN(TIOC1A_B), GPIO_FN(LCD_DATA9_B),
1579 	GPIO_FN(VI1_7_A), GPIO_FN(FCE_B), GPIO_FN(LCD_DATA8_B),
1580 	GPIO_FN(VI1_6_A), GPIO_FN(FD7_B), GPIO_FN(LCD_DATA7_B),
1581 	GPIO_FN(VI1_5_A), GPIO_FN(FD6_B), GPIO_FN(LCD_DATA6_B),
1582 	GPIO_FN(VI1_4_A), GPIO_FN(FD5_B), GPIO_FN(LCD_DATA5_B),
1583 	GPIO_FN(VI1_3_A), GPIO_FN(FD4_B), GPIO_FN(LCD_DATA4_B),
1584 	GPIO_FN(VI1_2_A), GPIO_FN(FD3_B), GPIO_FN(LCD_DATA3_B),
1585 	GPIO_FN(VI1_1_A), GPIO_FN(FD2_B), GPIO_FN(LCD_DATA2_B),
1586 	GPIO_FN(VI1_0_A), GPIO_FN(FD1_B), GPIO_FN(LCD_DATA1_B),
1587 	GPIO_FN(VI1_CLK_A), GPIO_FN(FD0_B), GPIO_FN(LCD_DATA0_B),
1588 
1589 	/* IPSR10 */
1590 	GPIO_FN(CAN1_TX_A), GPIO_FN(TX5_C), GPIO_FN(MLB_DAT),
1591 	GPIO_FN(CAN0_RX_A), GPIO_FN(IRQ0_B), GPIO_FN(MLB_SIG),
1592 	GPIO_FN(CAN1_RX_A), GPIO_FN(IRQ1_B),
1593 	GPIO_FN(CAN0_TX_A), GPIO_FN(TX4_D), GPIO_FN(MLB_CLK),
1594 	GPIO_FN(CAN_CLK_A), GPIO_FN(RX4_D),
1595 	GPIO_FN(AUDIO_CLKOUT), GPIO_FN(TX1_E), GPIO_FN(HRTS0_C),
1596 		GPIO_FN(FSE_B), GPIO_FN(LCD_M_DISP_B),
1597 	GPIO_FN(AUDIO_CLKC), GPIO_FN(SCK1_E), GPIO_FN(HCTS0_C),
1598 		GPIO_FN(FRB_B), GPIO_FN(LCD_VEPWC_B),
1599 	GPIO_FN(AUDIO_CLKB_A), GPIO_FN(LCD_CLK_B),
1600 	GPIO_FN(AUDIO_CLKA_A), GPIO_FN(VI1_CLK_B), GPIO_FN(SCK1_D),
1601 		GPIO_FN(IECLK_B), GPIO_FN(LCD_FLM_B),
1602 	GPIO_FN(SSI_SDATA3), GPIO_FN(VI1_7_B), GPIO_FN(HTX0_C),
1603 		GPIO_FN(FWE_B), GPIO_FN(LCD_CL2_B),
1604 	GPIO_FN(SSI_SDATA2), GPIO_FN(VI1_6_B), GPIO_FN(HRX0_C),
1605 		GPIO_FN(FRE_B), GPIO_FN(LCD_CL1_B),
1606 	GPIO_FN(SSI_WS23), GPIO_FN(VI1_5_B), GPIO_FN(TX1_D),
1607 		GPIO_FN(HSCK0_C), GPIO_FN(FALE_B), GPIO_FN(LCD_DON_B),
1608 	GPIO_FN(SSI_SCK23), GPIO_FN(VI1_4_B), GPIO_FN(RX1_D),
1609 		GPIO_FN(FCLE_B), GPIO_FN(LCD_DATA15_B),
1610 
1611 	/* IPSR11 */
1612 	GPIO_FN(PRESETOUT), GPIO_FN(ST_CLKOUT),
1613 	GPIO_FN(DACK1), GPIO_FN(HSPI_CS_B), GPIO_FN(TX4_B),
1614 		GPIO_FN(ET0_RX_CLK_A),
1615 	GPIO_FN(DREQ1), GPIO_FN(HSPI_CLK_B), GPIO_FN(RX4_B),
1616 		GPIO_FN(ET0_PHY_INT_C), GPIO_FN(ET0_TX_CLK_A),
1617 	GPIO_FN(DACK0), GPIO_FN(SD1_DAT3_A), GPIO_FN(ET0_TX_ER),
1618 	GPIO_FN(DREQ0), GPIO_FN(SD1_CLK_A), GPIO_FN(ET0_TX_EN),
1619 	GPIO_FN(USB_OVC1), GPIO_FN(RX3_D), GPIO_FN(CAN1_RX_B),
1620 		GPIO_FN(RX5_D), GPIO_FN(IERX_B),
1621 	GPIO_FN(PENC1), GPIO_FN(TX3_D), GPIO_FN(CAN1_TX_B),
1622 		GPIO_FN(TX5_D), GPIO_FN(IETX_B),
1623 	GPIO_FN(TX0_A), GPIO_FN(HSPI_TX_A),
1624 	GPIO_FN(RX0_A), GPIO_FN(HSPI_RX_A), GPIO_FN(RMII0_RXD0_A),
1625 		GPIO_FN(ET0_ERXD6),
1626 	GPIO_FN(SCK0_A), GPIO_FN(HSPI_CS_A), GPIO_FN(VI0_CLKENB),
1627 		GPIO_FN(RMII0_TXD1_A), GPIO_FN(ET0_ERXD5),
1628 	GPIO_FN(SCIF_CLK_A), GPIO_FN(HSPI_CLK_A), GPIO_FN(VI0_CLK),
1629 		GPIO_FN(RMII0_TXD0_A), GPIO_FN(ET0_ERXD4),
1630 	GPIO_FN(SDSELF), GPIO_FN(RTS1_E),
1631 	GPIO_FN(SDA0), GPIO_FN(HIFEBL_A),
1632 	GPIO_FN(SDA1), GPIO_FN(RX1_E),
1633 	GPIO_FN(SCL1), GPIO_FN(SCIF_CLK_C),
1634 };
1635 
1636 static const struct pinmux_cfg_reg pinmux_config_regs[] = {
1637 	{ PINMUX_CFG_REG("GPSR0", 0xFFFC0004, 32, 1, GROUP(
1638 		GP_0_31_FN, FN_IP2_2_0,
1639 		GP_0_30_FN, FN_IP1_31_29,
1640 		GP_0_29_FN, FN_IP1_28_26,
1641 		GP_0_28_FN, FN_IP1_25_23,
1642 		GP_0_27_FN, FN_IP1_22_20,
1643 		GP_0_26_FN, FN_IP1_19_18,
1644 		GP_0_25_FN, FN_IP1_17_16,
1645 		GP_0_24_FN, FN_IP0_5_4,
1646 		GP_0_23_FN, FN_IP0_3_2,
1647 		GP_0_22_FN, FN_IP0_1_0,
1648 		GP_0_21_FN, FN_IP11_28,
1649 		GP_0_20_FN, FN_IP1_7_6,
1650 		GP_0_19_FN, FN_IP1_5_4,
1651 		GP_0_18_FN, FN_IP1_3_2,
1652 		GP_0_17_FN, FN_IP1_1_0,
1653 		GP_0_16_FN, FN_IP0_31_30,
1654 		GP_0_15_FN, FN_IP0_29_28,
1655 		GP_0_14_FN, FN_IP0_27_26,
1656 		GP_0_13_FN, FN_IP0_25_24,
1657 		GP_0_12_FN, FN_IP0_23_22,
1658 		GP_0_11_FN, FN_IP0_21_20,
1659 		GP_0_10_FN, FN_IP0_19_18,
1660 		GP_0_9_FN, FN_IP0_17_16,
1661 		GP_0_8_FN, FN_IP0_15_14,
1662 		GP_0_7_FN, FN_IP0_13_12,
1663 		GP_0_6_FN, FN_IP0_11_10,
1664 		GP_0_5_FN, FN_IP0_9_8,
1665 		GP_0_4_FN, FN_IP0_7_6,
1666 		GP_0_3_FN, FN_IP1_15_14,
1667 		GP_0_2_FN, FN_IP1_13_12,
1668 		GP_0_1_FN, FN_IP1_11_10,
1669 		GP_0_0_FN, FN_IP1_9_8 ))
1670 	},
1671 	{ PINMUX_CFG_REG("GPSR1", 0xFFFC0008, 32, 1, GROUP(
1672 		GP_1_31_FN, FN_IP11_25_23,
1673 		GP_1_30_FN, FN_IP2_13_11,
1674 		GP_1_29_FN, FN_IP2_10_8,
1675 		GP_1_28_FN, FN_IP2_7_5,
1676 		GP_1_27_FN, FN_IP3_26_24,
1677 		GP_1_26_FN, FN_IP3_23_21,
1678 		GP_1_25_FN, FN_IP2_4_3,
1679 		GP_1_24_FN, FN_WE1,
1680 		GP_1_23_FN, FN_WE0,
1681 		GP_1_22_FN, FN_IP3_19_18,
1682 		GP_1_21_FN, FN_RD,
1683 		GP_1_20_FN, FN_IP3_17_15,
1684 		GP_1_19_FN, FN_IP3_14_12,
1685 		GP_1_18_FN, FN_IP3_11_9,
1686 		GP_1_17_FN, FN_IP3_8_6,
1687 		GP_1_16_FN, FN_IP3_5_3,
1688 		GP_1_15_FN, FN_EX_CS0,
1689 		GP_1_14_FN, FN_IP3_2,
1690 		GP_1_13_FN, FN_CS0,
1691 		GP_1_12_FN, FN_BS,
1692 		GP_1_11_FN, FN_CLKOUT,
1693 		GP_1_10_FN, FN_IP3_1_0,
1694 		GP_1_9_FN, FN_IP2_30_28,
1695 		GP_1_8_FN, FN_IP2_27_25,
1696 		GP_1_7_FN, FN_IP2_24_23,
1697 		GP_1_6_FN, FN_IP2_22_20,
1698 		GP_1_5_FN, FN_IP2_19_17,
1699 		GP_1_4_FN, FN_IP2_16_14,
1700 		GP_1_3_FN, FN_IP11_22_21,
1701 		GP_1_2_FN, FN_IP11_20_19,
1702 		GP_1_1_FN, FN_IP3_29_27,
1703 		GP_1_0_FN, FN_IP3_20 ))
1704 	},
1705 	{ PINMUX_CFG_REG("GPSR2", 0xFFFC000C, 32, 1, GROUP(
1706 		GP_2_31_FN, FN_IP4_31_30,
1707 		GP_2_30_FN, FN_IP5_2_0,
1708 		GP_2_29_FN, FN_IP5_5_3,
1709 		GP_2_28_FN, FN_IP5_8_6,
1710 		GP_2_27_FN, FN_IP5_11_9,
1711 		GP_2_26_FN, FN_IP5_14_12,
1712 		GP_2_25_FN, FN_IP5_17_15,
1713 		GP_2_24_FN, FN_IP5_20_18,
1714 		GP_2_23_FN, FN_IP5_22_21,
1715 		GP_2_22_FN, FN_IP5_24_23,
1716 		GP_2_21_FN, FN_IP5_26_25,
1717 		GP_2_20_FN, FN_IP4_29_28,
1718 		GP_2_19_FN, FN_IP4_27_26,
1719 		GP_2_18_FN, FN_IP4_25_24,
1720 		GP_2_17_FN, FN_IP4_23_22,
1721 		GP_2_16_FN, FN_IP4_21_20,
1722 		GP_2_15_FN, FN_IP4_19_18,
1723 		GP_2_14_FN, FN_IP4_17_15,
1724 		GP_2_13_FN, FN_IP4_14_12,
1725 		GP_2_12_FN, FN_IP4_11_9,
1726 		GP_2_11_FN, FN_IP4_8_6,
1727 		GP_2_10_FN, FN_IP4_5_3,
1728 		GP_2_9_FN, FN_IP8_27_26,
1729 		GP_2_8_FN, FN_IP11_12,
1730 		GP_2_7_FN, FN_IP8_25_23,
1731 		GP_2_6_FN, FN_IP8_22_20,
1732 		GP_2_5_FN, FN_IP11_27_26,
1733 		GP_2_4_FN, FN_IP8_29_28,
1734 		GP_2_3_FN, FN_IP4_2_0,
1735 		GP_2_2_FN, FN_IP11_11_10,
1736 		GP_2_1_FN, FN_IP11_9_7,
1737 		GP_2_0_FN, FN_IP11_6_4 ))
1738 	},
1739 	{ PINMUX_CFG_REG("GPSR3", 0xFFFC0010, 32, 1, GROUP(
1740 		GP_3_31_FN, FN_IP9_1_0,
1741 		GP_3_30_FN, FN_IP8_19_18,
1742 		GP_3_29_FN, FN_IP8_17_16,
1743 		GP_3_28_FN, FN_IP8_15_14,
1744 		GP_3_27_FN, FN_IP8_13_12,
1745 		GP_3_26_FN, FN_IP8_11_10,
1746 		GP_3_25_FN, FN_IP8_9_8,
1747 		GP_3_24_FN, FN_IP8_7_6,
1748 		GP_3_23_FN, FN_IP8_5_4,
1749 		GP_3_22_FN, FN_IP8_3_2,
1750 		GP_3_21_FN, FN_IP8_1_0,
1751 		GP_3_20_FN, FN_IP7_30_29,
1752 		GP_3_19_FN, FN_IP7_28_27,
1753 		GP_3_18_FN, FN_IP7_26_24,
1754 		GP_3_17_FN, FN_IP7_23_21,
1755 		GP_3_16_FN, FN_IP7_20_18,
1756 		GP_3_15_FN, FN_IP7_17_15,
1757 		GP_3_14_FN, FN_IP7_14_12,
1758 		GP_3_13_FN, FN_IP7_11_9,
1759 		GP_3_12_FN, FN_IP7_8_6,
1760 		GP_3_11_FN, FN_IP7_5_3,
1761 		GP_3_10_FN, FN_IP7_2_0,
1762 		GP_3_9_FN, FN_IP6_23_21,
1763 		GP_3_8_FN, FN_IP6_20_18,
1764 		GP_3_7_FN, FN_IP6_17_16,
1765 		GP_3_6_FN, FN_IP6_15_14,
1766 		GP_3_5_FN, FN_IP6_13_12,
1767 		GP_3_4_FN, FN_IP6_11_10,
1768 		GP_3_3_FN, FN_IP6_9_8,
1769 		GP_3_2_FN, FN_IP6_7_6,
1770 		GP_3_1_FN, FN_IP6_5_3,
1771 		GP_3_0_FN, FN_IP6_2_0 ))
1772 	},
1773 
1774 	{ PINMUX_CFG_REG("GPSR4", 0xFFFC0014, 32, 1, GROUP(
1775 		GP_4_31_FN, FN_IP10_24_23,
1776 		GP_4_30_FN, FN_IP10_22,
1777 		GP_4_29_FN, FN_IP11_18_16,
1778 		GP_4_28_FN, FN_USB_OVC0,
1779 		GP_4_27_FN, FN_IP11_15_13,
1780 		GP_4_26_FN, FN_PENC0,
1781 		GP_4_25_FN, FN_IP11_2,
1782 		GP_4_24_FN, FN_SCL0,
1783 		GP_4_23_FN, FN_IP11_1,
1784 		GP_4_22_FN, FN_IP11_0,
1785 		GP_4_21_FN, FN_IP10_21_19,
1786 		GP_4_20_FN, FN_IP10_18_16,
1787 		GP_4_19_FN, FN_IP10_15,
1788 		GP_4_18_FN, FN_IP10_14_12,
1789 		GP_4_17_FN, FN_IP10_11_9,
1790 		GP_4_16_FN, FN_IP10_8_6,
1791 		GP_4_15_FN, FN_IP10_5_3,
1792 		GP_4_14_FN, FN_IP10_2_0,
1793 		GP_4_13_FN, FN_IP9_29_28,
1794 		GP_4_12_FN, FN_IP9_27_26,
1795 		GP_4_11_FN, FN_IP9_9_8,
1796 		GP_4_10_FN, FN_IP9_7_6,
1797 		GP_4_9_FN, FN_IP9_5_4,
1798 		GP_4_8_FN, FN_IP9_3_2,
1799 		GP_4_7_FN, FN_IP9_17_16,
1800 		GP_4_6_FN, FN_IP9_15_14,
1801 		GP_4_5_FN, FN_IP9_13_12,
1802 		GP_4_4_FN, FN_IP9_11_10,
1803 		GP_4_3_FN, FN_IP9_25_24,
1804 		GP_4_2_FN, FN_IP9_23_22,
1805 		GP_4_1_FN, FN_IP9_21_20,
1806 		GP_4_0_FN, FN_IP9_19_18 ))
1807 	},
1808 	{ PINMUX_CFG_REG_VAR("GPSR5", 0xFFFC0018, 32,
1809 			     GROUP(-20, 1, 1, -6, 1, 1, 1, 1),
1810 			     GROUP(
1811 		/* GP5_31_12 RESERVED */
1812 		GP_5_11_FN, FN_IP10_29_28,
1813 		GP_5_10_FN, FN_IP10_27_26,
1814 		/* GP5_9_4 RESERVED */
1815 		GP_5_3_FN, FN_IRQ3_B,
1816 		GP_5_2_FN, FN_IRQ2_B,
1817 		GP_5_1_FN, FN_IP11_3,
1818 		GP_5_0_FN, FN_IP10_25 ))
1819 	},
1820 
1821 	{ PINMUX_CFG_REG_VAR("IPSR0", 0xFFFC001C, 32,
1822 			GROUP(2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2),
1823 			GROUP(
1824 		/* IP0_31_30 [2] */
1825 		FN_A15, FN_ST0_VCO_CLKIN, FN_LCD_DATA15_A,
1826 			FN_TIOC3D_C,
1827 		/* IP0_29_28 [2] */
1828 		FN_A14, FN_LCD_DATA14_A, FN_TIOC3C_C, 0,
1829 		/* IP0_27_26 [2] */
1830 		FN_A13, FN_LCD_DATA13_A, FN_TIOC3B_C, 0,
1831 		/* IP0_25_24 [2] */
1832 		FN_A12, FN_LCD_DATA12_A, FN_TIOC3A_C, 0,
1833 		/* IP0_23_22 [2] */
1834 		FN_A11, FN_ST0_D7, FN_LCD_DATA11_A, FN_TIOC2B_C,
1835 		/* IP0_21_20 [2] */
1836 		FN_A10, FN_ST0_D6, FN_LCD_DATA10_A, FN_TIOC2A_C,
1837 		/* IP0_19_18 [2] */
1838 		FN_A9, FN_ST0_D5, FN_LCD_DATA9_A, FN_TIOC1B_C,
1839 		/* IP0_17_16 [2] */
1840 		FN_A8, FN_ST0_D4, FN_LCD_DATA8_A, FN_TIOC1A_C,
1841 		/* IP0_15_14 [2] */
1842 		FN_A7, FN_ST0_D3, FN_LCD_DATA7_A, FN_TIOC0D_C,
1843 		/* IP0_13_12 [2] */
1844 		FN_A6, FN_ST0_D2, FN_LCD_DATA6_A, FN_TIOC0C_C,
1845 		/* IP0_11_10 [2] */
1846 		FN_A5, FN_ST0_D1, FN_LCD_DATA5_A, FN_TIOC0B_C,
1847 		/* IP0_9_8 [2] */
1848 		FN_A4, FN_ST0_D0, FN_LCD_DATA4_A, FN_TIOC0A_C,
1849 		/* IP0_7_6 [2] */
1850 		FN_A3, FN_ST0_VLD, FN_LCD_DATA3_A, FN_TCLKD_C,
1851 		/* IP0_5_4 [2] */
1852 		FN_A2, FN_ST0_SYC, FN_LCD_DATA2_A, FN_TCLKC_C,
1853 		/* IP0_3_2 [2] */
1854 		FN_A1, FN_ST0_REQ, FN_LCD_DATA1_A, FN_TCLKB_C,
1855 		/* IP0_1_0 [2] */
1856 		FN_A0, FN_ST0_CLKIN, FN_LCD_DATA0_A, FN_TCLKA_C ))
1857 	},
1858 	{ PINMUX_CFG_REG_VAR("IPSR1", 0xFFFC0020, 32,
1859 			GROUP(3, 3, 3, 3, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2),
1860 			GROUP(
1861 		/* IP1_31_29 [3] */
1862 		FN_D3, FN_SD0_DAT3_A, FN_MMC_D3_A, FN_ST1_D6,
1863 			FN_FD3_A, 0, 0, 0,
1864 		/* IP1_28_26 [3] */
1865 		FN_D2, FN_SD0_DAT2_A, FN_MMC_D2_A, FN_ST1_D5,
1866 			FN_FD2_A, 0, 0, 0,
1867 		/* IP1_25_23 [3] */
1868 		FN_D1, FN_SD0_DAT1_A, FN_MMC_D1_A, FN_ST1_D4,
1869 			FN_FD1_A, 0, 0, 0,
1870 		/* IP1_22_20 [3] */
1871 		FN_D0, FN_SD0_DAT0_A, FN_MMC_D0_A, FN_ST1_D3,
1872 			FN_FD0_A, 0, 0, 0,
1873 		/* IP1_19_18 [2] */
1874 		FN_A25, FN_TX2_D, FN_ST1_D2, 0,
1875 		/* IP1_17_16 [2] */
1876 		FN_A24, FN_RX2_D, FN_ST1_D1, 0,
1877 		/* IP1_15_14 [2] */
1878 		FN_A23, FN_ST1_D0, FN_LCD_M_DISP_A, 0,
1879 		/* IP1_13_12 [2] */
1880 		FN_A22, FN_ST1_VLD, FN_LCD_VEPWC_A, 0,
1881 		/* IP1_11_10 [2] */
1882 		FN_A21, FN_ST1_SYC, FN_LCD_VCPWC_A, 0,
1883 		/* IP1_9_8 [2] */
1884 		FN_A20, FN_ST1_REQ, FN_LCD_FLM_A, 0,
1885 		/* IP1_7_6 [2] */
1886 		FN_A19, FN_ST1_CLKIN, FN_LCD_CLK_A,	FN_TIOC4D_C,
1887 		/* IP1_5_4 [2] */
1888 		FN_A18, FN_ST1_PWM, FN_LCD_CL2_A, FN_TIOC4C_C,
1889 		/* IP1_3_2 [2] */
1890 		FN_A17, FN_ST1_VCO_CLKIN, FN_LCD_CL1_A,	FN_TIOC4B_C,
1891 		/* IP1_1_0 [2] */
1892 		FN_A16, FN_ST0_PWM, FN_LCD_DON_A, FN_TIOC4A_C ))
1893 	},
1894 	{ PINMUX_CFG_REG_VAR("IPSR2", 0xFFFC0024, 32,
1895 			     GROUP(-1, 3, 3, 2, 3, 3, 3, 3, 3, 3, 2, 3),
1896 			     GROUP(
1897 		/* IP2_31 [1] RESERVED */
1898 		/* IP2_30_28 [3] */
1899 		FN_D14, FN_TX2_B, 0, FN_FSE_A,
1900 			FN_ET0_TX_CLK_B, 0, 0, 0,
1901 		/* IP2_27_25 [3] */
1902 		FN_D13, FN_RX2_B, 0, FN_FRB_A,
1903 			FN_ET0_ETXD6_B, 0, 0, 0,
1904 		/* IP2_24_23 [2] */
1905 		FN_D12, 0, FN_FWE_A, FN_ET0_ETXD5_B,
1906 		/* IP2_22_20 [3] */
1907 		FN_D11, FN_RSPI_MISO_A, 0, FN_QMI_QIO1_A,
1908 			FN_FRE_A, FN_ET0_ETXD3_B, 0, 0,
1909 		/* IP2_19_17 [3] */
1910 		FN_D10, FN_RSPI_MOSI_A, 0, FN_QMO_QIO0_A,
1911 			FN_FALE_A, FN_ET0_ETXD2_B, 0, 0,
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1913 		FN_D9, FN_SD0_CMD_A, FN_MMC_CMD_A, FN_QIO3_A,
1914 			FN_FCLE_A, FN_ET0_ETXD1_B, 0, 0,
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1916 		FN_D8, FN_SD0_CLK_A, FN_MMC_CLK_A, FN_QIO2_A,
1917 			FN_FCE_A, FN_ET0_GTX_CLK_B, 0, 0,
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1919 		FN_D7, FN_RSPI_SSL_A, FN_MMC_D7_A, FN_QSSL_A,
1920 			FN_FD7_A, 0, 0, 0,
1921 		/* IP2_7_5 [3] */
1922 		FN_D6, FN_RSPI_RSPCK_A, FN_MMC_D6_A, FN_QSPCLK_A,
1923 			FN_FD6_A, 0, 0, 0,
1924 		/* IP2_4_3 [2] */
1925 		FN_D5, FN_SD0_WP_A, FN_MMC_D5_A, FN_FD5_A,
1926 		/* IP2_2_0 [3] */
1927 		FN_D4, FN_SD0_CD_A, FN_MMC_D4_A, FN_ST1_D7,
1928 			FN_FD4_A, 0, 0, 0 ))
1929 	},
1930 	{ PINMUX_CFG_REG_VAR("IPSR3", 0xFFFC0028, 32,
1931 			     GROUP(-2, 3, 3, 3, 1, 2, 3, 3, 3, 3, 3, 1, 2),
1932 			     GROUP(
1933 	    /* IP3_31_30 [2] RESERVED */
1934 	    /* IP3_29_27 [3] */
1935 		FN_DRACK0, FN_SD1_DAT2_A, FN_ATAG, FN_TCLK1_A,
1936 		FN_ET0_ETXD7, 0, 0, 0,
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1939 		FN_ET0_MAGIC_C, FN_ET0_ETXD6_A, 0, 0,
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1941 		FN_EX_WAIT1, FN_SD1_DAT0_A, FN_DREQ2, FN_CAN1_TX_C,
1942 		FN_ET0_LINK_C, FN_ET0_ETXD5_A, 0, 0,
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1944 		FN_EX_WAIT0, FN_TCLK1_B,
1945 	    /* IP3_19_18 [2] */
1946 		FN_RD_WR, FN_TCLK0, FN_CAN_CLK_B, FN_ET0_ETXD4,
1947 	    /* IP3_17_15 [3] */
1948 		FN_EX_CS5, FN_SD1_CMD_A, FN_ATADIR, FN_QSSL_B,
1949 		FN_ET0_ETXD3_A, 0, 0, 0,
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1954 		FN_EX_CS3, FN_SD1_CD_A, FN_ATARD, FN_QMO_QIO0_B,
1955 		FN_ET0_ETXD1_A, 0, 0, 0,
1956 	    /* IP3_8_6 [3] */
1957 		FN_EX_CS2, FN_TX3_B, FN_ATACS1, FN_QSPCLK_B,
1958 		FN_ET0_GTX_CLK_A, 0, 0, 0,
1959 	    /* IP3_5_3 [3] */
1960 		FN_EX_CS1, FN_RX3_B, FN_ATACS0, FN_QIO2_B,
1961 		FN_ET0_ETXD0, 0, 0, 0,
1962 	    /* IP3_2 [1] */
1963 		FN_CS1_A26, FN_QIO3_B,
1964 	    /* IP3_1_0 [2] */
1965 		FN_D15, FN_SCK2_B, 0, 0 ))
1966 	},
1967 	{ PINMUX_CFG_REG_VAR("IPSR4", 0xFFFC002C, 32,
1968 			     GROUP(2, 2, 2, 2, 2, 2, 2, 3, 3, 3, 3, 3, 3),
1969 			     GROUP(
1970 	    /* IP4_31_30 [2] */
1971 		0, FN_SCK2_A, FN_VI0_G3, 0,
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1988 		FN_HTX0_A, FN_TX1_A, FN_VI0_DATA1_VI0_B1, FN_RMII0_MDC_A,
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1992 			FN_ET0_CRS, 0, 0, 0,
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1994 		FN_HSCK0_A, FN_SCK1_A, FN_VI0_VSYNC, FN_RMII0_RX_ER_A,
1995 			FN_ET0_RX_ER, 0, 0, 0,
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1997 		FN_HRTS0_A, FN_RTS1_A, FN_VI0_HSYNC, FN_RMII0_TXD_EN_A,
1998 			FN_ET0_RX_DV, 0, 0, 0,
1999 	    /* IP4_2_0 [3] */
2000 		FN_HCTS0_A, FN_CTS1_A, FN_VI0_FIELD, FN_RMII0_RXD1_A,
2001 			FN_ET0_ERXD7, 0, 0, 0 ))
2002 	},
2003 	{ PINMUX_CFG_REG_VAR("IPSR5", 0xFFFC0030, 32,
2004 			     GROUP(-5, 2, 2, 2, 3, 3, 3, 3, 3, 3, 3),
2005 			     GROUP(
2006 	    /* IP5_31_27 [5] RESERVED */
2007 	    /* IP5_26_25 [2] */
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2032 		FN_SD2_CLK_A, FN_RX2_A, FN_VI0_G4, 0,
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2034 	},
2035 	{ PINMUX_CFG_REG_VAR("IPSR6", 0xFFFC0034, 32,
2036 			     GROUP(-8, 3, 3, 2, 2, 2, 2, 2, 2, 3, 3),
2037 			     GROUP(
2038 	    /* IP5_31_24 [8] RESERVED */
2039 	    /* IP6_23_21 [3] */
2040 		FN_DU0_DG1, FN_CTS1_C, FN_HRTS0_D, FN_TIOC1B_A,
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2058 		FN_DU0_DR1, FN_SCK0_B, FN_HTX0_D, FN_IERX_A,
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2061 		FN_DU0_DR0, FN_SCIF_CLK_B, FN_HRX0_D, FN_IETX_A,
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2063 	},
2064 	{ PINMUX_CFG_REG_VAR("IPSR7", 0xFFFC0038, 32,
2065 			     GROUP(-1, 2, 2, 3, 3, 3, 3, 3, 3, 3, 3, 3),
2066 			     GROUP(
2067 	    /* IP7_31 [1] RESERVED */
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2101 			     GROUP(-2, 2, 2, 3, 3, 2, 2, 2, 2, 2, 2, 2,
2102 				   2, 2, 2),
2103 			     GROUP(
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2135 		FN_DU0_DB5, 0, FN_HIFDREQ, 0 ))
2136 	},
2137 	{ PINMUX_CFG_REG_VAR("IPSR9", 0xFFFC0040, 32,
2138 			     GROUP(-2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2, 2,
2139 				   2, 2, 2, 2),
2140 			     GROUP(
2141 	    /* IP9_31_30 [2] RESERVED */
2142 	    /* IP9_29_28 [2] */
2143 		FN_SSI_SDATA1_A, FN_VI1_3_B, FN_LCD_DATA14_B, 0,
2144 	    /* IP9_27_26 [2] */
2145 		FN_SSI_WS1_A, FN_VI1_2_B, FN_LCD_DATA13_B, 0,
2146 	    /* IP9_25_24 [2] */
2147 		FN_SSI_SCK1_A, FN_VI1_1_B, FN_TIOC2B_B, FN_LCD_DATA12_B,
2148 	    /* IP9_23_22 [2] */
2149 		FN_SSI_SDATA0_A, FN_VI1_0_B, FN_TIOC2A_B, FN_LCD_DATA11_B,
2150 	    /* IP9_21_20 [2] */
2151 		FN_SSI_WS0_A, FN_TIOC1B_B, FN_LCD_DATA10_B, 0,
2152 	    /* IP9_19_18 [2] */
2153 		FN_SSI_SCK0_A, FN_TIOC1A_B, FN_LCD_DATA9_B, 0,
2154 	    /* IP9_17_16 [2] */
2155 		FN_VI1_7_A, FN_FCE_B, FN_LCD_DATA8_B, 0,
2156 	    /* IP9_15_14 [2] */
2157 		FN_VI1_6_A, 0, FN_FD7_B, FN_LCD_DATA7_B,
2158 	    /* IP9_13_12 [2] */
2159 		FN_VI1_5_A, 0, FN_FD6_B, FN_LCD_DATA6_B,
2160 	    /* IP9_11_10 [2] */
2161 		FN_VI1_4_A, 0, FN_FD5_B, FN_LCD_DATA5_B,
2162 	    /* IP9_9_8 [2] */
2163 		FN_VI1_3_A, 0, FN_FD4_B, FN_LCD_DATA4_B,
2164 	    /* IP9_7_6 [2] */
2165 		FN_VI1_2_A, 0, FN_FD3_B, FN_LCD_DATA3_B,
2166 	    /* IP9_5_4 [2] */
2167 		FN_VI1_1_A, 0, FN_FD2_B, FN_LCD_DATA2_B,
2168 	    /* IP9_3_2 [2] */
2169 		FN_VI1_0_A, 0, FN_FD1_B, FN_LCD_DATA1_B,
2170 	    /* IP9_1_0 [2] */
2171 		FN_VI1_CLK_A, 0, FN_FD0_B, FN_LCD_DATA0_B ))
2172 	},
2173 	{ PINMUX_CFG_REG_VAR("IPSR10", 0xFFFC0044, 32,
2174 			     GROUP(-2, 2, 2, 1, 2, 1, 3, 3, 1, 3, 3, 3, 3, 3),
2175 			     GROUP(
2176 	    /* IP9_31_30 [2] RESERVED */
2177 	    /* IP10_29_28 [2] */
2178 		FN_CAN1_TX_A, FN_TX5_C, FN_MLB_DAT, 0,
2179 	    /* IP10_27_26 [2] */
2180 		FN_CAN0_RX_A, FN_IRQ0_B, FN_MLB_SIG, 0,
2181 	    /* IP10_25 [1] */
2182 		FN_CAN1_RX_A, FN_IRQ1_B,
2183 	    /* IP10_24_23 [2] */
2184 		FN_CAN0_TX_A, FN_TX4_D, FN_MLB_CLK, 0,
2185 	    /* IP10_22 [1] */
2186 		FN_CAN_CLK_A, FN_RX4_D,
2187 	    /* IP10_21_19 [3] */
2188 		FN_AUDIO_CLKOUT, FN_TX1_E, 0, FN_HRTS0_C, FN_FSE_B,
2189 		FN_LCD_M_DISP_B, 0, 0,
2190 	    /* IP10_18_16 [3] */
2191 		FN_AUDIO_CLKC, FN_SCK1_E, 0, FN_HCTS0_C, FN_FRB_B,
2192 		FN_LCD_VEPWC_B, 0, 0,
2193 	    /* IP10_15 [1] */
2194 		FN_AUDIO_CLKB_A, FN_LCD_CLK_B,
2195 	    /* IP10_14_12 [3] */
2196 		FN_AUDIO_CLKA_A, FN_VI1_CLK_B, FN_SCK1_D, FN_IECLK_B,
2197 		FN_LCD_FLM_B, 0, 0, 0,
2198 	    /* IP10_11_9 [3] */
2199 		FN_SSI_SDATA3, FN_VI1_7_B, 0, FN_HTX0_C, FN_FWE_B,
2200 		FN_LCD_CL2_B, 0, 0,
2201 	    /* IP10_8_6 [3] */
2202 		FN_SSI_SDATA2, FN_VI1_6_B, 0, FN_HRX0_C, FN_FRE_B,
2203 		FN_LCD_CL1_B, 0, 0,
2204 	    /* IP10_5_3 [3] */
2205 		FN_SSI_WS23, FN_VI1_5_B, FN_TX1_D, FN_HSCK0_C, FN_FALE_B,
2206 		FN_LCD_DON_B, 0, 0,
2207 	    /* IP10_2_0 [3] */
2208 		FN_SSI_SCK23, FN_VI1_4_B, FN_RX1_D, FN_FCLE_B,
2209 		FN_LCD_DATA15_B, 0, 0, 0 ))
2210 	},
2211 	{ PINMUX_CFG_REG_VAR("IPSR11", 0xFFFC0048, 32,
2212 			     GROUP(-3, 1, 2, 3, 2, 2, 3, 3, 1, 2, 3, 3,
2213 				   1, 1, 1, 1),
2214 			     GROUP(
2215 	    /* IP11_31_29 [3] RESERVED */
2216 	    /* IP11_28 [1] */
2217 		FN_PRESETOUT, FN_ST_CLKOUT,
2218 	    /* IP11_27_26 [2] */
2219 		FN_DACK1, FN_HSPI_CS_B, FN_TX4_B, FN_ET0_RX_CLK_A,
2220 	    /* IP11_25_23 [3] */
2221 		FN_DREQ1, FN_HSPI_CLK_B, FN_RX4_B, FN_ET0_PHY_INT_C,
2222 		FN_ET0_TX_CLK_A, 0, 0, 0,
2223 	    /* IP11_22_21 [2] */
2224 		FN_DACK0, FN_SD1_DAT3_A, FN_ET0_TX_ER, 0,
2225 	    /* IP11_20_19 [2] */
2226 		FN_DREQ0, FN_SD1_CLK_A, FN_ET0_TX_EN, 0,
2227 	    /* IP11_18_16 [3] */
2228 		FN_USB_OVC1, FN_RX3_D, FN_CAN1_RX_B, FN_RX5_D,
2229 		FN_IERX_B, 0, 0, 0,
2230 	    /* IP11_15_13 [3] */
2231 		FN_PENC1, FN_TX3_D, FN_CAN1_TX_B, FN_TX5_D,
2232 		FN_IETX_B, 0, 0, 0,
2233 	    /* IP11_12 [1] */
2234 		FN_TX0_A, FN_HSPI_TX_A,
2235 	    /* IP11_11_10 [2] */
2236 		FN_RX0_A, FN_HSPI_RX_A, FN_RMII0_RXD0_A, FN_ET0_ERXD6,
2237 	    /* IP11_9_7 [3] */
2238 		FN_SCK0_A, FN_HSPI_CS_A, FN_VI0_CLKENB, FN_RMII0_TXD1_A,
2239 		FN_ET0_ERXD5, 0, 0, 0,
2240 	    /* IP11_6_4 [3] */
2241 		FN_SCIF_CLK_A, FN_HSPI_CLK_A, FN_VI0_CLK, FN_RMII0_TXD0_A,
2242 		FN_ET0_ERXD4, 0, 0, 0,
2243 	    /* IP11_3 [1] */
2244 		FN_SDSELF, FN_RTS1_E,
2245 	    /* IP11_2 [1] */
2246 		FN_SDA0, FN_HIFEBL_A,
2247 	    /* IP11_1 [1] */
2248 		FN_SDA1, FN_RX1_E,
2249 	    /* IP11_0 [1] */
2250 		FN_SCL1, FN_SCIF_CLK_C ))
2251 	},
2252 	{ PINMUX_CFG_REG_VAR("MOD_SEL1", 0xFFFC004C, 32,
2253 			     GROUP(-3, 1, 1, 1, 1, 1, 1, 2, 1, 1, 1, 2,
2254 				   2, 1, 2, 1, 1, 1, 1, 1, 1, 1, 1, 1, 1, 1),
2255 			     GROUP(
2256 		/* SEL1_31_29 [3] RESERVED */
2257 		/* SEL1_28 [1] */
2258 		FN_SEL_IEBUS_0, FN_SEL_IEBUS_1,
2259 		/* SEL1_27 [1] */
2260 		FN_SEL_RQSPI_0, FN_SEL_RQSPI_1,
2261 		/* SEL1_26 [1] */
2262 		FN_SEL_VIN1_0, FN_SEL_VIN1_1,
2263 		/* SEL1_25 [1] */
2264 		FN_SEL_HIF_0, FN_SEL_HIF_1,
2265 		/* SEL1_24 [1] */
2266 		FN_SEL_RSPI_0, FN_SEL_RSPI_1,
2267 		/* SEL1_23 [1] */
2268 		FN_SEL_LCDC_0, FN_SEL_LCDC_1,
2269 		/* SEL1_22_21 [2] */
2270 		FN_SEL_ET0_CTL_0, FN_SEL_ET0_CTL_1, FN_SEL_ET0_CTL_2, 0,
2271 		/* SEL1_20 [1] */
2272 		FN_SEL_ET0_0, FN_SEL_ET0_1,
2273 		/* SEL1_19 [1] */
2274 		FN_SEL_RMII_0, FN_SEL_RMII_1,
2275 		/* SEL1_18 [1] */
2276 		FN_SEL_TMU_0, FN_SEL_TMU_1,
2277 		/* SEL1_17_16 [2] */
2278 		FN_SEL_HSPI_0, FN_SEL_HSPI_1, FN_SEL_HSPI_2, 0,
2279 		/* SEL1_15_14 [2] */
2280 		FN_SEL_HSCIF_0, FN_SEL_HSCIF_1, FN_SEL_HSCIF_2, FN_SEL_HSCIF_3,
2281 		/* SEL1_13 [1] */
2282 		FN_SEL_RCAN_CLK_0, FN_SEL_RCAN_CLK_1,
2283 		/* SEL1_12_11 [2] */
2284 		FN_SEL_RCAN1_0, FN_SEL_RCAN1_1, FN_SEL_RCAN1_2, 0,
2285 		/* SEL1_10 [1] */
2286 		FN_SEL_RCAN0_0, FN_SEL_RCAN0_1,
2287 		/* SEL1_9 [1] */
2288 		FN_SEL_SDHI2_0, FN_SEL_SDHI2_1,
2289 		/* SEL1_8 [1] */
2290 		FN_SEL_SDHI1_0, FN_SEL_SDHI1_1,
2291 		/* SEL1_7 [1] */
2292 		FN_SEL_SDHI0_0, FN_SEL_SDHI0_1,
2293 		/* SEL1_6 [1] */
2294 		FN_SEL_SSI1_0, FN_SEL_SSI1_1,
2295 		/* SEL1_5 [1] */
2296 		FN_SEL_SSI0_0, FN_SEL_SSI0_1,
2297 		/* SEL1_4 [1] */
2298 		FN_SEL_AUDIO_CLKB_0, FN_SEL_AUDIO_CLKB_1,
2299 		/* SEL1_3 [1] */
2300 		FN_SEL_AUDIO_CLKA_0, FN_SEL_AUDIO_CLKA_1,
2301 		/* SEL1_2 [1] */
2302 		FN_SEL_FLCTL_0, FN_SEL_FLCTL_1,
2303 		/* SEL1_1 [1] */
2304 		FN_SEL_MMC_0, FN_SEL_MMC_1,
2305 		/* SEL1_0 [1] */
2306 		FN_SEL_INTC_0, FN_SEL_INTC_1 ))
2307 	},
2308 	{ PINMUX_CFG_REG_VAR("MOD_SEL2", 0xFFFC0050, 32,
2309 			     GROUP(-8, 1, 1, 1, 2, 2, 1, 2, 2, 3, 2, 3, 2, 2),
2310 			     GROUP(
2311 		/* SEL2_31_24 [8] RESERVED */
2312 		/* SEL2_23 [1] */
2313 		FN_SEL_MTU2_CLK_0, FN_SEL_MTU2_CLK_1,
2314 		/* SEL2_22 [1] */
2315 		FN_SEL_MTU2_CH4_0, FN_SEL_MTU2_CH4_1,
2316 		/* SEL2_21 [1] */
2317 		FN_SEL_MTU2_CH3_0, FN_SEL_MTU2_CH3_1,
2318 		/* SEL2_20_19 [2] */
2319 		FN_SEL_MTU2_CH2_0, FN_SEL_MTU2_CH2_1, FN_SEL_MTU2_CH2_2, 0,
2320 		/* SEL2_18_17 [2] */
2321 		FN_SEL_MTU2_CH1_0, FN_SEL_MTU2_CH1_1, FN_SEL_MTU2_CH1_2, 0,
2322 		/* SEL2_16 [1] */
2323 		FN_SEL_MTU2_CH0_0, FN_SEL_MTU2_CH0_1,
2324 		/* SEL2_15_14 [2] */
2325 		FN_SEL_SCIF5_0, FN_SEL_SCIF5_1, FN_SEL_SCIF5_2, FN_SEL_SCIF5_3,
2326 		/* SEL2_13_12 [2] */
2327 		FN_SEL_SCIF4_0, FN_SEL_SCIF4_1, FN_SEL_SCIF4_2, FN_SEL_SCIF4_3,
2328 		/* SEL2_11_9 [3] */
2329 		FN_SEL_SCIF3_0, FN_SEL_SCIF3_1, FN_SEL_SCIF3_2, FN_SEL_SCIF3_3,
2330 		FN_SEL_SCIF3_4, 0, 0, 0,
2331 		/* SEL2_8_7 [2] */
2332 		FN_SEL_SCIF2_0, FN_SEL_SCIF2_1, FN_SEL_SCIF2_2, FN_SEL_SCIF2_3,
2333 		/* SEL2_6_4 [3] */
2334 		FN_SEL_SCIF1_0, FN_SEL_SCIF1_1, FN_SEL_SCIF1_2, FN_SEL_SCIF1_3,
2335 			FN_SEL_SCIF1_4, 0, 0, 0,
2336 		/* SEL2_3_2 [2] */
2337 		FN_SEL_SCIF0_0, FN_SEL_SCIF0_1, FN_SEL_SCIF0_2, 0,
2338 		/* SEL2_1_0 [2] */
2339 		FN_SEL_SCIF_CLK_0, FN_SEL_SCIF_CLK_1, FN_SEL_SCIF_CLK_2, 0  ))
2340 	},
2341 	/* GPIO 0 - 5*/
2342 	{ PINMUX_CFG_REG("INOUTSEL0", 0xFFC40004, 32, 1, GROUP(GP_INOUTSEL(0)))
2343 	},
2344 	{ PINMUX_CFG_REG("INOUTSEL1", 0xFFC41004, 32, 1, GROUP(GP_INOUTSEL(1)))
2345 	},
2346 	{ PINMUX_CFG_REG("INOUTSEL2", 0xFFC42004, 32, 1, GROUP(GP_INOUTSEL(2)))
2347 	},
2348 	{ PINMUX_CFG_REG("INOUTSEL3", 0xFFC43004, 32, 1, GROUP(GP_INOUTSEL(3)))
2349 	},
2350 	{ PINMUX_CFG_REG("INOUTSEL4", 0xFFC44004, 32, 1, GROUP(GP_INOUTSEL(4)))
2351 	},
2352 	{ PINMUX_CFG_REG_VAR("INOUTSEL5", 0xffc45004, 32,
2353 			     GROUP(-20, 1, 1, 1, 1, 1, 1, 1, 1, 1, 1, 1, 1),
2354 			     GROUP(
2355 		/* GP5_31_12 RESERVED */
2356 		GP_5_11_IN, GP_5_11_OUT,
2357 		GP_5_10_IN, GP_5_10_OUT,
2358 		GP_5_9_IN, GP_5_9_OUT,
2359 		GP_5_8_IN, GP_5_8_OUT,
2360 		GP_5_7_IN, GP_5_7_OUT,
2361 		GP_5_6_IN, GP_5_6_OUT,
2362 		GP_5_5_IN, GP_5_5_OUT,
2363 		GP_5_4_IN, GP_5_4_OUT,
2364 		GP_5_3_IN, GP_5_3_OUT,
2365 		GP_5_2_IN, GP_5_2_OUT,
2366 		GP_5_1_IN, GP_5_1_OUT,
2367 		GP_5_0_IN, GP_5_0_OUT ))
2368 	},
2369 	{ /* sentinel */ }
2370 };
2371 
2372 static const struct pinmux_data_reg pinmux_data_regs[] = {
2373 	/* GPIO 0 - 5*/
2374 	{ PINMUX_DATA_REG("INDT0", 0xFFC4000C, 32, GROUP(GP_INDT(0))) },
2375 	{ PINMUX_DATA_REG("INDT1", 0xFFC4100C, 32, GROUP(GP_INDT(1))) },
2376 	{ PINMUX_DATA_REG("INDT2", 0xFFC4200C, 32, GROUP(GP_INDT(2))) },
2377 	{ PINMUX_DATA_REG("INDT3", 0xFFC4300C, 32, GROUP(GP_INDT(3))) },
2378 	{ PINMUX_DATA_REG("INDT4", 0xFFC4400C, 32, GROUP(GP_INDT(4))) },
2379 	{ PINMUX_DATA_REG("INDT5", 0xFFC4500C, 32, GROUP(
2380 		0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0, 0,
2381 		0, 0, 0, 0,
2382 		GP_5_11_DATA, GP_5_10_DATA, GP_5_9_DATA, GP_5_8_DATA,
2383 		GP_5_7_DATA, GP_5_6_DATA, GP_5_5_DATA, GP_5_4_DATA,
2384 		GP_5_3_DATA, GP_5_2_DATA, GP_5_1_DATA, GP_5_0_DATA ))
2385 	},
2386 	{ /* sentinel */ }
2387 };
2388 
2389 const struct sh_pfc_soc_info sh7734_pinmux_info = {
2390 	.name = "sh7734_pfc",
2391 
2392 	.unlock_reg = 0xFFFC0000,
2393 
2394 	.input = { PINMUX_INPUT_BEGIN, PINMUX_INPUT_END },
2395 	.output = { PINMUX_OUTPUT_BEGIN, PINMUX_OUTPUT_END },
2396 	.function = { PINMUX_FUNCTION_BEGIN, PINMUX_FUNCTION_END },
2397 
2398 	.pins = pinmux_pins,
2399 	.nr_pins = ARRAY_SIZE(pinmux_pins),
2400 	.func_gpios = pinmux_func_gpios,
2401 	.nr_func_gpios = ARRAY_SIZE(pinmux_func_gpios),
2402 
2403 	.cfg_regs = pinmux_config_regs,
2404 	.data_regs = pinmux_data_regs,
2405 
2406 	.pinmux_data = pinmux_data,
2407 	.pinmux_data_size = ARRAY_SIZE(pinmux_data),
2408 };
2409