1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ 2 /* 3 * Copyright (c) 2020, The Linux Foundation. All rights reserved. 4 * Copyright (c) 2021, Linaro Limited 5 */ 6 7 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8450_H 8 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8450_H 9 10 /* GCC HW clocks */ 11 #define PCIE_0_PIPE_CLK 1 12 #define PCIE_1_PHY_AUX_CLK 2 13 #define PCIE_1_PIPE_CLK 3 14 #define UFS_PHY_RX_SYMBOL_0_CLK 4 15 #define UFS_PHY_RX_SYMBOL_1_CLK 5 16 #define UFS_PHY_TX_SYMBOL_0_CLK 6 17 #define USB3_PHY_WRAPPER_GCC_USB30_PIPE_CLK 7 18 19 /* GCC clocks */ 20 #define GCC_AGGRE_NOC_PCIE_0_AXI_CLK 8 21 #define GCC_AGGRE_NOC_PCIE_1_AXI_CLK 9 22 #define GCC_AGGRE_UFS_PHY_AXI_CLK 10 23 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 11 24 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 12 25 #define GCC_ANOC_PCIE_PWRCTL_CLK 13 26 #define GCC_BOOT_ROM_AHB_CLK 14 27 #define GCC_CAMERA_AHB_CLK 15 28 #define GCC_CAMERA_HF_AXI_CLK 16 29 #define GCC_CAMERA_SF_AXI_CLK 17 30 #define GCC_CAMERA_XO_CLK 18 31 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK 19 32 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK 20 33 #define GCC_CPUSS_AHB_CLK 21 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GCC_PCIE_1_PHY_BCR 12 215 #define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR 13 216 #define GCC_PCIE_PHY_BCR 14 217 #define GCC_PCIE_PHY_CFG_AHB_BCR 15 218 #define GCC_PCIE_PHY_COM_BCR 16 219 #define GCC_PDM_BCR 17 220 #define GCC_QUPV3_WRAPPER_0_BCR 18 221 #define GCC_QUPV3_WRAPPER_1_BCR 19 222 #define GCC_QUPV3_WRAPPER_2_BCR 20 223 #define GCC_QUSB2PHY_PRIM_BCR 21 224 #define GCC_QUSB2PHY_SEC_BCR 22 225 #define GCC_SDCC2_BCR 23 226 #define GCC_SDCC4_BCR 24 227 #define GCC_UFS_PHY_BCR 25 228 #define GCC_USB30_PRIM_BCR 26 229 #define GCC_USB3_DP_PHY_PRIM_BCR 27 230 #define GCC_USB3_DP_PHY_SEC_BCR 28 231 #define GCC_USB3_PHY_PRIM_BCR 29 232 #define GCC_USB3_PHY_SEC_BCR 30 233 #define GCC_USB3PHY_PHY_PRIM_BCR 31 234 #define GCC_USB3PHY_PHY_SEC_BCR 32 235 #define GCC_USB_PHY_CFG_AHB2PHY_BCR 33 236 #define GCC_VIDEO_AXI0_CLK_ARES 34 237 #define GCC_VIDEO_AXI1_CLK_ARES 35 238 #define GCC_VIDEO_BCR 36 239 240 /* GCC power domains */ 241 #define PCIE_0_GDSC 0 242 #define PCIE_1_GDSC 1 243 #define UFS_PHY_GDSC 2 244 #define USB30_PRIM_GDSC 3 245 246 #endif 247