xref: /linux/include/dt-bindings/clock/samsung,exynosautov920.h (revision 0cf32b1f37180bba9b7d2c54e902eadc44a4f7a7)
1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
2 /*
3  * Copyright (c) 2024 Samsung Electronics Co., Ltd.
4  * Author: Sunyeal Hong <sunyeal.hong@samsung.com>
5  *
6  * Device Tree binding constants for ExynosAuto v920 clock controller.
7  */
8 
9 #ifndef _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H
10 #define _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H
11 
12 /* CMU_TOP */
13 #define FOUT_SHARED0_PLL		1
14 #define FOUT_SHARED1_PLL		2
15 #define FOUT_SHARED2_PLL		3
16 #define FOUT_SHARED3_PLL		4
17 #define FOUT_SHARED4_PLL		5
18 #define FOUT_SHARED5_PLL		6
19 #define FOUT_MMC_PLL			7
20 
21 /* MUX in CMU_TOP */
22 #define MOUT_SHARED0_PLL		8
23 #define MOUT_SHARED1_PLL		9
24 #define MOUT_SHARED2_PLL		10
25 #define MOUT_SHARED3_PLL		11
26 #define MOUT_SHARED4_PLL		12
27 #define MOUT_SHARED5_PLL		13
28 #define MOUT_MMC_PLL			14
29 #define MOUT_CLKCMU_CMU_BOOST		15
30 #define MOUT_CLKCMU_CMU_CMUREF		16
31 #define MOUT_CLKCMU_ACC_NOC		17
32 #define MOUT_CLKCMU_ACC_ORB		18
33 #define MOUT_CLKCMU_APM_NOC		19
34 #define MOUT_CLKCMU_AUD_CPU		20
35 #define MOUT_CLKCMU_AUD_NOC		21
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37 #define MOUT_CLKCMU_CPUCL0_CLUSTER	23
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40 #define MOUT_CLKCMU_CPUCL1_CLUSTER	26
41 #define MOUT_CLKCMU_CPUCL2_SWITCH	27
42 #define MOUT_CLKCMU_CPUCL2_CLUSTER	28
43 #define MOUT_CLKCMU_DNC_NOC		29
44 #define MOUT_CLKCMU_DPTX_NOC		30
45 #define MOUT_CLKCMU_DPTX_DPGTC		31
46 #define MOUT_CLKCMU_DPTX_DPOSC		32
47 #define MOUT_CLKCMU_DPUB_NOC		33
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49 #define MOUT_CLKCMU_DPUF0_NOC		35
50 #define MOUT_CLKCMU_DPUF1_NOC		36
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57 #define MOUT_CLKCMU_HSI1_NOC		43
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79 #define MOUT_CLKCMU_PERIC1_IP		65
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82 #define MOUT_CLKCMU_SSP_NOC		68
83 #define MOUT_CLKCMU_TAA_NOC		69
84 
85 /* DIV in CMU_TOP */
86 #define DOUT_SHARED0_DIV1		70
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88 #define DOUT_SHARED0_DIV3		72
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110 #define DOUT_CLKCMU_CMU_BOOST		94
111 #define DOUT_CLKCMU_ACC_NOC		95
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114 #define DOUT_CLKCMU_AUD_CPU		98
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148 #define DOUT_CLKCMU_MFC_WFD		132
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151 #define DOUT_CLKCMU_MISC_NOC		135
152 #define DOUT_CLKCMU_NOCL0_NOC		136
153 #define DOUT_CLKCMU_NOCL1_NOC		137
154 #define DOUT_CLKCMU_NOCL2_NOC		138
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163 #define DOUT_TCXO_DIV2			147
164 
165 /* CMU_PERIC0 */
166 #define CLK_MOUT_PERIC0_IP_USER		1
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179 
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190 #define CLK_DOUT_PERIC0_I3C		24
191 
192 /* CMU_PERIC1 */
193 #define CLK_MOUT_PERIC1_IP_USER		1
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206 
207 #define CLK_DOUT_PERIC1_USI09_USI	14
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217 #define CLK_DOUT_PERIC1_I3C		24
218 
219 /* CMU_MISC */
220 #define CLK_MOUT_MISC_NOC_USER		1
221 #define CLK_MOUT_MISC_GIC		2
222 
223 #define CLK_DOUT_MISC_OTP		3
224 #define CLK_DOUT_MISC_NOCP		4
225 #define CLK_DOUT_MISC_OSC_DIV2		5
226 
227 /* CMU_HSI0 */
228 #define CLK_MOUT_HSI0_NOC_USER		1
229 
230 #define CLK_DOUT_HSI0_PCIE_APB		2
231 
232 /* CMU_HSI1 */
233 #define CLK_MOUT_HSI1_MMC_CARD_USER	1
234 #define CLK_MOUT_HSI1_NOC_USER		2
235 #define CLK_MOUT_HSI1_USBDRD_USER	3
236 #define CLK_MOUT_HSI1_USBDRD		4
237 
238 #endif /* _DT_BINDINGS_CLOCK_EXYNOSAUTOV920_H */
239