Home
last modified time | relevance | path

Searched refs:regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX (Results 1 – 10 of 10) sorted by relevance

/linux/drivers/gpu/drm/amd/include/asic_reg/dpcs/
H A Ddpcs_3_1_4_offset.h7167 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddpcs_4_2_3_offset.h89 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddpcs_4_2_2_offset.h72 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddpcs_4_2_0_offset.h85 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_3_1_5_offset.h12289 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddcn_3_5_1_offset.h10411 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddcn_3_5_0_offset.h10432 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddcn_3_1_4_offset.h11533 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddcn_3_1_2_offset.h12424 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro
H A Ddcn_3_1_6_offset.h13020 #define regPWRSEQ0_PANEL_PWRSEQ_REF_DIV1_BASE_IDX … macro