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Searched refs:regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX (Results 1 – 9 of 9) sorted by relevance

/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_3_2_0_offset.h4426 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_1_5_offset.h5565 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_5_1_offset.h5695 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_5_0_offset.h5716 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_1_4_offset.h6715 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_1_2_offset.h5806 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_2_1_offset.h4425 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_3_1_6_offset.h6026 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro
H A Ddcn_4_1_0_offset.h4829 #define regCNVC_CFG3_PRE_CSC_C31_C32_BASE_IDX … macro