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107 union cvmx_pcie_address pcie_addr; in cvmx_pcie_get_io_base_address() local108 pcie_addr.u64 = 0; in cvmx_pcie_get_io_base_address()109 pcie_addr.io.upper = 0; in cvmx_pcie_get_io_base_address()110 pcie_addr.io.io = 1; in cvmx_pcie_get_io_base_address()111 pcie_addr.io.did = 3; in cvmx_pcie_get_io_base_address()112 pcie_addr.io.subdid = 2; in cvmx_pcie_get_io_base_address()113 pcie_addr.io.es = 1; in cvmx_pcie_get_io_base_address()114 pcie_addr.io.port = pcie_port; in cvmx_pcie_get_io_base_address()115 return pcie_addr.u64; in cvmx_pcie_get_io_base_address()141 union cvmx_pcie_address pcie_addr; in cvmx_pcie_get_mem_base_address() local[all …]
619 u64 axi_addr, u64 pcie_addr, u64 size) in mc_pcie_setup_inbound_atr() argument628 val = ALIGN_DOWN(lower_32_bits(pcie_addr), SZ_4K); in mc_pcie_setup_inbound_atr()634 writel(upper_32_bits(pcie_addr), table_addr + ATR0_PCIE_WIN0_SRC_ADDR); in mc_pcie_setup_inbound_atr()