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42 val |= VIAI2C_CR_CPU_RDY; in viai2c_write()54 val |= VIAI2C_CR_CPU_RDY; in viai2c_write()72 val |= VIAI2C_CR_CPU_RDY; in viai2c_read()88 val |= VIAI2C_CR_CPU_RDY; in viai2c_read()145 val = readw(base + VIAI2C_REG_CR) | VIAI2C_CR_CPU_RDY; in viai2c_irq_xfer()156 val = VIAI2C_CR_TX_END | VIAI2C_CR_CPU_RDY | VIAI2C_CR_ENABLE; in viai2c_irq_xfer()168 writew(VIAI2C_CR_CPU_RDY | VIAI2C_CR_ENABLE, base + VIAI2C_REG_CR); in viai2c_irq_xfer()
19 #define VIAI2C_CR_CPU_RDY BIT(3) macro
134 iowrite8(tmp |= VIAI2C_CR_CPU_RDY, base + VIAI2C_REG_CR); in viai2c_fifo_irq_xfer()