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Searched refs:OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT (Results 1 – 16 of 16) sorted by relevance

/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_2_0_3_sh_mask.h15554 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_0_3_sh_mask.h15729 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_1_0_sh_mask.h22995 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_0_1_sh_mask.h24414 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_2_1_sh_mask.h25790 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_2_1_0_sh_mask.h28874 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_5_1_sh_mask.h22173 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_5_0_sh_mask.h22194 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_1_2_sh_mask.h30731 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_1_5_sh_mask.h28696 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_1_6_sh_mask.h31495 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_1_4_sh_mask.h32628 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_0_2_sh_mask.h27802 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_2_0_0_sh_mask.h32219 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_0_0_sh_mask.h31351 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro
H A Ddcn_3_2_0_sh_mask.h25814 #define OTG1_OTG_CLOCK_CONTROL__OTG_SOFT_RESET__SHIFT macro