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Searched refs:GENFC_WT__VSYNC_SEL_W__SHIFT (Results 1 – 18 of 18) sorted by relevance

/linux/drivers/gpu/drm/amd/include/asic_reg/dce/
H A Ddce_6_0_sh_mask.h7156 #define GENFC_WT__VSYNC_SEL_W__SHIFT 0x00000003 macro
H A Ddce_8_0_sh_mask.h10634 #define GENFC_WT__VSYNC_SEL_W__SHIFT 0x3 macro
H A Ddce_11_0_sh_mask.h10830 #define GENFC_WT__VSYNC_SEL_W__SHIFT 0x3 macro
H A Ddce_10_0_sh_mask.h11018 #define GENFC_WT__VSYNC_SEL_W__SHIFT 0x3 macro
H A Ddce_11_2_sh_mask.h12084 #define GENFC_WT__VSYNC_SEL_W__SHIFT 0x3 macro
H A Ddce_12_0_sh_mask.h2182 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_3_0_3_sh_mask.h219 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_1_0_sh_mask.h821 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_0_1_sh_mask.h316 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_2_1_sh_mask.h4417 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_1_2_sh_mask.h316 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_1_5_sh_mask.h5132 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_1_6_sh_mask.h329 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_1_4_sh_mask.h7771 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_0_2_sh_mask.h232 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_2_0_0_sh_mask.h232 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_0_0_sh_mask.h213 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro
H A Ddcn_3_2_0_sh_mask.h4416 #define GENFC_WT__VSYNC_SEL_W__SHIFT macro