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/freebsd/contrib/llvm-project/llvm/utils/TableGen/Common/
H A DCodeGenRegisters.h47 class CodeGenRegBank; variable
150 void updateComponents(CodeGenRegBank &);
193 void buildObjectGraph(CodeGenRegBank &);
197 const SubRegMap &computeSubRegs(CodeGenRegBank &);
200 void computeSecondarySubRegs(CodeGenRegBank &);
204 void computeSuperRegs(CodeGenRegBank &);
213 CodeGenRegBank &) const;
272 bool inheritRegUnits(CodeGenRegBank &RegBank);
279 unsigned getWeight(const CodeGenRegBank &RegBank) const;
328 void inheritProperties(CodeGenRegBank &);
[all …]
H A DCodeGenRegisters.cpp79 void CodeGenSubRegIndex::updateComponents(CodeGenRegBank &RegBank) { in updateComponents()
170 void CodeGenRegister::buildObjectGraph(CodeGenRegBank &RegBank) { in buildObjectGraph()
264 bool CodeGenRegister::inheritRegUnits(CodeGenRegBank &RegBank) { in inheritRegUnits()
276 CodeGenRegister::computeSubRegs(CodeGenRegBank &RegBank) { in computeSubRegs()
476 void CodeGenRegister::computeSecondarySubRegs(CodeGenRegBank &RegBank) { in computeSecondarySubRegs()
557 void CodeGenRegister::computeSuperRegs(CodeGenRegBank &RegBank) { in computeSuperRegs()
587 SetVector<const CodeGenRegister *> &OSet, CodeGenRegBank &RegBank) const { in addSubRegsPreOrder()
600 unsigned CodeGenRegister::getWeight(const CodeGenRegBank &RegBank) const { in getWeight()
759 CodeGenRegisterClass::CodeGenRegisterClass(CodeGenRegBank &RegBank, Record *R) in CodeGenRegisterClass()
842 CodeGenRegisterClass::CodeGenRegisterClass(CodeGenRegBank &RegBank, in CodeGenRegisterClass()
[all …]
H A DCodeGenTarget.h38 class CodeGenRegBank; variable
63 mutable std::unique_ptr<CodeGenRegBank> RegBank;
122 CodeGenRegBank &getRegBank() const;
127 getSuperRegForSubReg(const ValueTypeByHwMode &Ty, CodeGenRegBank &RegBank,
H A DCodeGenTarget.cpp173 CodeGenRegBank &CodeGenTarget::getRegBank() const { in getRegBank()
175 RegBank = std::make_unique<CodeGenRegBank>(Records, getHwModes()); in getRegBank()
180 const ValueTypeByHwMode &ValueTy, CodeGenRegBank &RegBank, in getSuperRegForSubReg()
/freebsd/contrib/llvm-project/llvm/utils/TableGen/
H A DRegisterBankEmitter.cpp66 const CodeGenRegBank &RegisterClassHierarchy) const { in getExplicitlySpecifiedRegisterClasses()
175 const CodeGenRegBank &RegisterClassHierarchy, in visitRegisterBankClasses()
218 const CodeGenRegBank &RegisterClassHierarchy = Target.getRegBank(); in emitBaseClassImplementation()
296 const CodeGenRegBank &RegisterClassHierarchy = Target.getRegBank(); in run()
H A DRegisterInfoEmitter.cpp64 CodeGenRegBank &RegBank = Target.getRegBank(); in RegisterInfoEmitter()
69 void runEnums(raw_ostream &o, CodeGenTarget &Target, CodeGenRegBank &Bank);
72 void runMCDesc(raw_ostream &o, CodeGenTarget &Target, CodeGenRegBank &Bank);
76 CodeGenRegBank &Bank);
80 CodeGenRegBank &Bank);
93 void EmitRegUnitPressure(raw_ostream &OS, const CodeGenRegBank &RegBank,
95 void emitComposeSubRegIndices(raw_ostream &OS, CodeGenRegBank &RegBank,
97 void emitComposeSubRegIndexLaneMask(raw_ostream &OS, CodeGenRegBank &RegBank,
105 CodeGenRegBank &Bank) { in runEnums()
208 const CodeGenRegBank &RegBank, in EmitRegUnitPressure()
[all …]
H A DDAGISelMatcherGen.cpp724 const CodeGenRegBank &RB = CGP.getTargetInfo().getRegBank(); in EmitResultLeafAsOperand()
H A DGlobalISelEmitter.cpp341 CodeGenRegBank &CGRegs;